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sdrAM

同步動態(tài)隨機存取內(nèi)存（synchronousdynamicrandom-accessmemory，簡稱sdrAM）是有一個同步接口的動態(tài)隨機存取內(nèi)存（DRAM）。通常DRAM是有一個異步接口的，這樣它可以隨時響應(yīng)控制輸入的變化。而sdrAM有一個同步接口，在響應(yīng)控制輸入前會等待一個時鐘信號，這樣就能和計算機的系統(tǒng)總線同步。時鐘被用來驅(qū)動一個有限狀態(tài)機，對進(jìn)入的指令進(jìn)行管線(Pipeline)操作。這使得sdrAM與沒有同步接口的異步DRAM(asynchronousdrAM)相比，可以有一個更復(fù)雜的操作模式。

ddr sdrAM 的控制代碼

ddr sdrAM 的控制代碼，采用VHDL語言書寫

標(biāo)簽： sdrAM ddr 控制代碼

上傳時間： 2014-01-22

上傳用戶：zjf3110
本程序是基于三星公司生產(chǎn)的S3C44B0X編寫的對sdrAM進(jìn)行編程的匯編程序

本程序是基于三星公司生產(chǎn)的S3C44B0X編寫的對sdrAM進(jìn)行編程的匯編程序

標(biāo)簽： S3C44B0X sdrAM 程序三星

上傳時間： 2016-07-12

上傳用戶：cxl274287265
基于FPGA的sdrAM設(shè)計

基于FPGA的sdrAM設(shè)計，相信大家都會感興趣！原版的外文書

標(biāo)簽： sdrAM FPGA

上傳時間： 2016-07-18

上傳用戶：aa17807091
可以用的通用sdrAM控制器,可以用在FPGA上,是SDR類型的

可以用的通用sdrAM控制器,可以用在FPGA上,是SDR類型的

標(biāo)簽： sdrAM FPGA SDR 控制器

上傳時間： 2016-07-23

上傳用戶：woshiayin
PowerPC嵌入式系統(tǒng)中的sdrAM接口設(shè)計,系統(tǒng)以目前應(yīng)用廣泛的PowerPC G4 處理器MPC7410 作為核心處理器,以Tsi107 作為北橋芯片搭建嵌入式系統(tǒng)的硬件平臺。

PowerPC嵌入式系統(tǒng)中的sdrAM接口設(shè)計,系統(tǒng)以目前應(yīng)用廣泛的PowerPC G4 處理器MPC7410 作為核心處理器,以Tsi107 作為北橋芯片搭建嵌入式系統(tǒng)的硬件平臺。

標(biāo)簽： PowerPC sdrAM 7410 107

上傳時間： 2013-12-23

上傳用戶：aeiouetla
針對主控制板上存儲器(SRAM) 存儲的數(shù)據(jù)量小和最高頻率低的情況,提出了基于SDR sdrAM(同步動態(tài)RAM) 作為主存儲器的LED 顯示系統(tǒng)的研究。在實驗中,使用了現(xiàn)場可編程門陣列( FPGA)

針對主控制板上存儲器(SRAM) 存儲的數(shù)據(jù)量小和最高頻率低的情況,提出了基于SDR sdrAM(同步動態(tài)RAM) 作為主存儲器的LED 顯示系統(tǒng)的研究。在實驗中,使用了現(xiàn)場可編程門陣列( FPGA) 來實現(xiàn)各模塊的邏輯功能。最終實現(xiàn)了對L ED 顯示屏的控制,并且一塊主控制板最大限度的控制了256 ×128 個像素點,基于相同條件,比靜態(tài)內(nèi)存控制的面積大了一倍,驗證了動態(tài)內(nèi)存核[7 ]的實用性。

標(biāo)簽： sdrAM SRAM FPGA SDR

上傳時間： 2013-12-18

上傳用戶：c12228
ADI公司BF533處理器格式化sdrAM源代碼。

ADI公司BF533處理器格式化sdrAM源代碼。

標(biāo)簽： sdrAM ADI 533 BF

上傳時間： 2016-07-27

上傳用戶：xuanjie
sdrAM控制器的開發(fā)程序

sdrAM控制器的開發(fā)程序，還有文檔，可以參考以下

標(biāo)簽： sdrAM 控制器程序

上傳時間： 2013-12-21

上傳用戶：stewart·
高速sdrAM控制器

高速sdrAM控制器，并提供仿真測試程序和較詳細(xì)的文檔。

標(biāo)簽： sdrAM 控制器

上傳時間： 2013-12-10

上傳用戶：chenjjer
5402CPU對外部擴展sdrAM的讀取實驗

5402CPU對外部擴展sdrAM的讀取實驗

標(biāo)簽： sdrAM 5402 CPU 擴展

上傳時間： 2014-07-15

上傳用戶：huyiming139

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sdrAM

ddr sdrAM 的控制代碼

本程序是基于三星公司生產(chǎn)的S3C44B0X編寫的對sdrAM進(jìn)行編程的匯編程序

基于FPGA的sdrAM設(shè)計

可以用的通用sdrAM控制器,可以用在FPGA上,是SDR類型的

PowerPC嵌入式系統(tǒng)中的sdrAM接口設(shè)計,系統(tǒng)以目前應(yīng)用廣泛的PowerPC G4 處理器MPC7410 作為核心處理器,以Tsi107 作為北橋芯片搭建嵌入式系統(tǒng)的硬件平臺。

針對主控制板上存儲器(SRAM) 存儲的數(shù)據(jù)量小和最高頻率低的情況,提出了基于SDR sdrAM(同步動態(tài)RAM) 作為主存儲器的LED 顯示系統(tǒng)的研究。在實驗中,使用了現(xiàn)場可編程門陣列( FPGA)

ADI公司BF533處理器格式化sdrAM源代碼。

sdrAM控制器的開發(fā)程序

高速sdrAM控制器

5402CPU對外部擴展sdrAM的讀取實驗