本文主要介紹了verilog HDL 語言的一些基本知識，目的是使初學(xué)者能夠迅速掌握HDL 設(shè)計(jì)方法，初步了解并掌握verilog HDL語言的基本要素，能夠讀懂簡單的設(shè)計(jì)代碼并能 夠進(jìn)行一些簡單設(shè)計(jì)的verilog HDL建模。
標(biāo)簽： Verilog HDL 入門教程
上傳時(shí)間： 2013-05-16
上傳用戶：mosliu
基于FPGA的交通燈的設(shè)計(jì) 有verilog HDL 源碼、仿真圖與引腳配置圖，已下載實(shí)現(xiàn)\r\n
標(biāo)簽： Verilog FPGA HDL 交通燈
上傳時(shí)間： 2013-08-18
上傳用戶：BOBOniu
基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog FPGA HDL 多功能
上傳用戶：問題問題
lab1——FPGA這個(gè)文件中體統(tǒng)了如何如何使用verilog HDL以及如何使其在FPGA開發(fā)板上實(shí)現(xiàn)
標(biāo)簽： verilog FPGA Hdl 如何使用
上傳用戶：qwe1234
這是一個(gè)用verilog HDL語言編寫的交通燈程序。可以用Quartus II運(yùn)行。
標(biāo)簽： Verilog HDL 語言 編寫
上傳時(shí)間： 2013-08-19
上傳用戶：alex wang
verilog HDL代碼，學(xué)習(xí)一顆看一下
標(biāo)簽： Verilog HDl 代碼
上傳用戶：丶灬夏天
通過verilog HDL語言使用CPLD連接PS2鍵盤.
標(biāo)簽： VERILOG CPLD HDL PS2
上傳時(shí)間： 2013-08-21
上傳用戶：1583060504
verilog HDL 編寫的PWM，是初學(xué)CPLD者入門Z資源，epm7128stc100-10
標(biāo)簽： verilog HDL PWM 編寫
上傳時(shí)間： 2013-08-30
上傳用戶：aa54
本原碼是基于verilog HDL語言的FPGA原程序，主要用于測頻率，特點(diǎn)主要是可以更快地測頻。實(shí)時(shí)性更高。
標(biāo)簽： Verilog FPGA HDL 語言
上傳時(shí)間： 2013-09-01
上傳用戶：1417818867
以verilog HDL 語言編寫的一首歌曲，可供初學(xué)者借鑒
標(biāo)簽： verilog HDL 語言 編寫
上傳時(shí)間： 2013-09-05
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