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verilog learning

Verilog HDL編寫的串并轉換。采用iout類型口。包含源文件和測試文件。用Modsim編譯。

Verilog HDL編寫的串并轉換。采用iout類型口。包含源文件和測試文件。用Modsim編譯。

標簽： Verilog Modsim iout HDL

上傳時間： 2014-01-15

上傳用戶：lanwei
A matlab code for a reinforment learning routing problem

A matlab code for a reinforment learning routing problem

標簽： reinforment learning problem routing

上傳時間： 2015-07-19

上傳用戶：zhaoq123
經典計算機體系結構RISC8的源代碼（Verilog）

經典計算機體系結構RISC8的源代碼（Verilog），包括CPU、內存、寄存器等的實現

標簽： Verilog RISC8 計算機體系結構源代碼

上傳時間： 2014-12-05

上傳用戶：daguda
verilog實踐教程（包含2個PDF文檔）

verilog實踐教程（包含2個PDF文檔）

標簽： verilog 實踐教程文檔

上傳時間： 2014-11-01

上傳用戶：小儒尼尼奧
machine learning, accuracy estimation, cross-validation, bootstrap, ID3, decision trees, decision

machine learning, accuracy estimation, cross-validation, bootstrap, ID3, decision trees, decision graphs, naive-bayes, decision tables, majority, induction algorithms, classifiers, categorizers, general logic diagrams, instance-based algorithms, discretization, lazy learning, bagging, MineSet.

標簽： decision cross-validation estimation bootstrap

上傳時間： 2015-07-26

上傳用戶：趙云興
SDRAM 控制器的Verilog代碼經過綜合驗證過的.無截壓密碼

SDRAM 控制器的Verilog代碼經過綜合驗證過的.無截壓密碼

標簽： Verilog SDRAM 控制器代碼

上傳時間： 2013-12-19

上傳用戶：semi1981
verilog 32-bit ALU

verilog 32-bit ALU

標簽： verilog bit ALU 32

上傳時間： 2013-12-18

上傳用戶：yulg
本原碼是基于Verilog HDL語言的FPGA原程序

本原碼是基于Verilog HDL語言的FPGA原程序，主要用于測頻率，特點主要是可以更快地測頻。實時性更高。

標簽： Verilog FPGA HDL 語言

上傳時間： 2015-08-04

上傳用戶：15071087253
本原碼是基于Verilog HDL語言編寫的

本原碼是基于Verilog HDL語言編寫的，實現了SPI接口設計，可以應用于FPGA,實現SPI協議的接口設計.在MAXII編譯成功,用Modelsim SE 6仿真成功.

標簽： Verilog HDL 語言編寫

上傳時間： 2015-08-04

上傳用戶：mikesering
C＋＋編寫的機器學習算法 Lemga is a C++ package which consists of classes for several learning models and gener

C＋＋編寫的機器學習算法 Lemga is a C++ package which consists of classes for several learning models and generic algorithms for optimizing (training) the models

標簽： consists learning classes package

上傳時間： 2014-01-21

上傳用戶：wangchong

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