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verilog-ieee

用verilog 描述的嫡編碼(entropy coding) 應用于圖像壓縮編碼有測試文檔

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用verilog 編寫應用于圖像壓縮編碼中使用行程長度編碼(run lengthencoding,RLE)對交流系數(Aa)進行編碼。

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用verilog 描寫應用于數字圖像壓縮系統--jpeg 有測試文檔

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一個關于DES算法的verilog語言實現,包括了各個實現模塊以及測試模塊

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verilog語言寫的SPI接口,全同步設計,低門數,可以很容易應用到嵌入設計方案中.

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一個非常簡單的cpu設計的原代碼,是用verilog編寫的

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verilog設計進階

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用verilog編寫的pci——rtl級。

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1024點８位FFT的Verilog語言實現

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完整的I2C slave model以及spec詳附在內,適合想利用verilog開發此類傳輸的人參考

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