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verilog-ieee

一篇05年9月IEEE上發表的論文

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是關于dct的Verilog HDL源代碼和測試程序

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MODELSIM 環境下的Verilog 源代碼

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一個用verilog編寫的模擬交通燈控制的源代碼。模擬在十字路口的雙向交通燈。

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使用Verilog語言編寫的數字鐘程序.有慢校時,快校時,鬧鐘等功能.

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此文件采用了verilog語言在cpld中怎樣實現波形發生器

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Arm9指令Cache緩存模塊的verilog代碼

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此代碼是用Verilog實現的以太網接口,在此基礎上做修改,可以作為一般的以太網接口程序開發.

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用verilog語言編寫的全數字鎖相環的源代碼,基于fpga平臺

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采用verilog設計

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