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verilog-ieee

用verilog寫的cpld的各種分頻程序

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This Verilog HDL description implements a UART.

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一個可綜合的串并轉換接口verilog源代碼

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CORDIC算法的硬件實現用的verilog語言

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Verilog HDL編寫的CPU模型

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Verilog HDL編寫的總線功能模型

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一個電子中的verilog實驗源代碼。適合verilog初學者學習參考

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計數器同步異步預置數清零 verilog hdl 編寫

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verilog 教程

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IEEE 1149標準 JTAG,好東東

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