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x-DSP

  • 對Altera 28nm FPGA浮點DSP設計流程和性能的獨立分析

      電子發燒友網核心提示:Altera公司昨日宣布,在業界率先在28 nm FPGA器件上成功測試了復數高性能浮點數字信號處理(DSP)設計。獨立技術分析公司Berkeley設計技術有限公司(BDTI)驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發套件上簡單方便的高效實現Altera浮點DSP設計流程,同時驗證了要求較高的浮點DSP應用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。    Altera的浮點DSP設計流程經過規劃,能夠快速適應可參數賦值接口的設計更改,其工作環境包括來自MathWorks的MATLAB和 Simulink,以及Altera的DSP Builder高級模塊庫,支持FPGA設計人員比傳統HDL設計更迅速的實現并驗證復數浮點算法。這一設計流程非常適合設計人員在應用中采用高性能 DSP,這些應用包括,雷達、無線基站、工業自動化、儀表和醫療圖像等。

    標簽: Altera FPGA DSP 28

    上傳時間: 2015-01-01

    上傳用戶:sunshie

  • Allegro15.X培訓教材

    Allegro15[1].X培訓教材

    標簽: Allegro 15 培訓教材

    上傳時間: 2014-01-08

    上傳用戶:qzhcao

  • 基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現

         本文是基于Arria V和Cyclone V精度可調DSP模塊的高性能DSP應用與實現(英文資料)

    標簽: DSP Cyclone Arria 精度可調

    上傳時間: 2013-10-27

    上傳用戶:yzy6007

  • 基于DSP+FPGA的磁鐵電源控制器的設計

    介紹了一種基于DSP和FPGA的磁鐵電源控制器的設計方案,闡述了該控制器硬件系統的組成,包括信號調理電路、中間數據處理部分、后端的驅動電路。同時給出了DSP和FPGA之間通過SPI接口通信的具體流程和輸出PWM波形死區部分的控制流程。設計的磁鐵電源控制器有很好的控制和運算能力,同時具有很好的靈活性和可靠性。

    標簽: FPGA DSP 磁鐵 電源控制器

    上傳時間: 2013-11-16

    上傳用戶:1051290259

  • Alter FPGA的設計流程以及DSP設計

    Alter FPGA的設計流程以及DSP設計.

    標簽: Alter FPGA DSP 設計流程

    上傳時間: 2013-11-07

    上傳用戶:dudu1210004

  • WP267-Spartan-3A DSP FPGA的高級安全機制

    FPGA 具有輕松集成與支持新協議和新標準以及產品定制的能力,同時仍然可以實現快速的產品面市時間。在互聯網和全球市場環境中,外包制造變得越來越普遍,這使得安全變得更加重要。正如業界領袖出版的文章所述,反向工程、克隆、過度構建以及篡改已經成為主要的安全問題。據專家估計,每年因為假冒產品而造成的經濟損失達數十億美元。國際反盜版聯盟表示,這些假冒產品威脅經濟的發展,并且給全球的消費類市場帶來重大影響。本白皮書將確定設計安全所面臨的主要威脅,探討高級安全選擇,并且介紹Xilinx 的新型、低成本SpartanTM-3A、Spartan-3AN 和Spartan-3A DSP FPGA 如何協助保護您的產品和利潤。

    標簽: Spartan FPGA 267 DSP

    上傳時間: 2013-10-26

    上傳用戶:simonpeng

  • XAPP708 -133MHz PCI-X到128MB DDR小型DIMM存儲器橋

      The Virtex-4 features, such as the programmable IDELAY and built-in FIFO support, simplifythe bridging of a high-speed, PCI-X core to large amounts of DDR-SDRAM memory. Onechallenge is meeting the PCI-X target initial latency specification. PCI-X Protocol Addendum tothe PCI Local Bus Specification Revision 2.0a ([Ref 6]) dictates that when a target signals adata transfer, "the target must do so within 16 clocks of the assertion of FRAME#." PCItermination transactions, such as Split Response/Complete, are commonly used to meet thelatency specifications. This method adds complexity to the design, as well as additional systemlatency. Another solution is to increase the ratio of the memory frequency to the PCI-X busfrequency. However, this solution increases the required power and clock resource usage.

    標簽: PCI-X XAPP DIMM 708

    上傳時間: 2013-11-24

    上傳用戶:18707733937

  • WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案

    WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案: High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs

    標簽: Xilinx FPGA 409 DSP

    上傳時間: 2013-10-21

    上傳用戶:huql11633

  • 基于FPGA+DSP模式的智能相機設計

    針對嵌入式機器視覺系統向獨立化、智能化發展的要求,介紹了一種嵌入式視覺系統--智能相機。基于對智能相機體系結構、組成模塊和圖像采集、傳輸和處理技術的分析,對國內外的幾款智能相機進行比較。綜合技術發展現狀,提出基于FPGA+DSP模式的硬件平臺,并提出智能相機的發展方向。分析結果表明,該系統設計可以實現脫離PC運行,完成圖像獲取與分析,并作出相應輸出。 Abstract:  This paper introduced an embedded vision system-intelligent camera ,which was for embedded machine vision systems to an independent and intelligent development requirements. Intelligent camera architecture, component modules and image acquisition, transmission and processing technology were analyzed. After comparing integrated technology development of several intelligent cameras at home and abroad, the paper proposed the hardware platform based on FPGA+DSP models and made clear direction of development of intelligent cameras. On the analysis of the design, the results indicate that the system can run from the PC independently to complete the image acquisition and analysis and give a corresponding output.

    標簽: FPGA DSP 模式 智能相機

    上傳時間: 2013-11-14

    上傳用戶:無聊來刷下

  • 步進電機--手把手教你學DSP之入門篇

    DSP

    標簽: DSP 步進電機 手把手

    上傳時間: 2014-01-18

    上傳用戶:我累個乖乖

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