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基于vhdl的移位寄存器設計

  • 資源大?。?/b>1 K
  • 上傳時間: 2013-04-24
  • 上傳用戶:thjyykmqu
  • 資源積分:2 下載積分
  • 標      簽: vhdl 移位寄存器

資 源 簡 介

16位帶有并行預置功能的右移移位寄存器,CLK1是時鐘信號, LOAD是并行數據使能信號,QB是串行輸出端口

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