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• verilog設(shè)計三分頻器代碼免費下載

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  標簽： verilog 三分頻 代碼

  上傳時間： 2017-02-26

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• 本文主要介紹了50％占空比三分頻器的三種設(shè)計方法免費下載

  資源簡介：本文主要介紹了50％占空比三分頻器的三種設(shè)計方法，并給出了圖形設(shè)計、VHDL設(shè)計、編譯結(jié)果和仿真結(jié)果。設(shè)計中采用EPM7064AETC44-7 CPLD，在QUARTUSⅡ4.2軟件平臺上進行。

  標簽： 三分頻 設(shè)計方法

  上傳時間： 2014-01-25

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  資源簡介：此為EDA設(shè)計的分頻器模塊。可以實現(xiàn)三種不同的頻率信號，可以通過使用者自由設(shè)置頻率大小

  標簽： EDA 分頻器 模塊 頻率信號

  上傳時間： 2013-12-22

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• 用verilog編寫適中分頻器 并且還有測試程序免費下載

  資源簡介：用verilog編寫適中分頻器 并且還有測試程序

  標簽： verilog 編寫 分頻器 測試程序

  上傳時間： 2013-11-28

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• 用verilog編寫適中分頻器 并且還有測試程序免費下載

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  標簽： verilog 編寫 分頻器 測試程序

  上傳時間： 2013-12-17

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• 一個簡單的分頻器代碼,可以套用來作其他頻率的分頻免費下載

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  標簽： 分頻器 代碼 分頻 頻率

  上傳時間： 2014-06-18

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• vhdl語言編寫的2分頻器代碼免費下載

  資源簡介：vhdl語言編寫的2分頻器代碼，簡單易懂

  標簽： vhdl 語言 編寫 分頻器

  上傳時間： 2014-01-08

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  標簽： VHDL EDA 函數(shù) 交通燈

  上傳時間： 2013-12-23

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• 數(shù)控分頻器的設(shè)計數(shù)控分頻器的功能就是當在輸入端給定不同輸入數(shù)據(jù)時免費下載

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  標簽： 數(shù)控 分頻器 數(shù)據(jù) 輸入端

  上傳時間： 2016-10-13

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  標簽： 數(shù)控 分頻器 數(shù)據(jù) 輸入端

  上傳時間： 2013-12-11

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• 基于vhdl的分頻器設(shè)計免費下載

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  標簽： vhdl 分頻器

  上傳時間： 2017-03-31

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• 半整數(shù)分頻器的設(shè)計 請不要上傳有版權(quán)爭議的內(nèi)容和木馬病毒代碼免費下載

  資源簡介：半整數(shù)分頻器的設(shè)計 請不要上傳有版權(quán)爭議的內(nèi)容和木馬病毒代碼

  標簽： 整數(shù) 分頻器 代碼 木馬

  上傳時間： 2014-08-16

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  標簽： verilog 三分頻 代碼

  上傳時間： 2017-08-24

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  資源簡介：帶分頻器的bcd計數(shù)電路設(shè)計，verilog源碼

  標簽： bcd 分頻器 計數(shù)電路

  上傳時間： 2014-01-14

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  標簽： 分頻器 設(shè)計程序

  上傳時間： 2016-07-15

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  資源簡介：用verilog實現(xiàn)了奇數(shù)和偶數(shù)不同的分頻器設(shè)計

  標簽： verilog fpga 分頻器

  上傳時間： 2016-07-11

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• 用verilog實現(xiàn)基于FPGA的通用分頻器免費下載

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  標簽： verilog FPGA 分頻器

  上傳時間： 2013-08-30

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  標簽： FPG 分頻器 二分頻 程序設(shè)計

  上傳時間： 2013-08-31

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• 基于CPLD-FPGA的半整數(shù)分頻器的設(shè)計免費下載

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  上傳時間： 2013-09-03

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  上傳時間： 2013-10-28

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• 用verilogHDL實現(xiàn)基于FPGA的通用分頻器的設(shè)計免費下載

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  上傳時間： 2015-01-02

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  上傳時間： 2015-04-09

  上傳用戶：凌云御清風

• 第7章數(shù)字系統(tǒng)設(shè)計實例 7.1 半整數(shù)分頻器的設(shè)計 7.2 音樂發(fā)生器 7.3 2FSK/2PSK信號產(chǎn)生器 7.4 實用多功能電子表 7.5 交通燈控制器 7.6 數(shù)字頻率計免費下載

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  標簽： 7.1 7.2 7.3 FSK

  上傳時間： 2015-06-23

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• 數(shù)控分頻器設(shè)計:對于一個加法計數(shù)器免費下載

  資源簡介：數(shù)控分頻器設(shè)計:對于一個加法計數(shù)器，裝載不同的計數(shù)初始值時，會有不同頻率的溢出輸出信號。計數(shù)器溢出時，輸出‘1’電平，同時溢出時的‘1’電平反饋給計數(shù)器的輸入端作為裝載信號；否則輸出‘0’電平。

  標簽： 數(shù)控 分頻器 加法 計數(shù)器

  上傳時間： 2015-07-16

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• 用verilog實現(xiàn)基于FPGA的通用分頻器免費下載

  資源簡介：用verilog實現(xiàn)基于FPGA的通用分頻器

  標簽： verilog FPGA 分頻器

  上傳時間： 2015-08-20

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• 本文件介紹的是用verilogHDL語言設(shè)計分頻器和32位計數(shù)器.免費下載

  資源簡介：本文件介紹的是用verilogHDL語言設(shè)計分頻器和32位計數(shù)器.

  標簽： verilogHDL 語言 分頻器 計數(shù)器

  上傳時間： 2013-12-15

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• 分頻器 FPGＡ程序設(shè)計　二分頻　對硬件設(shè)計有很大用處免費下載

  資源簡介：分頻器 FPGＡ程序設(shè)計　二分頻　對硬件設(shè)計有很大用處

  標簽： FPG 分頻器 二分頻 程序設(shè)計

  上傳時間： 2014-01-25

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• 任意N進制分頻器的標準VHDL代碼（原創(chuàng)）免費下載

  資源簡介：任意N進制分頻器的標準VHDL代碼（原創(chuàng)）

  標簽： VHDL N進制 分頻器 代碼

  上傳時間： 2013-12-25

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• 常用2、4、6及任意偶數(shù)分頻器的VHDL代碼實現(xiàn)（原創(chuàng)）免費下載

  資源簡介：常用2、4、6及任意偶數(shù)分頻器的VHDL代碼實現(xiàn)（原創(chuàng)）

  標簽： VHDL 分頻器 代碼

  上傳時間： 2013-12-17

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• 常用1、3、5及任意奇數(shù)分頻器的VHDL代碼實現(xiàn)（原創(chuàng)）免費下載

  資源簡介：常用1、3、5及任意奇數(shù)分頻器的VHDL代碼實現(xiàn)（原創(chuàng)）

  標簽： VHDL 分頻器 代碼

  上傳時間： 2013-12-26

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