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關(guān)于在FPGA或CPLD鎖相環(huán)PLL原理與應(yīng)用,介紹用FPGA的分頻技術(shù).

  • 資源大小:93 K
  • 上傳時(shí)間: 2016-05-12
  • 上傳用戶:wzsq12
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA CPLD PLL 鎖相環(huán)

資 源 簡(jiǎn) 介

關(guān)于在FPGA或CPLD鎖相環(huán)PLL原理與應(yīng)用,介紹用FPGA的分頻技術(shù).

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