用Verilog HDL實現(xiàn)I2C總線功能,對I2C總線有很大幫助
資源簡介:用Verilog HDL實現(xiàn)I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-28
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資源簡介:用Verilog HDL實現(xiàn)I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-31
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資源簡介:用Verilog HDL實現(xiàn)I2C總線功能
上傳時間: 2013-11-07
上傳用戶:源弋弋
資源簡介:用Verilog HDL實現(xiàn)I2C總線功能
上傳時間: 2013-11-05
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資源簡介:用Verilog HDL實現(xiàn)I2C Master Controller 的設計,包括主程序設計和測試程序設計
上傳時間: 2014-01-04
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資源簡介:用Verilog HDL實現(xiàn)的1553B航空電子總線接口。
上傳時間: 2016-05-19
上傳用戶:許小華
資源簡介:用Verilog HDL實現(xiàn)曼徹斯特編碼的源碼
上傳時間: 2013-12-29
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資源簡介:Verilog HDL編寫的總線功能模型,十分有用,需要的下載
上傳時間: 2013-12-20
上傳用戶:ls530720646
資源簡介:數(shù)字時鐘顯示模塊,用Verilog HDL 實現(xiàn)
上傳時間: 2016-03-03
上傳用戶:yiwen213
資源簡介:用VHDL來實現(xiàn)I2C的功能(實驗過),很好用啊
上傳時間: 2016-03-25
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資源簡介:用Verilog HDL實現(xiàn)的曼徹斯特編碼器和解碼器。
上傳時間: 2013-12-23
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資源簡介:用Verilog HDL實現(xiàn)的VGA顯示彩條信號,其中包括VGA時序、豎彩條、橫彩條、棋盤格
上傳時間: 2016-06-29
上傳用戶:yangbo69
資源簡介:用Verilog HDL實現(xiàn)了83編碼器.
上傳時間: 2016-07-15
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資源簡介:用Verilog HDL實現(xiàn)的任意 頻率分頻器源代碼,是一個通用的程序
上傳時間: 2014-01-07
上傳用戶:alan-ee
資源簡介:用Verilog HDL 實現(xiàn)時鐘(時和分)
上傳時間: 2013-12-26
上傳用戶:Amygdala
資源簡介:用Verilog HDL實現(xiàn)狀態(tài)機的設計
上傳時間: 2014-01-22
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資源簡介:用Verilog HDL硬件描述語言實現(xiàn)多人搶答器功能,有計時,計分,報警等功能。
上傳時間: 2015-11-25
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資源簡介:actel A3P250 fpga用Verilog HDL語言實現(xiàn)串口功能的源代碼
上傳時間: 2013-12-23
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資源簡介:減1計數(shù)器 一、設計要求 用Verilog HDL語言設計一個計數(shù)器。 要求計數(shù)器具有異步置位/復位功能,可以進行自增和自減計數(shù),其計數(shù)周期為2^N(N為二進制位數(shù))。 二、設計原理 輸入/輸出說明: d:異步置數(shù)數(shù)據(jù)輸入; q:當前計數(shù)器數(shù)據(jù)輸出; clock:時鐘脈沖...
上傳時間: 2015-03-28
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資源簡介:用cpld實現(xiàn)曼徹斯特編碼 用Verilog HDL進行曼徹斯特編碼,用于通信中
上傳時間: 2015-05-02
上傳用戶:chenbhdt
資源簡介:Verilog HDL實現(xiàn)的I2C Slave模擬
上傳時間: 2014-11-17
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資源簡介:本文件提供了用Verilog HDL語言實現(xiàn)的8位超前進位加法器,充分說明了超前進位加法器和普通加法器之間的區(qū)別.
上傳時間: 2013-12-17
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資源簡介:是幾個用Verilog HDL語言編寫的源代碼(里面包括實現(xiàn)濾波器等),對想學習這個語言的朋友很有幫助!
上傳時間: 2016-05-22
上傳用戶:ouyangtongze
資源簡介:用VHADL和Verilog HDL實現(xiàn)帶進位的8位加減法器。
上傳時間: 2016-07-12
上傳用戶:bruce
資源簡介:包含了四位計數(shù)器等基本數(shù)字模塊的的Verilog HDL程序代碼,該功能實現(xiàn),可以直接利用DC進行綜合,得到硬件電路,亦能夠轉換成VHDL語言進行綜合
上傳時間: 2013-12-19
上傳用戶:hopy
資源簡介:用FPGA Verilog HDL實現(xiàn)千兆以太網(wǎng)MAC。
上傳時間: 2014-01-12
上傳用戶:yuanyuan123
資源簡介:16階FIR濾波器--本設計用Verilog HDL語言串行DA算法實現(xiàn)16階有限頻率響應濾波器!
上傳時間: 2016-11-26
上傳用戶:moshushi0009
資源簡介:用Verilog HDL / VHDL實現(xiàn)的數(shù)字頻率計(完整實驗報告)
上傳時間: 2014-01-22
上傳用戶:dapangxie
資源簡介:用Verilog HDL編寫的秒表設計,可以實現(xiàn)百分之一秒,十分之一秒,秒,十秒等功能。
上傳時間: 2017-07-09
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資源簡介:用Verilog HDL語言編寫的家用空調溫度控制器,可實現(xiàn)手動,自動控制兩種模式,并可實現(xiàn)報警功能。
上傳時間: 2013-12-24
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