Verilog HDL編寫的總線功能模型,十分有用,需要的下載
資源簡介:Verilog HDL編寫的總線功能模型,十分有用,需要的下載
上傳時間: 2013-12-20
上傳用戶:ls530720646
資源簡介:Verilog HDL編寫的CPU模型,很經典,比較通用
上傳時間: 2013-12-24
上傳用戶:龍飛艇
資源簡介:用Verilog HDL編寫的秒表設計,可以實現百分之一秒,十分之一秒,秒,十秒等功能。
上傳時間: 2017-07-09
上傳用戶:離殤
資源簡介:Verilog HDL 編寫的PWM,是初學CPLD者入門Z資源,epm7128stc100-10
上傳時間: 2013-08-30
上傳用戶:aa54
資源簡介:這是一個Verilog HDL編寫的RISC cpu的程序,該程序共10個子程序,實現了簡單的RISC cpu,可供初學者參考,學習硬件描述語言,及設計方法。該程序通過了modelsim仿真驗證。
上傳時間: 2015-03-26
上傳用戶:qiao8960
資源簡介:用Verilog HDL實現I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-28
上傳用戶:ouyangtongze
資源簡介:用Verilog HDL實現I2C總線功能,對I2C總線有很大幫助
上傳時間: 2013-12-31
上傳用戶:zhouchang199
資源簡介:Verilog HDL編寫的串并轉換。采用iout類型口。包含源文件和測試文件。用Modsim編譯。
上傳時間: 2014-01-15
上傳用戶:lanwei
資源簡介:Verilog HDL 編寫的PWM,是初學CPLD者入門Z資源,epm7128stc100-10
上傳時間: 2015-09-05
上傳用戶:gdgzhym
資源簡介:Verilog HDL編寫的出租車計費系統
上傳時間: 2015-11-20
上傳用戶:nanshan
資源簡介:用Verilog HDL編寫的一些例程,包括加法器/減法器等等,例子較多就不一一列舉了
上傳時間: 2013-12-20
上傳用戶:fhzm5658
資源簡介:基于Verilog HDL設計的多功能數字鐘,有興趣的
上傳時間: 2013-11-26
上傳用戶:宋桃子
資源簡介:Verilog HDL編寫的四位數碼管動態顯示程序,外圍電路用CPLD來實現
上傳時間: 2016-06-12
上傳用戶:米卡
資源簡介:用Verilog HDL編寫的0832源程序,實現對0832實現D/A轉換。也可方便地轉換為vHDL源程序。
上傳時間: 2013-11-25
上傳用戶:qiao8960
資源簡介:Verilog HDL 編寫的CY7C68013 SLAVE FIFO接口程序,實際測試可用??梢灾苯痈衔粰C連接,傳輸數據。
上傳時間: 2016-10-13
上傳用戶:ljmwh2000
資源簡介:用Verilog HDL編寫的VGA顯示驅動程序
上傳時間: 2013-12-09
上傳用戶:banyou
資源簡介:Verilog HDL編寫的4條指令CPU
上傳時間: 2014-01-27
上傳用戶:Ants
資源簡介:利用Verilog HDL編寫的浮點加法器運算單元,單精度。
上傳時間: 2013-11-29
上傳用戶:王慶才
資源簡介:用Verilog HDL編寫的基于fpga的動態數碼管顯示程序。
上傳時間: 2017-07-09
上傳用戶:13681659100
資源簡介:用Verilog HDL編寫的并串轉換模塊,在ISE軟件仿真過,也可綜合
上傳時間: 2014-10-10
上傳用戶:han_zh
資源簡介:實現簡單的UART功能,在QUARTUS4.0下編譯通過,采用Verilog HDL編寫.
上傳時間: 2013-12-18
上傳用戶:hfmm633
資源簡介:采用Verilog HDL語言編寫的多功能數字鐘,包括四個功能:時間顯示與設置、秒表、鬧鐘、日期顯示與設置,源代碼對FPGA和CPLD學習者價值很高,
上傳時間: 2016-03-21
上傳用戶:270189020
資源簡介:本文利用Verilog HDL 語言自頂向下的設計方法設計多功能數字鐘,突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優點,并通過Altera QuartusⅡ 4.1 和ModelSim
上傳時間: 2013-07-21
上傳用戶:ve3344
資源簡介:本文利用Verilog HDL 語言自頂向下的設計方法設計多功能數字鐘,突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優點,并通過Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成綜合、仿真。此程序通過下載到FPGA 芯片后,可應用于實際的數字鐘顯示中...
上傳時間: 2013-11-10
上傳用戶:hz07104032
資源簡介:用Verilog編寫的多功能數字鐘
上傳時間: 2015-02-25
上傳用戶:王者A
資源簡介:Verilog編寫的全功能串口
上傳時間: 2014-02-11
上傳用戶:Breathe0125
資源簡介:使用Verilog語言編寫的數字鐘程序.有慢校時,快校時,鬧鐘等功能.
上傳時間: 2014-01-26
上傳用戶:417313137
資源簡介:鍵盤鼠標的原代碼,用FPGA實現,使用Verilog HDL編寫,已經使用FPGA驗正過了,完全可以用
上傳時間: 2013-12-12
上傳用戶:athjac
資源簡介:bfm(總線功能模型)設計的基礎教材,值得一看,需要lotus打開文檔
上傳時間: 2014-11-11
上傳用戶:a3318966
資源簡介:Verilog語言編寫的FPGA代碼。功能為pc機通過epp不斷寫數到sram中,然后pc發送中斷信號打斷寫過程讀取sram中的數據。rar包中包含epp協議,模塊文件和測試文件(test)。
上傳時間: 2013-12-17
上傳用戶:1966640071