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• fpga功能實(shí)現(xiàn)有限字長(zhǎng)響應(yīng)FIR 用verilog編寫免費(fèi)下載

  資源簡(jiǎn)介：fpga功能實(shí)現(xiàn)有限字長(zhǎng)響應(yīng)FIR 用verilog編寫

  標(biāo)簽： verilog fpga FIR 有限字長(zhǎng)

  上傳時(shí)間： 2013-12-01

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• fpga功能實(shí)現(xiàn)有限字長(zhǎng)響應(yīng)FIR免費(fèi)下載

  資源簡(jiǎn)介：fpga功能實(shí)現(xiàn)有限字長(zhǎng)響應(yīng)FIR，用verilog編寫

  標(biāo)簽： fpga FIR 有限字長(zhǎng)

  上傳時(shí)間： 2013-08-24

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• 本文中用Laguerre網(wǎng)絡(luò)實(shí)現(xiàn)的濾波器吸收了傳統(tǒng)有限沖激響應(yīng)(FIR)、 無(wú)限沖激響應(yīng)(HR)濾波器的優(yōu)點(diǎn)免費(fèi)下載

  資源簡(jiǎn)介：本文中用Laguerre網(wǎng)絡(luò)實(shí)現(xiàn)的濾波器吸收了傳統(tǒng)有限沖激響應(yīng)(FIR)、 無(wú)限沖激響應(yīng)(HR)濾波器的優(yōu)點(diǎn)，既具有FIR濾波器的穩(wěn)定性又具有HR 濾波器的長(zhǎng)時(shí)記憶的特點(diǎn)和通阻帶特性。其設(shè)計(jì)方法是在Laguerre濾波器 與理想濾波器的頻率響應(yīng)的均方誤差為最小的前提下，...

  標(biāo)簽： Laguerre FIR 濾波器 沖激響應(yīng)

  上傳時(shí)間： 2017-07-17

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• 數(shù)字濾波器設(shè)計(jì),是有限沖擊長(zhǎng)響應(yīng)的濾波器,希望各位高手指點(diǎn)免費(fèi)下載

  資源簡(jiǎn)介：數(shù)字濾波器設(shè)計(jì),是有限沖擊長(zhǎng)響應(yīng)的濾波器,希望各位高手指點(diǎn)

  標(biāo)簽： 數(shù)字 濾波器設(shè)計(jì) 濾波器 高手

  上傳時(shí)間： 2015-11-23

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• 這是用pci-wishbone核和16450串口核在xilinx的fpga上實(shí)現(xiàn)的串口程序免費(fèi)下載

  資源簡(jiǎn)介：這是用pci-wishbone核和16450串口核在xilinx的fpga上實(shí)現(xiàn)的串口程序，用verilog實(shí)現(xiàn)，ise7.1，不知道這里可不可以上傳硬件的程序~

  標(biāo)簽： pci-wishbone xilinx 16450 fpga

  上傳時(shí)間： 2015-09-19

  上傳用戶：風(fēng)之驕子

• 這是在fpga上實(shí)現(xiàn)的數(shù)字電壓表免費(fèi)下載

  資源簡(jiǎn)介：這是在fpga上實(shí)現(xiàn)的數(shù)字電壓表，用VHDL編寫的，已通過(guò)編譯，仿真驗(yàn)證。

  標(biāo)簽： fpga 數(shù)字電壓表

  上傳時(shí)間： 2015-10-24

  上傳用戶：tyler

• 計(jì)算器的功能實(shí)現(xiàn),簡(jiǎn)單的數(shù)據(jù)操作規(guī)程.用圖形法做的免費(fèi)下載

  資源簡(jiǎn)介：計(jì)算器的功能實(shí)現(xiàn),簡(jiǎn)單的數(shù)據(jù)操作規(guī)程.用圖形法做的

  標(biāo)簽： 計(jì)算器 數(shù)據(jù) 操作規(guī)程 圖形

  上傳時(shí)間： 2016-07-11

  上傳用戶：colinal

• 用verilog編寫的多功能數(shù)字鐘免費(fèi)下載

  資源簡(jiǎn)介：用verilog編寫的多功能數(shù)字鐘

  標(biāo)簽： verilog 編寫 多功能 數(shù)字

  上傳時(shí)間： 2015-02-25

  上傳用戶：王者A

• 用verilog編寫在FLEX10K上實(shí)現(xiàn)的簡(jiǎn)易CPU免費(fèi)下載

  資源簡(jiǎn)介：用verilog編寫在FLEX10K上實(shí)現(xiàn)的簡(jiǎn)易CPU

  標(biāo)簽： verilog FLEX 10K CPU

  上傳時(shí)間： 2015-03-09

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• 用verilog編寫的FIR濾波器程序免費(fèi)下載

  資源簡(jiǎn)介：用verilog編寫的FIR濾波器程序，開(kāi)發(fā)環(huán)境可以用ise quartus或active hdl等

  標(biāo)簽： verilog FIR 編寫 濾波器

  上傳時(shí)間： 2015-08-21

  上傳用戶：英雄

• 用verilog編寫的USB下載線程序 實(shí)現(xiàn)USB協(xié)議和JTAG接口的數(shù)據(jù)轉(zhuǎn)換實(shí)現(xiàn)狀態(tài)機(jī)免費(fèi)下載

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  標(biāo)簽： USB verilog JTAG 編寫

  上傳時(shí)間： 2013-12-12

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• 用cordic算法實(shí)現(xiàn)超越函數(shù),sin,cos用此方法也可以實(shí)現(xiàn)其他的sinhx,coshx,ex.代碼用verilog編寫免費(fèi)下載

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  標(biāo)簽： verilog cordic coshx sinhx

  上傳時(shí)間： 2016-07-13

  上傳用戶：15071087253

• 并行算法的cannon算法實(shí)現(xiàn)。在smp環(huán)境下用c編寫。免費(fèi)下載

  資源簡(jiǎn)介：并行算法的cannon算法實(shí)現(xiàn)。在smp環(huán)境下用c編寫。

  標(biāo)簽： cannon smp 并行算法 算法

  上傳時(shí)間： 2014-01-01

  上傳用戶：LouieWu

• 并行算法下的transpose實(shí)現(xiàn)。在smp環(huán)境下用mpi編寫免費(fèi)下載

  資源簡(jiǎn)介：并行算法下的transpose實(shí)現(xiàn)。在smp環(huán)境下用mpi編寫

  標(biāo)簽： transpose smp mpi 并行算法

  上傳時(shí)間： 2016-10-08

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• 用verilog編寫的USB下載線程序 實(shí)現(xiàn)USB協(xié)議和JTAG接口的數(shù)據(jù)轉(zhuǎn)換實(shí)現(xiàn)狀態(tài)機(jī)。免費(fèi)下載

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  標(biāo)簽： USB verilog JTAG 編寫

  上傳時(shí)間： 2013-12-25

  上傳用戶：chenbhdt

• 用verilog編寫的FIR濾波器程序！免費(fèi)下載

  資源簡(jiǎn)介：用verilog編寫的FIR濾波器程序！

  標(biāo)簽： verilog FIR 編寫 濾波器

  上傳時(shí)間： 2016-11-26

  上傳用戶：D&L37

• 該程序是在xilinx的fpga上實(shí)現(xiàn)DDR_SDRAM接口免費(fèi)下載

  資源簡(jiǎn)介：該程序是在xilinx的fpga上實(shí)現(xiàn)DDR_SDRAM接口，程序是用verylog語(yǔ)言寫的

  標(biāo)簽： DDR_SDRAM xilinx fpga 程序

  上傳時(shí)間： 2015-06-10

  上傳用戶：爺?shù)臍赓|(zhì)

• 有限沖激響應(yīng)濾波器FIR的設(shè)計(jì)。采用c語(yǔ)言設(shè)計(jì)。系數(shù)由matlab計(jì)算得到?？稍贑CS環(huán)境中采用DSPs(0TMS320C5402)來(lái)實(shí)現(xiàn)。免費(fèi)下載

  資源簡(jiǎn)介：有限沖激響應(yīng)濾波器FIR的設(shè)計(jì)。采用c語(yǔ)言設(shè)計(jì)。系數(shù)由matlab計(jì)算得到?？稍贑CS環(huán)境中采用DSPs(0TMS320C5402)來(lái)實(shí)現(xiàn)。

  標(biāo)簽： matlab C5402 0TMS 320C

  上傳時(shí)間： 2013-12-27

  上傳用戶：chens000

• 16階FIR濾波器--本設(shè)計(jì)用verilog HDL語(yǔ)言串行DA算法實(shí)現(xiàn)16階有限頻率響應(yīng)濾波器！免費(fèi)下載

  資源簡(jiǎn)介：16階FIR濾波器--本設(shè)計(jì)用verilog HDL語(yǔ)言串行DA算法實(shí)現(xiàn)16階有限頻率響應(yīng)濾波器！

  標(biāo)簽： verilog FIR HDL 濾波器

  上傳時(shí)間： 2016-11-26

  上傳用戶：moshushi0009

• DSP6713實(shí)現(xiàn)有限沖擊響應(yīng)濾波器FIR程序。文件包為調(diào)試過(guò)的全部工程文件。.out文件為下載到DSP的文件。免費(fèi)下載

  資源簡(jiǎn)介：DSP6713實(shí)現(xiàn)有限沖擊響應(yīng)濾波器FIR程序。文件包為調(diào)試過(guò)的全部工程文件。.out文件為下載到DSP的文件。

  標(biāo)簽： DSP 6713 FIR out

  上傳時(shí)間： 2016-12-21

  上傳用戶：宋桃子

• 本程序是一個(gè)有限長(zhǎng)沖擊響應(yīng)FIR濾波器算法實(shí)驗(yàn)程序免費(fèi)下載

  資源簡(jiǎn)介：本程序是一個(gè)有限長(zhǎng)沖擊響應(yīng)FIR濾波器算法實(shí)驗(yàn)程序，采用的是匯編語(yǔ)言。

  標(biāo)簽： FIR 程序 濾波器 實(shí)驗(yàn)

  上傳時(shí)間： 2017-09-08

  上傳用戶：離殤

• 地面數(shù)字電視廣播系統(tǒng)中SRRC濾波器及FFT處理器的設(shè)計(jì)與fpga實(shí)現(xiàn).rar免費(fèi)下載

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  標(biāo)簽： SRRC fpga FFT

  上傳時(shí)間： 2013-04-24

  上傳用戶：mdrd3080

• 基于fpga的數(shù)字濾波器實(shí)現(xiàn)技術(shù)研究免費(fèi)下載

  資源簡(jiǎn)介：隨著數(shù)字信號(hào)處理技術(shù)應(yīng)用的不斷深入，數(shù)字信號(hào)處理系統(tǒng)的實(shí)現(xiàn)面臨著很多挑戰(zhàn)，其中面臨的四個(gè)主要問(wèn)題是：速度、設(shè)計(jì)規(guī)模、功耗和開(kāi)發(fā)周期。因此許多數(shù)字信號(hào)處理的實(shí)現(xiàn)方法被提出，其中基于fpga的實(shí)現(xiàn)技術(shù)就是其中的重要技術(shù)之一。 本文以數(shù)字信號(hào)處理系統(tǒng)...

  標(biāo)簽： fpga 數(shù)字濾波器 實(shí)現(xiàn)技術(shù)

  上傳時(shí)間： 2013-08-01

  上傳用戶：Andy123456

• 用fpga器件實(shí)現(xiàn)UART核心功能的一種方法免費(fèi)下載

  資源簡(jiǎn)介：用fpga器件實(shí)現(xiàn)UART核心功能的一種方法.doc

  標(biāo)簽： fpga UART 器件 核心

  上傳時(shí)間： 2013-08-14

  上傳用戶：1583060504

• 介紹FIR濾波器的fpga高效實(shí)現(xiàn)和巧妙驗(yàn)證,不錯(cuò)免費(fèi)下載

  資源簡(jiǎn)介：介紹FIR濾波器的fpga高效實(shí)現(xiàn)和巧妙驗(yàn)證

  標(biāo)簽： fpga FIR 濾波器

  上傳時(shí)間： 2013-08-24

  上傳用戶：haoxiyizhong

• 使用fpga模擬實(shí)現(xiàn)8051單片機(jī)及其外設(shè)的功能免費(fèi)下載

  資源簡(jiǎn)介：隨著電子技術(shù)的發(fā)展,當(dāng)前數(shù)字系統(tǒng)的設(shè)計(jì)正朝著速度快、容量大、體積小、重量輕的方向發(fā)展.fpga以其功能強(qiáng)大,開(kāi)發(fā)過(guò)程投資少、周期短,可反復(fù)修改,保密性能好,開(kāi)發(fā)工具智能化等特點(diǎn)成為當(dāng)今硬件設(shè)計(jì)的首選方式之一.由于Intel公司的MCS-51系列單片機(jī)被公認(rèn)為8位...

  標(biāo)簽： fpga 8051 模擬 單片機(jī)

  上傳時(shí)間： 2013-07-28

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• 在fpga上實(shí)現(xiàn)的出租車計(jì)價(jià)器VHDL源代碼免費(fèi)下載

  資源簡(jiǎn)介：在fpga上實(shí)現(xiàn)的出租車計(jì)價(jià)器VHDL源代碼\r\n能實(shí)現(xiàn)里程計(jì)價(jià)、誤時(shí)計(jì)價(jià)等功能

  標(biāo)簽： fpga VHDL 出租車計(jì)價(jià)器 源代碼

  上傳時(shí)間： 2013-08-13

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• CVSD語(yǔ)音壓縮的算法和程序流程.量階δ能夠自動(dòng)地隨輸入信號(hào)平均斜率的大小而連續(xù)變化,譯碼輸出信號(hào)實(shí)現(xiàn)了對(duì)輸入信號(hào)的理想逼近,最后在可編程邏輯器件(fpga)中實(shí)現(xiàn)了CVSD調(diào)制功能。免費(fèi)下載

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  標(biāo)簽： CVSD fpga 輸入信號(hào) 語(yǔ)音壓縮

  上傳時(shí)間： 2015-03-12

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• 針對(duì)在fpga中實(shí)現(xiàn)FIR濾波器的關(guān)鍵--乘法運(yùn)算的高效實(shí)現(xiàn)進(jìn)行了研究免費(fèi)下載

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  標(biāo)簽： fpga FIR 濾波器 乘法運(yùn)算

  上傳時(shí)間： 2015-04-24

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• 用verilog語(yǔ)言在fpga中實(shí)現(xiàn)fifo功能！免費(fèi)下載

  資源簡(jiǎn)介：用verilog語(yǔ)言在fpga中實(shí)現(xiàn)fifo功能！

  標(biāo)簽： verilog fpga fifo 語(yǔ)言

  上傳時(shí)間： 2015-05-02

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