VHDL/FPGA/Verilog
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基于vhdl的數字鐘完整工程文件
基于vhdl的數字鐘完整工程文件,已在實驗箱上實現
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4 bit ALU 設計功能仿真和門級仿真結果
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vhdl語言實現加減乘除計算器設計主程序模塊
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PWM generation,Altera standard function.
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基于FPGA單精度浮點除法器的實現
基于FPGA單精度浮點除法器的實現,有一些源代碼,僅供參考。
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OFDM系統中的QAM調制
OFDM系統中的QAM調制,用verilog語言編寫,用于FPGA設計
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VHDL的語言詳解,很全,很好很強大
VHDL的語言詳解,很全,很好很強大
VHDL的語言詳解,很全,很好很強大 VHDL的語言詳解,很全,很好很強大
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主要講述了FPGA設計中的關鍵語言VHDL的學習
主要講述了FPGA設計中的關鍵語言VHDL的學習
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將AD采樣的八位比特轉化為十進制數值大小
將AD采樣的八位比特轉化為十進制數值大小,并用數碼管動態顯示
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利用CPLD對輸入信號測量幅度
利用CPLD對輸入信號測量幅度,保存數值
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用veirlog寫成的七段顯示器 可以把十進制轉成七段顯示器上面的顯示數字
用veirlog寫成的七段顯示器 可以把十進制轉成七段顯示器上面的顯示數字
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It is n-bit sequential divider in verilog language
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This approach, we feel, came very close to obtaining an image from the camera OV7620. Before we trie
This approach, we feel, came very close to obtaining an image from the camera OV7620. Before we tried to capture a camer ...
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The objective of this project is to create a driver for a camera module (we used the OV7620). After
The objective of this project is to create a driver for a camera module (we used the OV7620). After taking the image wit ...
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基于現場可編程(FPGA)技術和硬件描述語言
基于現場可編程(FPGA)技術和硬件描述語言
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完整的TPC編譯碼VHDL程序
完整的TPC編譯碼VHDL程序,直接就可以運行
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verilog hdl經典例程
verilog hdl經典例程,全部調試通過
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this is a AMBA AHB code for master.
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this is a code of AMBA AHB master protocol in verilog
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一篇比較實用的論文
一篇比較實用的論文,基于FPGA的視頻監控
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這是VERILOG語言編寫的程序,可在FPGA板上運行.有很大的作用.謝謝.
這是VERILOG語言編寫的程序,可在FPGA板上運行.有很大的作用.謝謝.
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用vhdl編寫的一個直流電機控制器
用vhdl編寫的一個直流電機控制器
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異步FIFO的FPGA實現,XILINX FPGA,
ISE ,VHDL語言實現
異步FIFO的FPGA實現,XILINX FPGA, ISE ,VHDL語言實現
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用vhdl設計的一個FIFO存儲器
用vhdl設計的一個FIFO存儲器
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用vhdl語言編寫的一個小的游戲
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一個關于漢字糾錯碼器的vhdl設計
一個關于漢字糾錯碼器的vhdl設計
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該項目在VGA顯示器上顯示8色豎彩條,使用的是verilog HDL語言編寫
該項目在VGA顯示器上顯示8色豎彩條,使用的是verilog HDL語言編寫,言簡意賅,一目了然
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FPGA實現的SPI串行通信 可以方便的與微控器建立通信
FPGA實現的SPI串行通信 可以方便的與微控器建立通信
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1.8421碼十進制計數器
2.分頻系數為8
1.8421碼十進制計數器 2.分頻系數為8,占空比為0.5的分頻器 3.控制8個二極管的電路
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基于VHDL語言的32位單精度的浮點加法器
基于VHDL語言的32位單精度的浮點加法器