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fulladder.vhd 一位全加器 adder.vhd 四位全加器 multi4.vhd 四位并行乘法器
標簽： vhd fulladder adder multi
上傳時間： 2015-09-03
上傳用戶：上善若水
8*8乘法器及其測試：采用booth編碼的乘法器：1． ultipler_quick_add_4 即4位的并行全加器，在這里主要起了兩個作用：第一個是在求部分積單元時，當編碼為3x時用來輸出部分積；另外一個是在將部分積加起來時，求3到6位時所用到。 2． ultiplier_quick_add_5 即5位的并行全加器，這里用來分別計算積的7到11位和12到16位。 3． ultiplier_unit_4 這個模塊是用來實現部分積的，每一個模塊實現一個部分積的4位，因此一個部分積需要4個這個模塊來實現。總共需要12個這樣的模塊。 4．Multiplier_full_add 這是一位的全加器，在實現部分積相加的時候，通過全加器的陣列來實現的。
標簽： ultipler_quick_add booth 乘法器 測試
上傳時間： 2016-07-12
上傳用戶：zhaiye
[VHDL經典設計26例]--在xilinx芯片上調試通過--[01--1位全加器][02--2選1多路選擇器][03--8位硬件加法器][04--7段數碼顯示譯碼器][05--8位串入并出寄存器][6--8位并入串出寄存器][7--內部三態總線][8--含清零和同步時鐘使能的4位加法計數器][9--數控分頻器][10--4位十進制頻率計][11--譯碼掃描顯示電路][12--用狀態機實現序列檢測器的設計][13--用狀態機對ADC0832電路控制實現SIN函數發生器][14--用狀態機實現ADC0809的采樣電路設計][15--DMA方式A/D采樣控制電路設計][16--硬件電子琴][17--樂曲自動演奏][18--秒表][19--移位相加8位硬件乘法器][20--VGA圖像顯示控制器(彩條)][21--VGA圖像顯示控制器][22--等精度頻率計][23--模擬波形發生器][24--模擬示波器][25--通用異步收發器(UART)][26--8位CPU設計(COP2000)]
標簽： xilinx VHDL 01 02
上傳時間： 2014-09-06
上傳用戶：han_zh
四位全加器verilog源碼，簡單實用！歡迎下載
標簽： verilog 全加器 程序
上傳時間： 2013-05-16
上傳用戶：a6697238
verilog浮點乘發器，特定數據結構，指數底為10
標簽： verilog 浮點
上傳時間： 2013-12-20
上傳用戶：chenbhdt
verilog浮點乘發器，特定數據結構，指數底為10,利用pipeline
上傳時間： 2013-12-24
上傳用戶：ljmwh2000
上傳時間： 2013-12-27
上傳用戶：thinode
上傳時間： 2014-01-26
上傳用戶：dengzb84
c語言浮點乘發器，特定數據結構，指數底為10
標簽： c語言 浮點
上傳時間： 2015-02-07
上傳用戶：comua
四位二進制計數器與半加器
標簽： 二進制 計數器 半加器
上傳用戶：來茴
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