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位運算

程序中的所有數在計算機內存中都是以二進制的形式儲存的。位運算就是直接對整數在內存中的二進制位進行操作。比如，and運算本來是一個邏輯運算符，但整數與整數之間也可以進行and運算。舉個例子，6的二進制是110，11的二進制是1011，那么6and11的結果就是2，它是二進制對應位進行邏輯運算的結果（0表示False，1表示True，空位都當0處理）。

一個四位二進制加/減運算器。要求：當控制端G＝0時做加運算

一個四位二進制加/減運算器。要求：當控制端G＝0時做加運算，G＝1時做減運算。用發光二極管表示運算結果的正、負。用數碼管顯示運算結果：加運算時，相加之和不超過15，減運算時，結果可正可負，但都用原碼表示。

標簽： 二進制減運算器控制

上傳時間： 2013-12-17

上傳用戶：chfanjiang
1、熟悉運算類指令對標志位的狀態影響以及標志位狀態的表示方法； 2、掌握條件轉移、無條件轉移指令的使用方法； 3、掌握分支程序設計、編寫、調試和運行的方法。

1、熟悉運算類指令對標志位的狀態影響以及標志位狀態的表示方法； 2、掌握條件轉移、無條件轉移指令的使用方法； 3、掌握分支程序設計、編寫、調試和運行的方法。

標簽： 指令標志位狀態轉移

上傳時間： 2014-02-19

上傳用戶：lili123
本設計是用32位的并行全加器的,可以實現浮點運算!

本設計是用32位的并行全加器的,可以實現浮點運算!

標簽： 并行全加器浮點運算

上傳時間： 2014-01-22

上傳用戶：WMC_geophy
基于ARM的超聲波液位計的研制

液位是工業生產中常見的測量參數，化工、石油、污水處理等各類工廠企業都要進行液位測量。目前，液位檢測技術飛速發展，新的液位測量儀表量程大、精度高、功能全，我國新型液位儀表大多依靠進口。由于超聲波測量液位具有非接觸測量、可測低溫介質、能夠定點和連續測量等優點，近年來，超聲液位測量技術取得了長足的進步，己成功應用于江河水位、化學和制藥工業、食品加工、罐裝液位等多種領域。本文研制的是基于ARM的超聲波液位計。傳統的超聲波液位計一般使用8位的單片機作處理器，采用電子元件捕捉到超聲波回波信號后產生中斷，判斷超聲波的傳播時間。本文提出了使用32位ARM芯片做處理器，采用數字信號處理的方法來判斷超聲波傳播時間的設計方案。本文使用高性能的ARM7TDMI-S內核的芯片LPC2119作為系統的運算控制器，加強了系統對超聲波回波信號的處理能力；使用A/D轉換器將回波信號轉換為數字信號，采用數字濾波處理信號，利用數值處理來判斷超聲波回波信號的起始點，提高了液位的測量精度；采用單換能器收發一體式電路設計，簡化了液位的計算；利用LPC2119芯片內部的CAN總線控制器設計了CAN總線通信接口；選用一線式數字溫度傳感器DSl8820進行溫度補償，避免了由于環境溫度的變化而產生的測量誤差。ARM芯片豐富的內部資源和I/0口線有利于今后擴展功能，升級系統。本超聲波液位計使用方便，精度高，能滿足工業生產中的要求。

標簽： ARM 超聲波液位計

上傳時間： 2013-04-24

上傳用戶：lwt123
OFDM信道估計模塊運算部件的FPGA設計

正交頻分復用(OnIlogonaJ Frequency Division Multiplexing，OFDM)技術通過將整個信道分為多個帶寬相等并行傳輸的子信道，通過將信息經過子信道獨立傳輸來實現通信，子信道的正交性可以保證最大限度的利用頻譜資源。OFDM系統通過循環前綴來消除符號間干擾(ISI)，通過IDFT/DFT調制解調降低了系統實現的復雜度。由于其頻譜利用率高，抗多徑能力強，在多種通信場合中都得到了應用。雖然有著上述優點，但為了準確的恢復信號，信道估計是OFDM系統中必須實現的一環。本文正是針對OFDM接收機中的信道估計模塊的運算部件的實現進行了研究。首先，研究了OFDM信道估計的LS算法，一階線性插值算法，二次多項式插值算法，建立了適用于寬帶通信系統的信道估計模塊模型。其次研究了加法器電路和乘法器電路的實現，包括進位行波加法器，曼徹斯特進位鏈，超前進位加法器和乘法原理，陣列乘法器，wallace樹乘法器及BOOTH編碼算法，并分析了各種電路的特性及優缺點。接著研究了幾種主要的除法器設計算法，包括數字循環算法，基于函數迭代的算法，以及CORDIC算法，結合信道估計的特點選擇了函數迭代和CORDIC算法作為具體實現的方法。最后，在前面的設計的基礎上在FPGA芯片上實現了前面的設計方案。

標簽： OFDM FPGA 信道估計模塊

上傳時間： 2013-06-06

上傳用戶：yyyyyyyyyy
64位MIPS微處理器的模塊設計和FPGA驗證

　　作為嵌入式系統核心的微處理器，是SOC不可或缺的“心臟”，微處理器的性能直接影響著整個SOC的性能。　　與國際先進技術相比，我國在這一領域的研究和開發工作還相當落后，這直接影響到我國信息產業的發展。本著趕超國外先進技術，填補我國在該領域的空白以擺脫受制于國外的目的，我國很多科研單位和公司進行了自己的努力和嘗試。經過幾年的探索，已經有多種自主知識產權的處理器芯片完成了設計驗證并逐漸進入市場化階段。我國已結束無“芯”的歷史，并向設計出更高性能處理器的目標邁進。　　艾科創新微電子公司的VEGA處理器，是公司憑借自己的技術力量和科研水平設計出的一款64位高性能RSIC微處理器。該處理器基于MIPSISA構架，采用五級流水線的設計，并且使用了高性能處理器所廣泛采用的虛擬內存管理技術。設計過程中采用自上而下的方法，根據其功能將其劃分為取指、譯碼、算術邏輯運算、內存管理、流水線控制和cache控制等幾個功能塊，使得我們在設計中能夠按照其功能和時序要求進行。　　本文的首先介紹了MIPS微處理器的特點，通過對MIPS指令集和其五級流水線結構的介紹使得對VEGA的設計有了一個直觀的認識。在此基礎上提出了VEGA的結構劃分以及主要模塊的功能。作為采用虛擬內存管理技術的處理器，文章的主要部分介紹了VEGA的虛擬內存管理技術，將VEGA的內存管理單元(MMU)尤其是內部兩個翻譯后援緩沖(TLB)的設計作為重點給出了流水線處理器設計的方法。結束總體設計并完成仿真后，并不能代表設計的正確性，它還需要我們在實際的硬件平臺上進行驗證。作為論文的又一重點內容，介紹了我們在VEGA驗證過程中使用到的FPGA的主要配置單元，FPGA的設計流程。VEGA的FPGA平臺是一完整的計算機系統，我們利用在線調試軟件XilinxChipscope對其進行了在線調試，修正其錯誤。　　經過模塊設計到最后的FPGA驗證，VEGA完成了其邏輯設計，經過綜合和布局布線等后端流程，VEGA采用0.18工藝流片后達到120MHz的工作頻率，可在其平臺上運行Windows-CE和Linux嵌入式操作系統，達到了預計的設計要求。　　

標簽： MIPS FPGA 微處理器模塊設計

上傳時間： 2013-07-07

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基于FPGA的32位浮點數據FFT及IFFT的設計與實現

FFT/IFFT是時域信號與頻域信號之間轉換的基本運算，是數字信號處理的核心工具之一，因此，它廣泛地應用于許多領域。在數字化的今天，不論是在通信領域還是在圖像處理領域，對數字信號處理的速度、精度和實時性要求不斷提高。為滿足不斷提高的要求，國內外不斷地推出各種FFT/IFFT處理器，主要處理器有ASIC、DSP芯片、FPGA等。由于FPGA具有可反復編程的特點及豐富資源，所以它受到廣泛的關注。本論文就是一種基于FPGA實現浮點型數據的FFT及IFFT處理器，該處理器使用A1tera公司的Stratix Ⅱ系列的FPGA芯片。它主要采用流水線結構，這種結構可以使各級運算并行處理，對輸入進來的數據進行連續處理，提高了運算速度，滿足了系統的實時性要求；另外處理器所處理的數據是32位浮點型的，因此它同時提高了運算的精度。

標簽： FPGA IFFT FFT 浮點

上傳時間： 2013-07-12

上傳用戶：cuicuicui
LM324運算放大器應用電路全集

LM324是四運放集成電路,它采用14腳雙列直插塑料封裝,外形如圖所示。它的內部包含四組形式完全相同的運算放大器, 除電源共用外,四組運放相互獨立。每一組運算放大器可用圖1所示的符號來表示,它有5個引出腳,其中“+”、“-”為兩個信號輸入端,“V+”、“V-”為正、負電源端,“Vo”為輸出端。兩個信號輸入端中,Vi-（-）為反相輸入端,表示運放輸出端Vo的信號與該輸入端的位相反;Vi+（+）為同相輸入端,表示運放輸出端Vo的信號與該輸入端的相位相同。

標簽： 324 LM 運算放大器應用電路

上傳時間： 2013-04-24

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32位單精度浮點加法器

32位單精度浮點加法器。進行用加法運算，仿真輸出

標簽： 精度浮點加法器

上傳時間： 2013-04-24

上傳用戶：x4587
基于選擇進位32位加法器的硬件電路實現

為了縮短加法電路運行時間，提高FPGA運行效率，利用選擇進位算法和差額分組算法用硬件電路實現32位加法器，差額分組中的加法單元是利用一種改進的超前進位算法實現，選擇進位算法可使不同的分組單元并行運算，利用低位的運算結果選擇高位的進位為1或者進位為零的運算結果，節省了進位選擇等待的時間，最后利用XILINX進行時序仿真，在FPGA上進行驗證，可穩定運行在高達50兆的頻率，理論分析與計算機仿真表明該算法切實可行、有效并且易于實現。

標簽： 進位加法器硬件電路實現

上傳時間： 2013-12-19

上傳用戶：jshailingzzh

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