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偏移技術(shù)

應(yīng)用于十萬門FPGA的全數(shù)字鎖相環(huán)設(shè)計(jì)

在過去的十幾年間，F(xiàn)PGA取得了驚人的發(fā)展：集成度已達(dá)到1000萬等效門、速度可達(dá)到400～500MHz。隨著FPGA的集成度不斷增大，在高密度FPGA中，芯片上時(shí)鐘的分布質(zhì)量就變得越來越重要。時(shí)鐘延時(shí)和時(shí)鐘相位偏移已成為影響系統(tǒng)性能的重要因素。現(xiàn)在，解決時(shí)鐘延時(shí)問題主要使用時(shí)鐘延時(shí)補(bǔ)償電路。為了消除FPGA芯片內(nèi)的時(shí)鐘延時(shí)，減小時(shí)鐘偏差，本文設(shè)計(jì)了內(nèi)置于FPGA芯片中的延遲鎖相環(huán)，采用一種全數(shù)字的電路結(jié)構(gòu)，將傳統(tǒng)DLL中的用模擬方式實(shí)現(xiàn)的環(huán)路濾波器和壓控延遲鏈改進(jìn)為數(shù)字方式實(shí)現(xiàn)的時(shí)鐘延遲測(cè)量電路，和延時(shí)補(bǔ)償調(diào)整電路，配合特定的控制邏輯電路，完成時(shí)鐘延時(shí)補(bǔ)償。在輸入時(shí)鐘頻率不變的情況下，只需一次調(diào)節(jié)過程即可完成輸入輸出時(shí)鐘的同步，鎖定時(shí)間較短，噪聲不會(huì)積累，抗干擾性好。在Smic0.18um工藝下，設(shè)計(jì)出的時(shí)鐘延時(shí)補(bǔ)償電路工作頻率范圍從25MHz到300MHz，最大抖動(dòng)時(shí)間為35ps，鎖定時(shí)間為13個(gè)輸入時(shí)鐘周期。另外，完成了時(shí)鐘相移電路的設(shè)計(jì)，實(shí)現(xiàn)可編程相移，為用戶提供與輸入時(shí)鐘同頻的相位差為90度，180度，270度的相移時(shí)鐘；時(shí)鐘占空比調(diào)節(jié)電路的設(shè)計(jì)，實(shí)現(xiàn)可編程占空比，可以提供占空比為50/50的時(shí)鐘信號(hào)；時(shí)鐘分頻電路的設(shè)計(jì)，實(shí)現(xiàn)頻率分頻，提供1.5，2，2.5，3，4，5，8，16分頻時(shí)鐘。

標(biāo)簽： FPGA 應(yīng)用于全數(shù)字鎖相環(huán)

上傳時(shí)間： 2013-07-06

上傳用戶：LouieWu
全數(shù)字OQPSK解調(diào)算法的研究及FPGA實(shí)現(xiàn)

隨著各種通信系統(tǒng)數(shù)量的日益增多，為了充分地利用有限的頻譜資源，高頻譜利用率的調(diào)制技術(shù)不斷被應(yīng)用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡(luò)調(diào)制技術(shù)，具有較高的頻譜利用率和功率利用率，廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)和地面移動(dòng)通信系統(tǒng)。因此，對(duì)于OQPSK全數(shù)字解調(diào)技術(shù)的研究具有一定的理論價(jià)值。本文以軟件無線電和全數(shù)字解調(diào)的相關(guān)理論為指導(dǎo)，成功設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的OQPSK全數(shù)字解調(diào)。論文介紹了OQPSK全數(shù)字接收解調(diào)原理和基于軟件無線電設(shè)計(jì)思想的全數(shù)字接收機(jī)的基本結(jié)構(gòu)，詳細(xì)闡述了當(dāng)今OQPSK數(shù)字解調(diào)中載波頻率同步、載波相位同步、時(shí)鐘同步和數(shù)據(jù)幀同步的一些常用算法，并選擇了相應(yīng)算法構(gòu)建了三種系統(tǒng)級(jí)的實(shí)現(xiàn)方案。通過MATLAB對(duì)解調(diào)方案的仿真和性能分析，確定了FPGA中的系統(tǒng)實(shí)現(xiàn)方案。在此基礎(chǔ)上，本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發(fā)平臺(tái)上設(shè)計(jì)了同步解調(diào)系統(tǒng)中的各個(gè)模塊，還對(duì)各模塊和整個(gè)系統(tǒng)在ModelSim中進(jìn)行了時(shí)序仿真驗(yàn)證，并對(duì)設(shè)計(jì)中出現(xiàn)的問題進(jìn)行了修正。最后，經(jīng)過FPGA調(diào)試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實(shí)際測(cè)試，本文對(duì)系統(tǒng)方案進(jìn)行了最終的改進(jìn)與調(diào)整。實(shí)際測(cè)試結(jié)果表明，本文的設(shè)計(jì)最終能夠達(dá)到了預(yù)期的指標(biāo)和要求。本課題設(shè)計(jì)經(jīng)過時(shí)序和資源優(yōu)化后還可以向ASIC和系統(tǒng)級(jí)SOC轉(zhuǎn)化，以進(jìn)一步縮小系統(tǒng)體積、降低成本和提高電路的可靠性，因此具有良好的實(shí)際應(yīng)用價(jià)值。

標(biāo)簽： OQPSK FPGA 全數(shù)字解調(diào)

上傳時(shí)間： 2013-07-14

上傳用戶：aappkkee
基于FPGA的ADC并行測(cè)試方法研究

高性能ADC產(chǎn)品的出現(xiàn)，給混合信號(hào)測(cè)試領(lǐng)域帶來前所未有的挑戰(zhàn)。并行ADC測(cè)試方案實(shí)現(xiàn)了多個(gè)ADC測(cè)試過程的并行化和實(shí)時(shí)化，減少了單個(gè)ADC的平均測(cè)試時(shí)間，從而降低ADC測(cè)試成本。本文實(shí)現(xiàn)了基于FPGA的ADC并行測(cè)試方法。在閱讀相關(guān)文獻(xiàn)的基礎(chǔ)上，總結(jié)了常用ADC參數(shù)測(cè)試方法和測(cè)試流程。使用FPGA實(shí)現(xiàn)時(shí)域參數(shù)評(píng)估算法和頻域參數(shù)評(píng)估算法，并對(duì)2個(gè)ADC在不同樣本數(shù)條件下進(jìn)行并行測(cè)試。　　本研究通過在FPGA內(nèi)部實(shí)現(xiàn)ADC測(cè)試時(shí)域算法和頻域算法相結(jié)合的方法來搭建測(cè)試系統(tǒng)，完成了音頻編解碼器WM8731L的控制模式接口、音頻數(shù)據(jù)接口、ADC測(cè)試時(shí)域算法和頻域算法的FPGA實(shí)現(xiàn)。整個(gè)測(cè)試系統(tǒng)使用Angilent33220A任意信號(hào)發(fā)生器提供模擬激勵(lì)信號(hào)，共用一個(gè)FPGA內(nèi)部實(shí)現(xiàn)的采樣時(shí)鐘控制模塊。并行測(cè)試系統(tǒng)將WM8731.L片內(nèi)的兩個(gè)獨(dú)立ADC的串行輸出數(shù)據(jù)分流成左右兩通道，并對(duì)其進(jìn)行串并轉(zhuǎn)換。然后對(duì)左右兩個(gè)通道分別配置一個(gè)FFT算法模塊和時(shí)域算法模塊，并行地實(shí)現(xiàn)了ADC參數(shù)的評(píng)估算法。在樣本數(shù)分別為128和4096的實(shí)驗(yàn)條件下，對(duì)WM8731L片內(nèi)2個(gè)被測(cè).ADC并行地進(jìn)行參數(shù)評(píng)估，被測(cè)參數(shù)包括增益GAIN、偏移量OFFSET、信噪比SNR、信號(hào)與噪聲諧波失真比SINAD、總諧波失真THD等5個(gè)常用參數(shù)。實(shí)驗(yàn)結(jié)果表明，通過在FPGA內(nèi)配置2個(gè)獨(dú)立的參數(shù)計(jì)算模塊，可并行地實(shí)現(xiàn)對(duì)2個(gè)相同ADC的參數(shù)評(píng)估，減小單個(gè)ADC的平均測(cè)試時(shí)間。FPGA片內(nèi)實(shí)時(shí)評(píng)估算法的實(shí)現(xiàn)節(jié)省了測(cè)試樣本傳輸至自動(dòng)測(cè)試機(jī)PC端的時(shí)間。而且只需將HDL代碼多次復(fù)制，就可實(shí)現(xiàn)多個(gè)被測(cè)ADC在同一時(shí)刻并行地被評(píng)估，配置靈活。基于FPGA的ADC并行測(cè)試方法易于實(shí)現(xiàn)，具有可行性，但由于噪聲的影響，測(cè)試精度有待進(jìn)一步提高。該方法可用于自動(dòng)測(cè)試機(jī)的混合信號(hào)選項(xiàng)卡或測(cè)試子系統(tǒng)。

標(biāo)簽： FPGA ADC 并行測(cè)試方法研究

上傳時(shí)間： 2013-06-07

上傳用戶：gps6888
串口獵人 ( Serial Hunter ) V31

在V29的版本上升級(jí)。發(fā)布日期2011-08-19. -------------------------------------------------------------------------------- 歡迎使用免費(fèi)軟件《串口獵人》V31 ！ -------------------------------------------------------------------------------- 友情提醒1：本軟件如有新版本，將發(fā)布到我的博客《匠人的百寶箱》，歡迎光臨！友情提醒2：點(diǎn)擊右側(cè)【清除】按鈕，可清除本幫助信息。清除后如想再次查閱，請(qǐng)重啟軟件。 -------------------------------------------------------------------------------- 《串口獵人》功能簡(jiǎn)介 -------------------------------------------------------------------------------- 一、基本功能 1、支持16個(gè)COM口、自動(dòng)/手動(dòng)搜索串口、串口參數(shù)的設(shè)置和查看。 2、支持查看或修改串口控制線（DTR、RTS、DCD等等）的狀態(tài)。 3、支持基本的收、發(fā)、查看、保存、載入、清除等功能。 4、兩種收發(fā)格式：HEX碼/字符串，支持中文字符串。（英文=ASCII碼，中文=ANSI(GBK)碼）。 5、大容量的收碼區(qū)，為了加快顯示速度會(huì)把超過10K的數(shù)據(jù)自動(dòng)隱藏（可以點(diǎn)擊【全顯】鈕查看）。 6、收碼區(qū)的顯示方式可以靈活設(shè)置：原始接收數(shù)據(jù)、按幀換行、通道數(shù)據(jù)、發(fā)送數(shù)據(jù)。 7、可以為收到的數(shù)據(jù)標(biāo)注時(shí)間和來源。 8、可以自動(dòng)比對(duì)發(fā)碼區(qū)和收碼區(qū)的數(shù)據(jù)是否一致（用于自發(fā)自收測(cè)試模式）。 9、收碼區(qū)的內(nèi)容，可以點(diǎn)擊【轉(zhuǎn)發(fā)】鈕轉(zhuǎn)到發(fā)碼區(qū)。 10、可以在每次發(fā)碼之前自動(dòng)清除收碼區(qū)。二、高級(jí)發(fā)碼功能 1、自動(dòng)發(fā)列表功能：支持多組（最多16組）數(shù)據(jù)的輪流發(fā)送。 2、自動(dòng)發(fā)文件功能：支持文件逐行發(fā)送。 3、輪發(fā)規(guī)則可以靈活設(shè)置，比如可以定時(shí)發(fā)，也可以收到應(yīng)答后立即發(fā)。 4、輪發(fā)的間隔、無應(yīng)答重發(fā)次數(shù)和循環(huán)次數(shù)均可靈活設(shè)置。 5、靈活的幀格式設(shè)置。支持自動(dòng)添加幀頭、幀尾、幀長(zhǎng)、校驗(yàn)、回車換行符。 6、幀頭、幀尾、幀長(zhǎng)、校驗(yàn)，是否要參與校驗(yàn)或計(jì)入幀長(zhǎng)，皆可靈活設(shè)置。 7、支持3種校驗(yàn)方式：SC(累加和校驗(yàn))、LRC(縱向冗余校驗(yàn))、BBC（異或和校驗(yàn)）。 8、校驗(yàn)碼和幀長(zhǎng)的長(zhǎng)度，可以選擇單/雙字節(jié)。三、高級(jí)收碼功能 1、支持按幀接收數(shù)據(jù)。 2、能自動(dòng)進(jìn)行幀結(jié)束判定（方式非常靈活，可以按幀頭、幀尾、幀長(zhǎng)或時(shí)間）。 3、即時(shí)顯示最新一幀內(nèi)容。 4、擁有八個(gè)獨(dú)立接收通道，可以自動(dòng)從指定幀中指定位置收取有效數(shù)據(jù)。 5、每個(gè)通道的數(shù)據(jù)，可以獨(dú)自顯示、保存、清除。也可以送到收碼區(qū)去顯示。 6、可以設(shè)置通道收取數(shù)據(jù)的首地址、字節(jié)長(zhǎng)度（單字節(jié)或多字節(jié)）、碼制（HEX/BCD）、符號(hào)位形式。 7、示波器功能，可把收取的數(shù)據(jù)用波形方式顯示。示波器的通道數(shù)、倍率、偏移、周期、顏色和線寬等可調(diào)。 8、碼表功能，可把收取的數(shù)據(jù)用碼表方式顯示。（可以設(shè)置碼表的最大/最小值和報(bào)警值）。 9、柱狀圖功能，可把收取的數(shù)據(jù)用柱狀圖方式顯示。（也可以設(shè)置最大/最小值和報(bào)警值）。 10、可以把實(shí)施繪制的圖形保存為圖片。四、其它貼心設(shè)計(jì) 1、用戶的設(shè)置內(nèi)容，可以保存/載入或恢復(fù)默認(rèn)值。可以選擇啟動(dòng)時(shí)載入默認(rèn)值還是上次設(shè)置值。 2、可以通過提示區(qū)和狀態(tài)指示了解軟件當(dāng)前工作狀態(tài)。 3、當(dāng)鼠標(biāo)停留在按鈕、文本框或其它控件上，會(huì)獲得必要的提示。 4、右下角的圖釘按鈕，可以把窗口釘在最前面，避免被其它窗口覆蓋。 5、附送串口電路、協(xié)議、碼表等參考資料。 6、在【版權(quán)信息】標(biāo)簽頁有匠人的聯(lián)系方式，歡迎交流。

標(biāo)簽： Serial Hunter V31 串口獵人

上傳時(shí)間： 2013-07-28

上傳用戶：lili1990
模擬信號(hào)發(fā)生頻率計(jì)方法

? 計(jì)算方法： 1) A值（相位）的計(jì)算：根據(jù)設(shè)置的相位值D（單位為度，0度-360度可設(shè)置），由公式A=D/360，得出A值，按四舍五入的方法得出相位A的最終值； 2) B偏移量值的計(jì)算：按B=512*(1/2VPP-VDC+20)/5； 3) C峰峰值的計(jì)算：按C=VPP/20V*4095；

標(biāo)簽： 模擬信號(hào) 發(fā)生頻率計(jì)

上傳時(shí)間： 2013-11-18

上傳用戶：xdqm
3GHz射頻信號(hào)源模塊GR6710

產(chǎn)品概要： 3GHz射頻信號(hào)源模塊GR6710是軟件程控的虛擬儀器模塊，可以通過測(cè)控軟件產(chǎn)生9kHz到3GHz的射頻信號(hào)源和AM/FM/CW調(diào)制輸出，具有CPCI、PXI、SPI、RS232、RS485和自定義IO接口。產(chǎn)品描述： 3GHz射頻信號(hào)源模塊GR6710是軟件程控的虛擬儀器模塊，可以通過測(cè)控軟件產(chǎn)生9kHz到3GHz的射頻信號(hào)源和AM/FM/CW調(diào)制輸出，還可以通過IQ選件實(shí)現(xiàn)其它任意調(diào)制輸出。GR6710既可程控發(fā)生點(diǎn)頻信號(hào)和掃頻信號(hào)，也支持內(nèi)部調(diào)制和外部調(diào)制。GR6710可安裝于3U/6U背板上工作，也可以獨(dú)立供電工作，使用靈活。該模塊可用于通信測(cè)試、校準(zhǔn)信號(hào)源。技術(shù)指標(biāo) 頻率特性頻率范圍：9kHz～3GHz，500KHz以下指標(biāo)不保證頻率分辨率：3Hz，1Hz（載頻<10MHz時(shí)）頻率穩(wěn)定度：晶振保證電平特性電平范圍：-110dBm～+10dBm 電平分辨率：0.5dB 電平準(zhǔn)確度：≤±2.5dB@POWER<-90dBm，≤±1.5dB@POWER>-90dBm 輸出關(guān)斷功能頻譜純度諧波：9KHz～200MHz≥20dBc，200MHz～3GHz≥30dBc 非諧波：≤80dBc典型值（偏移10kHz，載頻<1GHz），≥68dBc（偏移10kHz，其它載頻），鎖相環(huán)小數(shù)分頻雜散≥64dBc（偏移10kHz） SSB相噪： ≤-98dBc/Hz 偏移20kHz（500MHz） ≤-102dBc/Hz 偏移20kHz（1GHz） ≤-90dBc/Hz 偏移20kHz（>1GHz）調(diào)制輸出：調(diào)幅AM、調(diào)頻FM、脈沖CW，其它調(diào)制輸出可以通過IQ選件實(shí)現(xiàn) 調(diào)制源：內(nèi)、外參考時(shí)鐘輸入和輸出：10MHz，14dBm 控制接口：CPCI、PXI、SPI、RS232、RS485、自定義GPIO 射頻和時(shí)鐘連接器：SMA-K 電源接口：背板供電、獨(dú)立供電可選電源及其功耗：+5V DC、±12V DC（紋波≤2%輸出電壓），≤38W 結(jié)構(gòu)尺寸：3U高度4槽寬度（100mm×160mm×82mm，不含連接器部分）工作環(huán)境：商業(yè)級(jí)溫度和工業(yè)級(jí)溫度可選，振動(dòng)、沖擊、可靠性、MTBF 測(cè)控軟件功能：射頻信號(hào)發(fā)生、調(diào)制信號(hào)輸出、跳頻/掃頻信號(hào)發(fā)生、支持WindowsXP系統(tǒng) 成功案例: 通信綜測(cè)儀器內(nèi)部的信號(hào)源模塊無線電監(jiān)測(cè)設(shè)備內(nèi)部的信號(hào)校準(zhǔn)模塊無線電通信測(cè)試儀器的調(diào)制信號(hào)發(fā)生

標(biāo)簽： 3GHz 6710 GR 射頻信號(hào)源

上傳時(shí)間： 2013-11-13

上傳用戶：s363994250
校準(zhǔn)ADC內(nèi)部偏移的光學(xué)微控制器DS4830

Abstract: The DS4830 optical microcontroller's analog-to-digital converter (ADC) offset can change with temperature and gainselection. However, the DS4830 allows users to measure the ADC internal offset. The measured ADC offset is added to the ADCoffset register to nullify the offset error. This application note demonstrates the DS4830's ADC internal offset calibration in theapplication program.

標(biāo)簽： 4830 ADC DS 校準(zhǔn)

上傳時(shí)間： 2014-12-23

上傳用戶：萍水相逢
2.5Gbs限幅放大器設(shè)計(jì)

限幅放大器信號(hào)通道利用多級(jí)放大方式"降低了輸出信號(hào)上升:下降時(shí)間"減小了級(jí)間驅(qū)動(dòng)能力不匹配對(duì)信號(hào)完整性的影響#通過負(fù)反饋環(huán)路消除了信號(hào)通道上的偏移電壓"采用獨(dú)特的遲滯技術(shù)"使檢測(cè)電路的遲滯對(duì)外接電阻變化不敏感!

標(biāo)簽： 2.5 Gbs 限幅放大器設(shè)計(jì)

上傳時(shí)間： 2013-11-05

上傳用戶：s藍(lán)莓汁
一種載波同步鎖相環(huán)設(shè)計(jì)方案

研究了一種利用corid 算法的矢量及旋轉(zhuǎn)模式對(duì)載波同步中相位偏移進(jìn)行估計(jì)并校正的方法.設(shè)計(jì)并實(shí)現(xiàn)了基于corid 算法的數(shù)字鎖相環(huán).通過仿真驗(yàn)證了設(shè)計(jì)的有效性和高效性.

標(biāo)簽： 載波同步設(shè)計(jì)方案鎖相環(huán)

上傳時(shí)間： 2013-11-21

上傳用戶：吾學(xué)吾舞
電子設(shè)備電磁兼容仿真模型研究

針時(shí)引起電磁干技的主要因素一縫隙．本文提出了縫隙轉(zhuǎn)移阻抗等效建模方法，并在文中詳細(xì)論述，為快速、正確預(yù)測(cè)電于設(shè)備中電磁兼容的性能提供方法和理論依據(jù)。

標(biāo)簽： 電子設(shè)備仿真模型研究電磁兼容

上傳時(shí)間： 2013-10-25

上傳用戶：hullow