JTAG CPLD實現源代碼，比用簡單并口調試器快5倍以上。\r\n以前總覺得簡單的并口jtag板速度太慢，特別是調試bootloader的時候，簡直難以忍受。最近沒什么事情，于是補習了幾天vhdl，用cpld實現了一個快速的jtag轉換板。cpld用epm7128stc100-15，晶振20兆，tck頻率5兆。用sjf2410作測試，以前寫50k的文件用時5分鐘，現在則是50秒左右。tck的頻率還可以加倍，但是不太穩定，而且速度的瓶頸已經不在tck這里，而在通訊上面了。\r\n
上傳時間： 2013-09-04
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為了縮短加法電路運行時間，提高FPGA運行效率，利用選擇進位算法和差額分組算法用硬件電路實現32位加法器，差額分組中的加法單元是利用一種改進的超前進位算法實現，選擇進位算法可使不同的分組單元并行運算，利用低位的運算結果選擇高位的進位為1或者進位為零的運算結果，節省了進位選擇等待的時間，最后利用XILINX進行時序仿真，在FPGA上進行驗證，可穩定運行在高達50兆的頻率，理論分析與計算機仿真表明該算法切實可行、有效并且易于實現。
上傳時間： 2013-12-19
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高速數據轉換器評估平臺(HSDCEP)是基于PC的平臺，提供評估Maxim RF數/模轉換器(RF-DAC，支持更新速率≥ 1.5Gsps)和Maxim數字上變頻器(DUC)的齊全工具。HSDCEP可以在每對數據引腳產生速率高達1.25Gbps的測試碼型，支持多達4條并行16位LVDS總線。通過USB 2.0端口將最長64兆字(Mw)、每字16位寬的數據碼型裝載至HSDCEP存儲器
上傳時間： 2013-10-25
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中興通訊硬件一部巨作－信號完整性 近年來，通訊技術、計算機技術的發展越來越快，高速數字電路在設計中的運用越來 越多，數字接入設備的交換能力已從百兆、千兆發展到幾十千兆。高速數字電路設計對信 號完整性技術的需求越來越迫切。 在中、 大規模電子系統的設計中， 系統地綜合運用信號完整性技術可以帶來很多好處， 如縮短研發周期、降低產品成本、降低研發成本、提高產品性能、提高產品可靠性。 數字電路在具有邏輯電路功能的同時，也具有豐富的模擬特性，電路設計工程師需要 通過精確測定、或估算各種噪聲的幅度及其時域變化，將電路抗干擾能力精確分配給各種 噪聲，經過精心設計和權衡，控制總噪聲不超過電路的抗干擾能力，保證產品性能的可靠 實現。 為了滿足中興上研一所的科研需要， 我們在去年和今年關于信號完整性技術合作的基 礎上，克服時間緊、任務重的困難，編寫了這份硬件設計培訓系列教材的“信號完整性” 部分。由于我們的經驗和知識所限，這部分教材肯定有不完善之處，歡迎廣大讀者和專家 批評指正。 本教材的對象是所內硬件設計工程師， 針對我所的實際情況， 選編了第一章——導論、 第二章——數字電路工作原理、第三章——傳輸線理論、第四章——直流供電系統設計， 相信會給大家帶來益處。同時，也希望通過我們的不懈努力能消除大家在信號完整性方面 的煩腦。 在編寫本教材的過程中，得到了沙國海、張亞東、沈煜、何廣敏、鐘建兔、劉輝、曹 俊等的指導和幫助，尤其在審稿時提出了很多建設性的意見，在此一并致謝！
上傳時間： 2013-11-15
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王兆安老師的
上傳時間： 2013-11-12
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在過去10年中，滿足高帶寬應用需要的布線技術發生了巨大的變化，布線系統所支持的帶寬已從最初10MHz發展到今天的250MHz。2002年6月，TIA/EIA組織最終核準了六類布線標準，將所有廠商的布線產品實現標準化，而網絡設備制造商也將保證它們的設備在六類布線上高速運行。應該說，六類系統的推出為人類從真正意義上跨入千兆網絡的時代奠定了堅實的基礎，但同時也帶來了種種疑惑
上傳時間： 2013-11-02
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關于數字歐姆表設計的介紹
上傳時間： 2013-11-09
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主要功能和特性 1 支持串口的仿真功能 2 串口中斷用戶可以使用 3 不占用定時器 2 4 完全仿真 p0 p2 口 5 支持 89C52 等嵌入式 CPU仿真 6 占用用戶堆棧 2 個字節 7 占用 1 條 I/O : P3.5 8 ISP 在線編程,在線下載 9 仿真頻率最高 33 兆 10 支持同時最多 10 個斷點 11 支持單步,斷點,全速運行 12 支持匯編,c 語言,混合調試 13 支持 KEIL C51 的 IDE 開發仿真環境 UV1 UV2 (V5.20 V6.02 V6.10 V6.12 V6.14) 14 單步執行時間(60 毫秒) 15 程序代碼載入(可以重復裝載,無需預先擦除用戶程序空間) 16 SFR 讀取速度(128 個)200 毫秒 17 跟蹤記錄(trace record)256 條 18 可以仿真標準的 89c51 89c52 89c58 等 51 內核的單片機仿真
上傳時間： 2013-10-24
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LG-32K是老古開發網推出的一個支持keilc51設計軟件的軟件斷點仿真機使用一片SST89C58單片機和一片AT90S8515單片機來實現仿真功能(主CPU和用戶CPU),兩片CPU之間通過一根I/O引腳通訊(通訊速率在33兆晶振時約100KBPS),主CPU負責跟keilc51通訊,用戶CPU只跟主CPU通訊.
上傳時間： 2013-11-06
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本文介紹了以8051為例的單片機與10兆以太網控制器RTL8019AS的硬件連接電路的實現和編程方法。
上傳時間： 2013-10-30
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