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分區(qū)

使用VHDL進行分頻器設計

基于VHDL語言的多種分頻程序

標簽： VHDL 分頻器

上傳時間： 2013-11-02

上傳用戶：xjz632
基于Xilinx FPGA的多分辨率頻譜分析儀設計

　　頻譜分析儀的主要工作原理　　接收到的中頻模擬信號經過A/D轉換為14位的數字信號，首先對數字信號進行數字下變頻（DDC），得到I路、Q路信號，然后根據控制信號對I路、Q路信號進行抽取濾波，使用CIC抽取濾波器完成，然后在分別對I路、Q路信號分別進行低通濾波，濾波器采用FIR濾波器和半帶濾波器相結合的方式，然后對信號進行加窗、FFT（對頻譜進行分析時進行FFT運算，對功率譜進行分析時不進行FFT運算）、I路和Q路平方求和、求平均。最后將輸出的數據送入到DSP中進行顯示與控制的后續處理。

標簽： Xilinx FPGA 多分辨率頻譜分析儀

上傳時間： 2013-11-14

上傳用戶：leixinzhuo
PCB布線的直角走線、差分走線和蛇形線基礎理論

PCB布線的直角走線、差分走線和蛇形線基礎理論

標簽： PCB 布線差分走線走線

上傳時間： 2013-10-08

上傳用戶：旭521
利用Verilog_HDL實現基于FPGA的分頻方法

利用Verilog_HDL實現基于FPGA的分頻方法

標簽： Verilog_HDL FPGA 分頻

上傳時間： 2013-11-20

上傳用戶：atdawn
Verilog_實現任意占空比、任意分頻的方法

Verilog_實現任意占空比、任意分頻的方法

標簽： Verilog 分頻

上傳時間： 2013-11-20

上傳用戶：ccxzzhm
簡單分頻時序邏輯分頻電路設計

簡單分頻時序邏輯電路設計分頻電路，有圖，有代碼

標簽： 分頻時序邏輯電路設計

上傳時間： 2014-01-21

上傳用戶：924484786
用VerilogHDL實現基于FPGA的通用分頻器的設計

用VerilogHDL實現基于FPGA的通用分頻器的設計

標簽： VerilogHDL FPGA 分頻器

上傳時間： 2015-01-02

上傳用戶：oooool
基于FPGA的小數分頻實現方法

基于FPGA的小數分頻實現方法

標簽： FPGA 小數分頻實現方法

上傳時間： 2013-11-05

上傳用戶：feifei0302
差分線對的PCB設計要點

信號完整性是高速數字系統中要解決的一個首要問題之一，如何在高速PCB 設計過程中充分考慮信號完整性因素,并采取有效的控制措施,已經成為當今系統設計能否成功的關鍵。在這方面，差分線對具有很多優勢，比如更高的比特率 ,更低的功耗 ,更好的噪聲性能和更穩定的可靠性等。目前，差分線對在高速數字電路設計中的應用越來越廣泛，電路中最關鍵的信號往往都要采用差分線對設計。介紹了差分線對在PCB 設計中的一些要點，并給出具體設計方案。

標簽： PCB 差分線

上傳時間： 2013-10-26

上傳用戶：lps11188
差分信號PCB布局布線誤區

誤區一：認為差分信號不需要地平面作為回流路徑，或者認為差分走線彼此為對方提供回流途徑。造成這種誤區的原因是被表面現象迷惑，或者對高速信號傳輸的機理認識還不夠深入。雖然差分電路對于類似地彈以及其它可能存在于電源和地平面上的噪音信號是不敏感的。地平面的部分回流抵消并不代表差分電路就不以參考平面作為信號返回路徑，其實在信號回流分析上，差分走線和普通的單端走線的機理是一致的，即高頻信號總是沿著電感最小的回路進行回流，最大的區別在于差分線除了有對地的耦合之外，還存在相互之間的耦合，哪一種耦合強，那一種就成為主要的回流通路。

標簽： PCB 差分信號布局布線

上傳時間： 2013-10-25

上傳用戶：zhaiyanzhong