為滿足對(duì)彈載雷達(dá)回波信號(hào)、圖像及遙測(cè)數(shù)據(jù)的高速、高容量、遠(yuǎn)距離、低功耗、高可靠性等特點(diǎn)的要求。地面測(cè)試臺(tái)采用LVDS接口，運(yùn)用FPGA對(duì)雷達(dá)獲取信號(hào)數(shù)據(jù)進(jìn)行處理與存儲(chǔ)，通過USB接口將數(shù)據(jù)上傳到計(jì)算機(jī)實(shí)現(xiàn)數(shù)據(jù)分析與實(shí)驗(yàn)。實(shí)驗(yàn)結(jié)果表明，該方案的傳輸速率600 MBps，很好的滿足了對(duì)雷達(dá)獲取信號(hào)的數(shù)據(jù)發(fā)送和接收的速度要求。
標(biāo)簽： FPGA 實(shí)時(shí)傳輸 接口設(shè)計(jì)
上傳時(shí)間： 2013-11-10
上傳用戶：小碼農(nóng)lz
白皮書：采用低成本FPGA實(shí)現(xiàn)高效的低功耗PCIe接口 了解一個(gè)基于DDR3存儲(chǔ)器控制器的真實(shí)PCI Express® （PCIe®） Gen1x4參考設(shè)計(jì)演示高效的Cyclone V FPGA怎樣降低系統(tǒng)總成本，同時(shí)實(shí)現(xiàn)性能和功耗目標(biāo)。點(diǎn)擊馬上下載！
上傳時(shí)間： 2013-10-18
上傳用戶：康郎
使用功能強(qiáng)大的FPGA來實(shí)現(xiàn)一種DDR2 SDRAM存儲(chǔ)器的用戶接口。該用戶接口是基于XILINX公司出產(chǎn)的DDR2 SDRAM的存儲(chǔ)控制器，由于該公司出產(chǎn)的這種存儲(chǔ)控制器具有很高的效率，使用也很廣泛，可知本設(shè)計(jì)具有很大的使用前景。本設(shè)計(jì)通過采用多路高速率數(shù)據(jù)讀寫操作仿真驗(yàn)證，可知其完全可以滿足時(shí)序要求，由綜合結(jié)果可知其使用邏輯資源很少，運(yùn)行速率很高，基本可以滿足所有設(shè)計(jì)需要。
標(biāo)簽： SDRAM FPGA DDR2 存儲(chǔ)器
上傳時(shí)間： 2013-10-14
上傳用戶：zxh122
HDB3(High Density Bipolar三階高密度雙極性)碼是在AMI碼的基礎(chǔ)上改進(jìn)的一種雙極性歸零碼，它除具有AMI碼功率譜中無直流分量，可進(jìn)行差錯(cuò)自檢等優(yōu)點(diǎn)外，還克服了AMI碼當(dāng)信息中出現(xiàn)連“0”碼時(shí)定時(shí)提取困難的缺點(diǎn)，而且HDB3碼頻譜能量主要集中在基波頻率以下，占用頻帶較窄，是ITU-TG.703推薦的PCM基群、二次群和三次群的數(shù)字傳輸接口碼型,因此HDB3碼的編解碼就顯得極為重要了[1]。目前，HDB3碼主要由專用集成電路及相應(yīng)匹配的外圍中小規(guī)模集成芯片來實(shí)現(xiàn)，但集成程度不高，特別是位同步提取非常復(fù)雜，不易實(shí)現(xiàn)。隨著可編程器件的發(fā)展，這一難題得到了很好地解決。
上傳時(shí)間： 2013-11-01
上傳用戶：lindor
基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)
上傳時(shí)間： 2013-10-19
上傳用戶：wudu0932
數(shù)字幅頻均衡功率放大器設(shè)計(jì)
標(biāo)簽： 數(shù)字 幅頻均衡 功率 放大器設(shè)計(jì)
上傳時(shí)間： 2013-10-31
上傳用戶：gdgzhym
NiosII軟核處理器是Altera公司開發(fā)，基于FPGA操作平臺(tái)使用的一款高速處理器，為了適應(yīng)高速運(yùn)動(dòng)圖像采集，提出了一種基于NiosII軟核處理的步進(jìn)電機(jī)接口設(shè)計(jì)，使用verilog HDL語言完成該接口設(shè)計(jì)，最后通過QuartusII軟件，給出了實(shí)驗(yàn)仿真結(jié)果。
標(biāo)簽： NiosII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計(jì)
上傳時(shí)間： 2015-01-02
上傳用戶：妄想演繹師
軟件接口
標(biāo)簽： 接口設(shè)計(jì) 說明書 文檔 范例
上傳時(shí)間： 2013-10-12
上傳用戶：huxiao341000
現(xiàn)場(chǎng)可編程門陣列（FPGA）與模數(shù)轉(zhuǎn)換器（ADC）數(shù)字?jǐn)?shù)據(jù)輸出的接口是一項(xiàng)常見的工程設(shè)計(jì)挑戰(zhàn)。此外，ADC使用多種多樣的數(shù)字?jǐn)?shù)據(jù)樣式和標(biāo)準(zhǔn)，使這項(xiàng)挑戰(zhàn)更加復(fù)雜。本資料將告訴您有關(guān)在高速數(shù)據(jù)轉(zhuǎn)換器實(shí)現(xiàn)方案中使用LVDS的應(yīng)用訣竅和技巧。
上傳時(shí)間： 2015-01-02
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在點(diǎn)對(duì)多點(diǎn)主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實(shí)現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標(biāo)準(zhǔn)接口形式。當(dāng)選擇主從多點(diǎn)同步通信方式時(shí),工作過程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語言在FPGA 上實(shí)現(xiàn)的以HDLC/ SDLC 協(xié)議控制為基礎(chǔ)的RS - 485 通信接口芯片。實(shí)驗(yàn)表明,這種接口芯片操作簡單、體積小、功耗低、可靠性高,極具實(shí)用價(jià)值。
上傳時(shí)間： 2014-01-02
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