基于Verilog HDL的16位超前進位加法器 分為3個功能子模塊
標簽: Verilog HDL 進位 加法器
上傳時間: 2014-01-07
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32位元浮點數加法器,用于以VHDL編寫的32位元CPU
標簽: VHDL CPU 浮點數 加法器
上傳時間: 2014-12-19
上傳用戶:壞天使kk
利用verilog hdl編寫的浮點加法器運算單元,單精度。
標簽: verilog hdl 編寫 浮點
上傳時間: 2013-11-29
上傳用戶:王慶才
設計一個一元多項式加法器:兩個多項式相加,輸出多項式并計算
標簽: 多項式 加法器
上傳時間: 2014-01-04
上傳用戶:wendy15
實現十六位加法器,是書籍上配套的應該可用
標簽: 十六位 加法器
上傳時間: 2013-12-21
上傳用戶:alan-ee
22位流水線加法器,altera公司仿真壞境可用。
標簽: 流水線加法器
上傳時間: 2013-12-18
上傳用戶:日光微瀾
這是用VHDL實現的8位加法器,對新手有點幫助。
標簽: VHDL 8位 加法器
上傳時間: 2014-01-05
上傳用戶:1079836864
Verilog寫的 8 位超前進位加法器
標簽: Verilog 進位 加法器
上傳時間: 2017-07-01
上傳用戶:hustfanenze
4位二進制加法器,vhdl實現,外帶譯碼器部分,清晰簡潔,可讀性好
標簽: 二進制 加法器
上傳時間: 2017-07-03
上傳用戶:1101055045
介紹關于FPGA的浮點加法器運算單元設計
標簽: FPGA 浮點 加法器 單元設計
上傳時間: 2014-01-24
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