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核密度估計(jì)(jì)

基于MC8051軟核的星載智能1394終端

提出了一種星載IEEE 1394智能終端的設(shè)計(jì)方案，介紹了基于MC8051軟核與Actel APA系列FPGA開發(fā)IEEE 1394總線接口的設(shè)計(jì)過程與要點(diǎn)，實(shí)現(xiàn)了靈活、小型化、易于擴(kuò)展的1394總線接口。

標(biāo)簽： 8051 1394 MC 軟核

上傳時(shí)間： 2014-12-27

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基于EDA技術(shù)的單片機(jī)IP核設(shè)計(jì)

本文介紹了利用EDA技術(shù)設(shè)計(jì)出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經(jīng)過驗(yàn)證獲得了滿意的效果。

標(biāo)簽： EDA 單片機(jī) IP核

上傳時(shí)間： 2013-10-28

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Cortex-M3 技術(shù)參考手冊

Cortex-M3 技術(shù)參考手冊 Cortex-M3是一個(gè)32位的核，在傳統(tǒng)的單片機(jī)領(lǐng)域中，有一些不同于通用32位CPU應(yīng)用的要求。譚軍舉例說，在工控領(lǐng)域，用戶要求具有更快的中斷速度，Cortex-M3采用了Tail-Chaining中斷技術(shù)，完全基于硬件進(jìn)行中斷處理，最多可減少12個(gè)時(shí)鐘周期數(shù)，在實(shí)際應(yīng)用中可減少70%中斷。　　單片機(jī)的另外一個(gè)特點(diǎn)是調(diào)試工具非常便宜，不象ARM的仿真器動(dòng)輒幾千上萬。針對這個(gè)特點(diǎn)，Cortex-M3采用了新型的單線調(diào)試(Single Wire)技術(shù)，專門拿出一個(gè)引腳來做調(diào)試，從而節(jié)約了大筆的調(diào)試工具費(fèi)用。同時(shí)，Cortex-M3中還集成了大部分存儲器控制器，這樣工程師可以直接在MCU外連接Flash，降低了設(shè)計(jì)難度和應(yīng)用障礙。　　ARM Cortex-M3處理器結(jié)合了多種突破性技術(shù)，令芯片供應(yīng)商提供超低費(fèi)用的芯片，僅33000門的內(nèi)核性能可達(dá)1.2DMIPS/MHz。該處理器還集成了許多緊耦合系統(tǒng)外設(shè)，令系統(tǒng)能滿足下一代產(chǎn)品的控制需求。ARM公司希望Cortex-M3核的推出，能幫助單片機(jī)廠商實(shí).　　Cortex的優(yōu)勢應(yīng)該在于低功耗、低成本、高性能3者(或2者)的結(jié)合。　　Cortex如果能做到合理的低功耗(肯定要比Arm7 & Arm9要低，但不大可能比430、PIC、AVR低) ＋合理的高性能(10~50MIPS是比較可能出現(xiàn)的范圍) ＋適當(dāng)?shù)牡统杀?1~5$應(yīng)該不會(huì)奇怪)。　　簡單的低成本不大可能比典型的8位MCU低。對于已經(jīng)有8位MCU的廠商來說，比如Philips、Atmel、Freescale、Microchip還有ST和Silocon Lab，不大可能用Cortex來打自己的8位MCU。對于沒有8位MCU的廠商來說，當(dāng)然是另外一回事，但他們在國內(nèi)進(jìn)行推廣的實(shí)力在短期內(nèi)還不夠。　　對于已經(jīng)有32位ARM的廠商來說，比如Philips、Atmel、ST，又不大可能用Cortex來打自己的Arm7/9，對他們來說，比較合理的定位把Cortex與Arm7/9錯(cuò)開，即<40MIPS的性能＋低于Arm7的價(jià)格，當(dāng)然功耗也會(huì)更低些；當(dāng)然這樣做的結(jié)果很可能是，斷了16位MCU的后路。　　對于仍然在推廣16位MCU的廠商來說，比如Freescal、Microchip，處境比較尷尬，因?yàn)镃ortex基本上可以完全替代16位MCU。　　所以，未來的1～2年，來自新廠商的Cortex比較值得期待－包括國內(nèi)的供應(yīng)商；對于已有32位ARM的廠商，情況比較有趣；對于16位MCU的廠商，反應(yīng)比較有意思。　　關(guān)于編程模式　　Cortex－M3處理器采用ARMv7-M架構(gòu)，它包括所有的16位Thumb指令集和基本的32位Thumb-2指令集架構(gòu)，Cortex-M3處理器不能執(zhí)行ARM指令集。　　Thumb-2在Thumb指令集架構(gòu)（ISA）上進(jìn)行了大量的改進(jìn)，它與Thumb相比，具有更高的代碼密度并提供16/32位指令的更高性能。　　關(guān)于工作模式　　Cortex-M3處理器支持2種工作模式：線程模式和處理模式。在復(fù)位時(shí)處理器進(jìn)入“線程模式”，異常返回時(shí)也會(huì)進(jìn)入該模式，特權(quán)和用戶（非特權(quán)）模式代碼能夠在“線程模式”下運(yùn)行。　　出現(xiàn)異常模式時(shí)處理器進(jìn)入“處理模式”，在處理模式下，所有代碼都是特權(quán)訪問的。　　關(guān)于工作狀態(tài)　　Coretx-M3處理器有2種工作狀態(tài)。　　Thumb狀態(tài)：這是16位和32位“半字對齊”的Thumb和Thumb-2指令的執(zhí)行狀態(tài)。　　調(diào)試狀態(tài)：處理器停止并進(jìn)行調(diào)試，進(jìn)入該狀態(tài)。

標(biāo)簽： Cortex-M 技術(shù)參考手冊

上傳時(shí)間： 2013-12-04

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基于EDA技術(shù)的單片機(jī)IP核設(shè)計(jì)

本文介紹了利用EDA技術(shù)設(shè)計(jì)出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經(jīng)過驗(yàn)證獲得了滿意的效果。

標(biāo)簽： EDA 單片機(jī) IP核

上傳時(shí)間： 2013-11-14

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一種基于8051核SoC引導(dǎo)程序的設(shè)計(jì)與實(shí)現(xiàn)

引導(dǎo)程序的開發(fā)是系統(tǒng)芯片設(shè)計(jì)的重要組成部分。針對基于8051核的某控制系統(tǒng)芯片的具體要求，提出了一種系統(tǒng)芯片引導(dǎo)程序的設(shè)計(jì)策略。該策略思路是：當(dāng)系統(tǒng)上電復(fù)位后,開始執(zhí)行固化在系統(tǒng)芯片中的引導(dǎo)程序，并加載存儲于片外串行接口Flash的用戶程序到片內(nèi)SRAM中；加載完成后，程序無條件跳到SRAM中執(zhí)行用戶程序。在分析該系統(tǒng)芯片組成的基礎(chǔ)上，重點(diǎn)闡述了引導(dǎo)程序開發(fā)面臨的問題、解決的思路、引導(dǎo)程序的具體實(shí)現(xiàn)及開發(fā)編譯環(huán)境的配置。該方案對其它系統(tǒng)芯片引導(dǎo)程序的設(shè)計(jì)具有一定的參考價(jià)值。

標(biāo)簽： 8051 SoC 引導(dǎo)程序

上傳時(shí)間： 2013-11-23

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用VHDL語言進(jìn)行MCS－51兼容單片機(jī)ip核開發(fā)

用VHDL語言進(jìn)行MCS－51兼容單片機(jī)ip核開發(fā)

標(biāo)簽： VHDL MCS 51兼容語言

上傳時(shí)間： 2013-10-28

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基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例

　　QuartusII中利用免費(fèi)IP核的設(shè)計(jì) 　　作者：雷達(dá)室　　以設(shè)計(jì)雙端口RAM為例說明。　　Step1：打開QuartusII，選擇File—New Project Wizard，創(chuàng)建新工程，出現(xiàn)圖示對話框，點(diǎn)擊Next；

標(biāo)簽： Quartus RAM IP核雙端口

上傳時(shí)間： 2014-12-28

上傳用戶：fghygef
基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

標(biāo)簽： FPGA GPIB 接口 IP核

上傳時(shí)間： 2013-11-04

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ISE新建工程及使用IP核步驟詳解

ISE新建工程及使用IP核步驟詳解

標(biāo)簽： ISE IP核工程

上傳時(shí)間： 2013-11-18

上傳用戶：peterli123456
ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項(xiàng)

ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項(xiàng)

標(biāo)簽： ISE_IP DDR ip 教程

上傳時(shí)間： 2013-11-11

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