以PIC16F87X型號為主，內容包括存儲器；定時/計數器；輸入捕捉/輸出比較/脈寬調制CCP；模/數轉換器；主控同步串行端口等等
上傳時間： 2013-07-29
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超聲波電機(Ultrasonic Motor簡稱USM)是八十年代發展起來的新型微電機。本文針對超聲波電機及其控制技術的研究現狀和發展趨勢,以我國研究技術相對比較成熟并有產業化前景的行波超聲波電機(Traveling-wave Ultrasonic Motor簡稱TUSM)的伺服控制技術為研究對象,以直徑60mm的行波超聲波電機TUSM60為研究實例,在特性測試、動穩態性能分析,辨識模型建立、控制策略與控制算法的選擇與實現等方面展開研究。本論具體的研究內容為： 在分析超聲波電機研究歷史和現狀的基礎上,結合國內外超聲波電機特別是行波超聲波電機控制技術的發展趨勢,重點論述了行波超聲波電機及其驅動控制技術的研究進展。 介紹行波超聲波電機的基本結構,并從該電機的主要理論基礎--壓電原理、行波合成、接觸模型出發,分析了行波超聲波電機定子質點的運動方程.并結合定轉子摩擦接觸特點,分析了行波超聲波電機的運行機理。 根據對行波超聲波電機測試和高精度控制的要求,研制出基于雙DSP和FPGA的超聲波電機高性能測試控制平臺。其中控制核心采用了雙DSP結構,可以在對行波超聲波電機進行控制的同時,將必要的參數讀取出來進行分析和研究。為行波超聲波電機瞬態特性分析以及控制策略、控制算法的深入研究打下了基礎。 對電機的瞬態、穩態特性進行的測試,可以分析驅動頻率、電壓以及相位差等調節量對電機輸出的影響。在此基礎上進一步對行波超聲波電機的調節方式、控制算法選擇方面進行分析,并得到相應結論。 通過對實驗數據的總結和歸納,利用系統辨識中的非參數方法,建立在特定頻率條件下的近似線性模型。在行波超聲波電機工作范圍內,辨識若干組不同頻率條件下的近似線性模型,將這些模型的參數進行二維或三維擬合,可以得到一個關于行波超聲波電機傳遞函數的模型。辨識模型的建立為合理的選擇和優化控制參數,控制效果的驗證等提供了行之有效的手段。 在對行波超聲波電機的速度控制、位置控制展開的研究中.首先利用遺傳算法對常規PI恒轉速控制的控制參數整定及修正方法進行了研究；利用神經元的在線自學習能力,研究和設計單神經元PID-PI轉速控制器,提高控制系統對電機非線性和時變性的適應能力；為了消除在伺服控制中,單一調節量(驅動頻率)情況下,低轉速的跳躍問題,研究和討論了多調節量分段控制方法,并利用模糊控制對控制方法的有效性進行了驗證；在位置控制中,利用轉速控制研究的結果,研究和設計了位置--速度雙環(串級)控制器,實現了電機高精度位置伺服控制。 通過對已有控制系統的改進和簡化,設計和研制了具有實用化價值行波超聲波電機控制器：并將研究成果應用于針對核磁成像設備而設計的行波超聲波電機隨動控制系統中,同時嘗試了將該控制器用于高精度X-Y兩維定位平臺。
上傳時間： 2013-07-13
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高性能伺服控制系統日益廣泛地應用于現代工業、家用電器和國防等各個領域。采用先進控制策略和全數字控制技術的永磁同步電機伺服系統，已成為高性能伺服系統發展的主流方向。應用在交流伺服系統上的背景技術不斷進步，同時市場對伺服系統性能、成本及自適應能力的要求也不斷提高。 本文從詳細分析了永磁同步電機的數學模型和矢量控制的基本原理，選取了基于id=0轉子磁場定向矢量控制方式，采用電壓空間矢量（SVPWM）調制技術，建立了位置、轉速、電流三閉環控制的永磁同步電機伺服系統。針對伺服系統在運行過程中參數變化及負載擾動等問題，深入分析了連續與離散系統滑模變結構控制器設計的基本原則和方法，將滑模變結構控制與矢量控制相結合，改進了基于趨近率的單段滑模面變結構控制，設計了適用于矢量控制位置伺服系統的分段式滑模變結構控制器。在Matlab/Simulink7．1仿真環境和以Freescale MC56F8346DSP為核心的實驗系統平臺進行了詳盡的仿真和實驗研究。結果表明本系統滿足高性能伺服控制系統的基本要求，滑模變結構控制能夠有效應用于矢量控制伺服系統并提高其魯棒性。
上傳時間： 2013-07-18
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新型8 通道24 位模數轉換器ADS1216 及其應用
上傳時間： 2013-04-24
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隨著電力電子技術的發展，開關電源的小型化、高頻化成為趨勢，其中各個部分工作時的電磁干擾問題也越來越嚴重，因此開關電源的電磁兼容性也越來越引起人們的重視。目前，軟開關技術因其能減少開關損耗和提高效率，在開關電源中應用越來越廣泛。本文的主要目的是針對開關電源中的電磁干擾進行分析，研究軟開關技術對電磁干擾的影響，并且提出一種抑制共模干擾的濾波方法。 本文首先介紹了電磁兼容的定義、開關電源EMI的特點，論述了開關電源中EMI的研究現狀。從電磁干擾的三要素出發，介紹了開關電源中電磁干擾的干擾源和干擾的耦合通路。分析了電感、電容、高頻變壓器等器件的高頻特性，并介紹了線性阻抗穩定系統(LISN)的定義和作用。在了解了軟開關基本概念的基礎上，本文以全橋變換器為對象，介紹了移相全橋ZVS的工作原理，分析了它在實現過程中對共模干擾的影響，并在考慮IGBT寄生電容的情況下，對其共模干擾通道進行了分析。然后以UC3875為核心，設計了移相全橋ZVS的控制電路和主電路，實現了軟開關。為了對共模干擾進行抑制，本文提出了一種新型的有源和無源相結合的EMI濾波器，即無源部分采用匹配網絡法，將阻抗失配的影響降到最低；有源部分采用前饋控制，對共模電流進行補償。 針對以上提出的問題，本文通過Saber軟件對移相全橋ZVS進行了仿真，并和硬開關條件下的傳導干擾進行了比較，得出了在高頻段，ZVS的共模干擾小于硬開關，在較低頻段改善不大，甚至更加嚴重，而差模干擾有較大衰減的結論。通過對混合濾波器進行仿真，取得了良好的濾波效果，和傳統的無源EMI濾波器相比，在體積和重量上都有一定優勢。
上傳時間： 2013-05-28
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滑模控制理論的基本原理，各種滑模控制器的MATLAB仿真源程序，程序代碼詳細，正確，能直接運行。
上傳時間： 2013-04-24
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對一些信號的監測尤其是對電壓、電流、溫度等模擬量的監測有著很廣泛的應用，通過監測到的數據，可以對系統相關設置進行及時調整，為人們的生產生活帶來便利與保證。 系統采用Actel公司先進的模數混合FPGA以及Actel公司的SOPC設計解決方案，單芯片實現以CortexMI處理器為核心的片上監測系統。它可以完成對電壓、電流、溫度等模擬量的監測，系統模擬模塊將采集到的數據ADC后送給處理器Cortex-MI進行處理，通過串行口，以太網口和OLED，實現與PC主機交互，板上實時顯示以及遠程主機檢測功能。借助于Actel的先進的新型fusion模數混合FPGA器件，單芯片實現可直接對外部模擬信號進行處理的數模混合系統，簡化了設計；對電壓，電流，溫度等模擬量的測控在日常生活中有很重要的意義，該系統在智能家電，電源監控以及微控制器等領域有廣泛的應用前景。 本文研究的主要內容包括： 1.對現有嵌入式設計方法進行比較，確定系統設計目標并選擇SOPC方案設計系統； 2.系統硬件平臺設計； 3.系統軟件設計。
上傳時間： 2013-06-14
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隨著電子技術的快速發展，各種電子設備對時間精度的要求日益提升。在衛星發射、導航、導彈控制、潛艇定位、各種觀測、通信等方面，時鐘同步技術都發揮著極其重要的作用，得到了廣泛的推廣。對于分布式采集系統來說，中心主站需要對來自于不同采集設備的采集數據進行匯總和分析，得到各個采集點對同一事件的采集時間差異，通過對該時間差異的分析，最終做出對事件的準確判斷。如果分布式采集系統中的各個采集設備不具有統一的時鐘基準，那么得到的各個采集時間差異就不能反映出實際情況，中心主站也無法準確地對事件進行分析和判斷，甚至得出錯誤的結論。因此，時鐘同步是分布式采集系統正常運作的必要前提。 目前國內外時鐘同步領域常用的技術有GPS授時技術，鎖相環技術和IRIG-B 碼等。GPS授時技術雖然精度高，抗干擾性強，但是由于需要專用的GPS接收機，若單純使用GPS 授時技術做時鐘同步，就需要在每個采集點安裝接收機，成本較高。鎖相環是一種讓輸出信號在頻率和相位上與輸入參考信號同步的技術，輸出信號的時鐘準確度和穩定性直接依賴于輸入參考信號。IRIG-B 碼是一種信息量大，適合傳輸的時間碼，但是由于其時間精度低，不適合應用于高精度時鐘同步的系統。基于上述分析，本文結合這三種常用技術，提出了一種基于FPGA的分布式采集系統時鐘同步控制技術。該技術既保留了GPS 授時的高精確度和高穩定性，又具備IRIG-B時間碼易傳輸和低成本的特性，為分布式采集系統中的時鐘同步提供了一種新的解決方案。 本文中的設計采用了Ublox公司的精確授時GPS芯片LEA-5T，通過對GPS芯片串行時間信息解碼，獲得準確的UTC時間，并實現了分布式采集系統中各個采集設備的精確時間打碼。為了能夠使整個分布式采集系統具有統一的高精度數據采集時鐘，本論文采用了數模混合的鎖相環技術，將GPS 接收芯片輸出的高精度秒信號作為參考基準，生成了與秒信號高精度同步的100MHZ 高頻時鐘。本文在FPGA 中完成了IRIG-B 碼的編碼部分，將B 碼的準時標志與GPS 秒信號同步，提高了IRIG-B 碼的時間精度。在分布式采集系統中，IRIG-B時間碼能直接通過串口或光纖將各個采集點時間與UTC時間統一，節約了各點布設GPS 接收機的高昂成本。最后，通過PC104總線對時鐘同步控制卡進行了數據讀取和測試，通過實驗結果的分析，提出了改進方案。實驗表明，改進后的時鐘同步控制方案具有很高的時鐘同步精度，對時鐘同步技術有著重大的推進意義！
上傳時間： 2013-08-05
上傳用戶：lz4v4
現代社會信息量爆炸式增長，由于網絡、多媒體等新技術的發展，用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移，以及PCB布線的困難，使得傳輸速率的進一步提升面臨設計的極限；而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優勢，正迅速取代傳統的并行技術，成為業界的主流。 本論文針對目前比較流行并且有很大發展潛力的兩種高速串行接口電路——高速鏈路口和Rocket I/O進行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺，在其中的一塊信號處理板上，進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真，當仿真驗證通過之后，重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進行數據的互相傳送，接收和發送的數據相同，證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發器進行回環設計，經過回環之后接收到的數據與發送的數據相同，證明了Rocket I/O高速串行接口設計的正確性。
上傳時間： 2013-04-24
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國家863項目“飛行控制計算機系統FC通信卡研制”的任務是研究設計符合CPCI總線標準的FC通信卡。本課題是這個項目的進一步引伸，用于設計SCI串行通信接口，以實現環上多計算機系統間的高速串行通信。 本文以此項目為背景，對基于FPGA的SCI串行通信接口進行研究與實現。論文先概述SCI協議，接著對SCI串行通信接口的兩個模塊：SCI節點模型模塊和CPCI總線接口模塊的功能和實現進行了詳細的論述。 SCI節模型包含Aurora收發模塊、中斷進程、旁路FIFO、接受和發送存儲器、地址解碼、MUX。在SCI節點模型的實現上，利用FPGA內嵌的RocketIO高速串行收發器實現主機之間的高速串行通信，并利用Aurora IP核實現了Aurora鏈路層協議；設計一個同步FIFO實現旁路FIFO；利用FPGA上的塊RAM實現發送和接收存儲器；中斷進程、地址解碼和多路復合分別在控制邏輯中實現。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個部分。本課題中，采用FPGA+PCI軟核的方法來實現CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁：PCI核的配置模塊負責對PCI核進行配置，得到用戶需要的PCI核；用戶邏輯模塊負責實現整個通信接口具體的內部邏輯功能；并引入中斷機制來提高SCI通信接口與主機之間數據交換的速率。 設計選用硬件描述語言VerilogHDL和VHDL，在開發工具Xilinx ISE7.1中完成整個系統的設計、綜合、布局布線，利用Modelsim進行功能及時序仿真，使用DriverWorks為SCI串行通信接口編寫WinXP下的驅動程序，用VC++6.0編寫相應的測試應用程序。最后，將FPGA設計下載到FC通信卡中運行，并利用ISE內嵌的ChipScope Pro虛擬邏輯分析儀對設計進行驗證，運行結果正常。 文章最后分析傳輸性能上的原因，指出工作中的不足之處和需要進一步完善的地方。
上傳時間： 2013-04-24
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