<code id="usyuc"></code>
用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序
標簽： Verilog HDL GF C程序
上傳時間： 2016-01-15
上傳用戶：chenbhdt
信號處理－濾波器設計（基于matlab和Mathmatica的設計方法）中關于無乘法器橢圓IIR濾波器設計的原創程序。
標簽： Mathmatica matlab IIR 濾波器設計
上傳時間： 2016-01-19
上傳用戶：lyy1234
用Verilog語言實現了一個8bit的超前進位加法器，其中包括測試文件。
標簽： Verilog 8bit 語言 加法器
上傳時間： 2013-12-19
上傳用戶：alan-ee
veriog實現的128位高速加法器，fpga實現
標簽： veriog 128 加法器
上傳時間： 2013-11-29
上傳用戶：zhenyushaw
16位加法器，需要的拿去，經仿真試驗成功的
標簽： 加法器
上傳時間： 2016-01-30
上傳用戶：waizhang
基于fpga和sopc的用VHDL語言編寫的EDA移位相加硬件乘法器
標簽： fpga VHDL sopc EDA
上傳用戶：13517191407
介紹了除法器的設計，采用verilogHDL語言，利用modelsim仿真驗證，壓縮包中包含了流程圖
標簽： 除法器
上傳時間： 2016-02-04
上傳用戶：chenlong
介紹了幾種常用的乘法器的設計，carry_save_mult，ripple_carry_mult等，壓縮包中包含結構流程圖，用verilogHDL語言，采用modelsim仿真驗證
標簽： 乘法器
上傳用戶：pompey
關于硬件平臺實現乘法器的構架的書，不錯哦。
標簽： 硬件平臺 乘法器 構架
上傳時間： 2013-12-26
上傳用戶：gxmm
講在乘法器實現當中應用最多的wallace樹比較好的網上資料
標簽： wallace 乘法器 樹 比較
上傳時間： 2016-02-06
上傳用戶：huannan88
蟲蟲下載站版權所有 京ICP備2021023401號-1
