用vhdl實(shí)現(xiàn)簡(jiǎn)單cpu的功能,能夠很好的幫助特別是初學(xué)者學(xué)習(xí)vhdl的功能!
標(biāo)簽： vhdl cpu 初學(xué)者
上傳時(shí)間： 2013-12-15
上傳用戶：D&L37
實(shí)現(xiàn)基本的資料壓縮演算法的參考,以run-length編碼的的演算法機(jī)制,所得出的源碼
標(biāo)簽： run-length 算法
上傳時(shí)間： 2015-10-20
上傳用戶：gundamwzc
SDI接口的源程序,包括擾碼編碼,并串轉(zhuǎn)換,用VHDL硬件描述語(yǔ)言編寫(xiě)
標(biāo)簽： VHDL SDI 接口 源程序
上傳時(shí)間： 2014-08-24
上傳用戶：gtzj
用VHDL語(yǔ)言實(shí)現(xiàn)DDS直接數(shù)字頻率合成器的設(shè)計(jì)，采用正弦RAM表，可實(shí)現(xiàn)頻率可控的正弦數(shù)字信號(hào)，編譯、仿真通過(guò)。
標(biāo)簽： VHDL DDS 語(yǔ)言 數(shù)字頻率合成器
上傳時(shí)間： 2014-01-04
上傳用戶：蟲(chóng)蟲(chóng)蟲(chóng)蟲(chóng)蟲(chóng)蟲(chóng)
用VHDL編的移位寄存器,具有置位,清零,裝載,方向功能.~
標(biāo)簽： VHDL 移位寄存器 方向 零
上傳時(shí)間： 2013-12-26
上傳用戶：小鵬
用VHDL編的編碼器,具有多種功能,希望呢溫暖感跟大家共享~!
標(biāo)簽： VHDL 編碼器 家
上傳時(shí)間： 2015-10-22
上傳用戶：大三三
用VHDL編寫(xiě)的一個(gè)出租車計(jì)費(fèi)器，起步6元計(jì)2公里，此后每半公里計(jì)0.8元，停車等待每2.5分計(jì)0.8元。通過(guò)仿真，但未下載到CPLD測(cè)試
標(biāo)簽： VHDL 編寫(xiě) 出租車計(jì)費(fèi)器
上傳時(shí)間： 2013-12-24
上傳用戶：caixiaoxu26
用VHDL實(shí)現(xiàn)的通信滑碼處理，線路為2.3Mbps，通信終端為2Mbps
標(biāo)簽： VHDL 通信 滑碼
上傳時(shí)間： 2015-10-25
上傳用戶：s363994250
用VHDL語(yǔ)言實(shí)現(xiàn)數(shù)顯時(shí)鐘，devid200.vhd為分頻模塊，scan.vhd為L(zhǎng)ED掃描模塊，timecount.vhd為計(jì)數(shù)模塊
標(biāo)簽： VHDL 語(yǔ)言 數(shù)顯 時(shí)鐘
上傳時(shí)間： 2013-12-25
上傳用戶：gtf1207
用vhdl硬件語(yǔ)言設(shè)計(jì)的16位cpu，上傳的壓縮包既包含源代碼又包含詳細(xì)的文檔說(shuō)明。
標(biāo)簽： vhdl cpu 硬件語(yǔ)言設(shè)計(jì)
上傳時(shí)間： 2015-10-27
上傳用戶：refent
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