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硬件線路

  • FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的,,,,,

    標(biāo)簽: FPGA VHDL ARM EPI

    上傳時間: 2013-10-31

    上傳用戶:chaisz

  • 設(shè)計實例2:MP3播放器硬件電路設(shè)計

    MP3播放器硬件電路設(shè)計實例

    標(biāo)簽: MP3 設(shè)計實例 播放器 硬件電路設(shè)計

    上傳時間: 2013-12-31

    上傳用戶:zczc

  • 算法設(shè)計到硬件邏輯的實現(xiàn) - 實驗練習(xí)與Verilog語法手冊

    算法設(shè)計到硬件邏輯的實現(xiàn) - 實驗練習(xí)與Verilog語法手冊

    標(biāo)簽: Verilog 算法設(shè)計 硬件 實驗

    上傳時間: 2013-10-30

    上傳用戶:012345

  • 基于FPGA的多軸控制器設(shè)計

    介紹了一種基于FPGA的多軸控制器,控制器主要由ARM7(LPC2214)和FPGA(EP2C5T144C8)及其外圍電路組成,用于同時控制多路電機(jī)的運(yùn)動。利用Verilog HDL 硬件描述語言在FPGA中實現(xiàn)了電機(jī)控制邏輯,主要包括脈沖控制信號產(chǎn)生、加減速控制、編碼器反饋信號的辨向和細(xì)分、絕對位移記錄、限位信號保護(hù)邏輯等。論文中給出了FPGA內(nèi)部一些核心邏輯單元的實現(xiàn),并利用Quartus Ⅱ、Modelsim SE軟件對關(guān)鍵邏輯及時序進(jìn)行了仿真。實際使用表明該控制器可以很好控制多軸電機(jī)的運(yùn)動,并且能夠?qū)崿F(xiàn)高精度地位置控制。

    標(biāo)簽: FPGA 多軸控制器

    上傳時間: 2013-10-13

    上傳用戶:lchjng

  • 基于FPGA的無人機(jī)多路視頻監(jiān)控系統(tǒng)設(shè)計

    為了能實時監(jiān)控?zé)o人機(jī)的狀態(tài)和提高無人機(jī)的安全可靠性,本設(shè)計利用FPGA高速率、豐富的片上資源和靈活的設(shè)計接口,設(shè)計了一套無人機(jī)多路監(jiān)控系統(tǒng)。該監(jiān)控系統(tǒng)具備了將處于無人機(jī)不同位置的攝像機(jī)所采集的視頻信息,傳送給地面站控制設(shè)備,并在同一臺顯示器上實現(xiàn)同步顯示的功能。仿真結(jié)果表明,該系統(tǒng)可以很好的保證監(jiān)控視頻的實時性、和高清度,確保無人機(jī)完成偵查任務(wù)。

    標(biāo)簽: FPGA 無人機(jī) 多路 視頻監(jiān)控

    上傳時間: 2013-10-24

    上傳用戶:baiom

  • 中興通訊硬件巨作:信號完整性基礎(chǔ)知識

    中興通訊硬件一部巨作-信號完整性 近年來,通訊技術(shù)、計算機(jī)技術(shù)的發(fā)展越來越快,高速數(shù)字電路在設(shè)計中的運(yùn)用越來 越多,數(shù)字接入設(shè)備的交換能力已從百兆、千兆發(fā)展到幾十千兆。高速數(shù)字電路設(shè)計對信 號完整性技術(shù)的需求越來越迫切。 在中、 大規(guī)模電子系統(tǒng)的設(shè)計中, 系統(tǒng)地綜合運(yùn)用信號完整性技術(shù)可以帶來很多好處, 如縮短研發(fā)周期、降低產(chǎn)品成本、降低研發(fā)成本、提高產(chǎn)品性能、提高產(chǎn)品可靠性。 數(shù)字電路在具有邏輯電路功能的同時,也具有豐富的模擬特性,電路設(shè)計工程師需要 通過精確測定、或估算各種噪聲的幅度及其時域變化,將電路抗干擾能力精確分配給各種 噪聲,經(jīng)過精心設(shè)計和權(quán)衡,控制總噪聲不超過電路的抗干擾能力,保證產(chǎn)品性能的可靠 實現(xiàn)。 為了滿足中興上研一所的科研需要, 我們在去年和今年關(guān)于信號完整性技術(shù)合作的基 礎(chǔ)上,克服時間緊、任務(wù)重的困難,編寫了這份硬件設(shè)計培訓(xùn)系列教材的“信號完整性” 部分。由于我們的經(jīng)驗和知識所限,這部分教材肯定有不完善之處,歡迎廣大讀者和專家 批評指正。 本教材的對象是所內(nèi)硬件設(shè)計工程師, 針對我所的實際情況, 選編了第一章——導(dǎo)論、 第二章——數(shù)字電路工作原理、第三章——傳輸線理論、第四章——直流供電系統(tǒng)設(shè)計, 相信會給大家?guī)硪嫣帯M瑫r,也希望通過我們的不懈努力能消除大家在信號完整性方面 的煩腦。 在編寫本教材的過程中,得到了沙國海、張亞東、沈煜、何廣敏、鐘建兔、劉輝、曹 俊等的指導(dǎo)和幫助,尤其在審稿時提出了很多建設(shè)性的意見,在此一并致謝!

    標(biāo)簽: 中興通訊 硬件 信號完整性 基礎(chǔ)知識

    上傳時間: 2013-11-03

    上傳用戶:奇奇奔奔

  • VerilogHDL硬件描述語言

    VerilogHDL硬件描述語言

    標(biāo)簽: VerilogHDL 硬件描述語言

    上傳時間: 2013-11-06

    上傳用戶:風(fēng)行天下

  • 基于FPGA的多功能多路舵機(jī)控制器的實現(xiàn)

    伺服舵機(jī)作為基本的輸出執(zhí)行機(jī)構(gòu)廣泛應(yīng)用于 遙控航模以及人形機(jī)器人的控制中。舵機(jī)是一種位 置伺服的驅(qū)動器,其控制信號是PWM信號.,利 用占空比的變化改變舵機(jī)的位置,也可使用FPGA、 模擬電路、單片機(jī)來產(chǎn)生舵機(jī)的控制信號舊。應(yīng) 用模擬電路產(chǎn)生PWM信號,應(yīng)用的元器件較多, 會增加電路的復(fù)雜程度;若用單片機(jī)產(chǎn)生PWM信 號,當(dāng)信號路數(shù)較少時單片機(jī)能滿足要求,但當(dāng) PWM信號多于4路時,由于單片機(jī)指令是順序執(zhí) 行的,會產(chǎn)生較大的延遲,從而使PWM信號波形 不穩(wěn),導(dǎo)致舵機(jī)發(fā)生顫振。

    標(biāo)簽: FPGA 多功能 多路 舵機(jī)

    上傳時間: 2013-11-20

    上傳用戶:cjh1129

  • 基于FPGA的多路視頻合成系統(tǒng)的設(shè)計

      摘 要:研究一種基于FPGA的多路視頻合成系統(tǒng)。系統(tǒng)接收16路ITU656格式的視頻數(shù)據(jù),按照畫面分割的要求對視頻數(shù)據(jù)流進(jìn)行有效抽取和幀合成處理,經(jīng)過視頻編碼芯片轉(zhuǎn)換成模擬信號輸出到顯示器,以全屏或多窗口模式顯示多路視頻畫面。系統(tǒng)利用FPGA的高速并行處理能力的優(yōu)勢,應(yīng)用靈活的的多路視頻信號的合成技術(shù)和數(shù)字圖像處理算法,實現(xiàn)實時處理多路視頻數(shù)據(jù)。

    標(biāo)簽: FPGA 多路 視頻合成

    上傳時間: 2013-11-21

    上傳用戶:pei5

  • 七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路

             七天玩轉(zhuǎn)Altera:學(xué)習(xí)FPGA必經(jīng)之路包括基礎(chǔ)篇、時序篇和驗證篇三個部分。

    標(biāo)簽: Altera FPGA

    上傳時間: 2013-11-13

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