cpu設計中關于加法器，乘法器，除法器設計的ppt，希望對硬件學習的人有幫助
上傳時間： 2016-02-09
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功能：雙字節十六進制小數轉換成雙字節ＢＣＤ碼小數 入口條件：待轉換的雙字節十六進制小數在R2、R3中。 出口信息：轉換后的雙字節ＢＣＤ碼小數仍在R2、R3中。 影響資源：PSW、A、B、R2、R3、R4、R5 堆棧需求： ６字節
上傳時間： 2014-07-23
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B樣條（三次）曲線和曲面逼近分析技術文檔
上傳時間： 2013-12-23
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小信號放大器的設計 1. 放大器是射頻/微波系統的必不可少的部件。 2. 放大器有低噪聲、小信號、高增益、中功率、大功率等。 3. 放大器按工作點分有A、AB、B、C、D…等類型。 4. 放大器指標有：頻率范圍、動態范圍、增益、噪聲系數、工作效率、1dB壓縮點、三階交調等。
上傳時間： 2016-02-10
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B樹代碼以及演示，主要是讓大家理解B樹是如何組成的，以及如何刪除和查詢
上傳時間： 2013-12-15
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比較牛b的一個計算器程序,源碼在word文檔里面,
上傳時間： 2016-02-14
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Floyd-Warshall算法描述 1)適用范圍： a)APSP(All Pairs Shortest Paths) b)稠密圖效果最佳 c)邊權可正可負 2)算法描述： a)初始化：dis[u,v]=w[u,v] b)For k:=1 to n For i:=1 to n For j:=1 to n If dis[i,j]>dis[i,k]+dis[k,j] Then Dis[I,j]:=dis[I,k]+dis[k,j] c)算法結束：dis即為所有點對的最短路徑矩陣 3)算法小結：此算法簡單有效，由于三重循環結構緊湊，對于稠密圖，效率要高于執行|V|次Dijkstra算法。時間復雜度O(n^3)。 考慮下列變形：如(I,j)∈E則dis[I,j]初始為1,else初始為0，這樣的Floyd算法最后的最短路徑矩陣即成為一個判斷I,j是否有通路的矩陣。更簡單的，我們可以把dis設成boolean類型，則每次可以用“dis[I,j]:=dis[I,j]or(dis[I,k]and dis[k,j])”來代替算法描述中的藍色部分，可以更直觀地得到I,j的連通情況。
標簽： Floyd-Warshall Shortest Pairs Paths
上傳時間： 2013-12-01
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金蘋果進銷存管理系統-是一個用C#.net編寫的非常使用而且功能強大的進銷存的B/S系統
上傳時間： 2013-12-28
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利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器（數碼管）之外的所有數字電路功能。所有數字邏輯功能都在CPLD器件上用VHDL語言實現。這樣設計具有體積小、設計周期短（設計過程中即可實現時序仿真）、調試方便、故障率低、修改升級容易等特點。 本設計采用自頂向下、混合輸入方式（原理圖輸入—頂層文件連接和VHDL語言輸入—各模塊程序設計）實現數字鐘的設計、下載和調試。 一、 功能說明 已完成功能 1. 完成秒／分／時的依次顯示并正確計數； 2. 秒／分／時各段個位滿10正確進位，秒／分能做到滿60向前進位； 3. 定時鬧鐘：實現整點報時，又揚聲器發出報時聲音； 4. 時間設置，也就是手動調時功能：當認為時鐘不準確時，可以分別對分／時鐘進行調整； 5. 利用多余兩位數碼管完成秒表顯示：A、精度達10ms；B、可以清零；C、完成暫停 可以隨時記時、暫停后記錄數據。 待改進功能： 1. 鬧鐘只是整點報時，不能手動設置報時時間，遺憾之一； 2. 秒表不能向秒進位，也就是最多只能記時100ms； 3. 秒表暫停記錄數據后不能在原有基礎上繼續計時，而是復位重新開始。 【注意】秒表為后來添加功能，所以有很多功能不成熟！
上傳時間： 2014-01-02
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電網月度（年度）檢修計劃圖示化智能分析 技術報告。系統設計了通過B/S模型IE瀏覽器登陸系統網站上報檢修計劃，二級單位主任直接通過網頁審批檢修計劃，實現了上報計劃流程的網絡化。
上傳時間： 2014-10-31
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