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被動

  • 液位測量中的信號采集與處理

    在超聲波探頭上施加一電脈沖信號,探頭發出超聲波,在遇到不同介質界面時被反射,超聲波探頭接收回波并將之變為電脈沖信號。利用P89LPC935 的捕捉功能測量發射波和回波之間的時間間隔,通過環境溫

    標簽: 液位測量 信號采集

    上傳時間: 2013-06-06

    上傳用戶:cee16

  • 基于DSP與FPGA的兩相混合式步進電機細分驅動的實現.rar

    在步進電機驅動方式中,效果最好的是細分驅動,當今高端的步進電機驅動器基本都采用這種技術。步進電機的細分驅動技術是一門綜合了數字化技術、集成控制技術和計算機技術的新技術,被廣泛應用于工業、科研、通訊、天文等領域。 本文設計了一種基于DSP以及FPGA的兩相混合式步進電機SPWM(正弦脈寬調制)波細分驅動系統。在DSP系統中采用TMS320I.F2407A微控制器作為核心控制器件,用軟件產生SPWM波;在FPGA系統中采用FPGA芯片,通過VerilogHDL語言,實現了SPWM波;在功率驅動級電路上采用雙極性H橋的驅動方式。最終實現了對兩相混合式步進電機SPWM波細分驅動,大大提高了步進電機的運轉性能。 本文介紹了兩相混合式步進電機的工作原理、控制原理以及細分驅動的基本原理。通過對恒轉矩細分驅動的分析,提出了兩相混合式步進電機SPWM波細分驅動的方案,并給出了SPWM波產生的數學模型。最后,對步進電機的SPWM波細分驅動系統進行了實驗測量,給出了實驗結果。 實驗的結果表明,設計的基于DSP與FPGA的SPWM波細分驅動系統可以很好地克服電機低頻振蕩的問題,提高電機在中、低速運行的性能。電機的掃描范圍與理論值基本接近;微步距在誤差允許的范圍內也基本可以滿足要求。

    標簽: FPGA DSP 步進電機

    上傳時間: 2013-04-24

    上傳用戶:WANGLIANPO

  • RFID技術介紹

    RFID被列為本世紀十大重要技術項目之一,經濟部技術處為國內科技研發推動之火車頭,92年度起即開始透過工研院系統中心推動高頻 RFID的研發計劃,研發內容包括IC芯片、天線、讀取機(Reader)等重

    標簽: RFID

    上傳時間: 2013-08-04

    上傳用戶:14786697487

  • 高速AD轉換器AD7654與單片機接口電路設計

    模/數轉換是現代測控電路中非常重要的環節,它有并行和串行兩種數據輸出形式。目前,模/數轉換器ADC已被做成大規模集成電路,并有多種型號和種類可供選擇。本文介紹了AD7654的性能特點,并設計了AD76

    標簽: 7654 AD 高速AD轉換器 單片機接口

    上傳時間: 2013-07-18

    上傳用戶:sssnaxie

  • 超寬帶脈沖與MB-OFDM物理層的FPGA實現

    現代通信系統對帶寬和數據速率的要求越來越高,超寬帶(ultra-wideband,UWB)通信以其傳輸速率高、空間容量大、成本低、功耗低的優點,成為解決企業、家庭、公共場所等高速因特網接入的需求與越來越擁擠的頻率資源分配之間的矛盾的技術手段。 論文主要圍繞兩方面展開分析:一是介紹用于UWB無載波脈沖調制及直接序列碼分多址調制(DS-CDMA)的新型脈沖,即Hermite正交脈沖,并且分析了這種構建UWB多元通信和多用戶通信的系統性能。二是分析了UWB的多帶頻分復用物理層提案(MBOA)的調制技術,并在FPGA上實現了調制模塊。正交Hermite脈沖集被提出用于UWB的M元雙正交調制系統,獲得高數據速率。調整脈沖的脈寬因子和中心頻率能使脈沖滿足FCC的頻譜要求。M元雙正交調制的接收機需要M/2個相關器,遠比M元正交調制所需的相關器數量少。誤碼率一定時,維數M的增加可獲得高的比特率和低的信噪比。雖然高階的Hermite脈沖易受抖動時延的影響,但當抖動時延范圍小于0.02ns時,其影響較為不明顯。本文認為1~8階的Hermite脈沖皆可用,可構成16元雙正交系統。 正交Hermite脈沖集也可以構造UWB多用戶系統。各用戶的信息用不同的Hermite脈沖同時傳輸,其多用戶的誤比特率上限低于高斯單脈沖構成的PPM多用戶系統的誤比特率,所以其系統性能更優。正交Hermite脈沖還可以用于UWB的DS-CDMA調制,在8個脈沖可用的情況下,最多可容64個用戶同時通信。 基于MBOA提出的UWB物理層協議,本文用Verilog硬件語言實現了調制與解調結構,并用Modelsim做了時序驗證。用Verilog編程實現的輸出數據與Matlab生成的UWB建模的輸出結果一致。為了達到UWBMB-OFDM系統的FFT處理器的要求,一個混和基多通道流水線的FFT算法結構被提出。其有效的實現方法也被提出。這種結構采用多通道以獲得高的數據吞吐量。此外,它用于存儲和復數乘法器的硬件損耗相比其他的FFT處理器是最少的。高基的FFT蝶算減少了復數乘法器的數量。在132MHz的工作頻率下,整個128點FFT變換在此結構模式下只需要242.4ns,滿足了MBOA的要求。

    標簽: MB-OFDM FPGA 超寬帶 脈沖

    上傳時間: 2013-07-29

    上傳用戶:TI初學者

  • 二維DCT/IDCT處理核的FPGA設計與實現

    離散余弦變換(DCT)及其反變換(IDCT)在圖像編解碼方面應用十分廣泛,至今已被JPEG、MPEG-1、MPEG-2、MPEG-4和H.26x等國際標準所采用。由于其計算量較大,軟件實現往往難以滿足實時處理的要求,因而在很多實際應用中需要采用硬件設計的DCT/IDCT處理電路來滿足我們對處理速度的要求。本文所研究的內容就是針對圖像處理應用的8×8二維DCT/IDCT處理核的硬件實現。 本文首先介紹了DCT和IDCT在圖像處理中的作用和原理,詳細說明了DCT變換實現圖像壓縮的過程,并與其它變換比較說明了用DCT變換實現圖像壓縮的優勢。接著,分析研究了DCT的各種快速算法,總結了前人對DCT快速算法及其實現所做的研究。本文給出了兩種性能、資源上有一定差異的二維DCT/IDCT的FPGA設計方案。兩種方案均利用DCT的行列分離特性,采用流水線設計技術,將二維DCT/IDCT實現轉化為兩個一維DCT/IDCT實現。在一維DCT/IDCT設計中,根據圖像處理的特點對Loeffler算法的數據流進行了優化,通過合理安排時鐘周期數和簡化各周期內的操作,大大縮短了關鍵路徑的執行時間,從而提高了流水線的執行速度。最后,對所設計的DCT/IDCT處理核進行了綜合和時序仿真。 結果表明,當使用Altera公司的MERCURY系列FPGA器件時,本文設計的方案一能夠在116M時鐘頻率下正確完成8×8的二維DCT或IDCT的邏輯運算,消耗2827個邏輯單元;方案二能夠在74M時鐘頻率下正常工作,消耗1629個邏輯單元。

    標簽: IDCT FPGA DCT 二維

    上傳時間: 2013-07-14

    上傳用戶:3291976780

  • FPGA在電機控制器中的應用研究

    隨著國民經濟的飛速發展,傳統的電機已無法滿足當前工程的要求,其作用也由過去簡單的起停控制、提供動力上升到要求對其速度、位置、轉矩等進行精確的控制,并能實現快速加速、減速、反轉以及準確停止等,使被驅動的機械運動符合于集的要求。在集成電路、現代電子技術及控制理論飛速發展的今天,電機控制技術也得到了飛快的發展,電機控制器也由模擬分立元件構成的電路向數模混合、全數字方向發展。本論文主要研究了FPGA芯片在電機控制器中的應用。 論文首先對無刷直流電機系統進行了綜合性論述。對系統的組成、及系統中主要部分:如位置傳感器、逆變器和功率器件、供電直流電源進行了較詳細的說明;并且提出了與本研究相關的控制機理和實施方案。 其次,論文對FPGA芯片的特點及配置電路、以及以FPGA-FLEX10K10為核心的控制器電路的組成進行了較詳細的論述;同時對超高速集成電路硬件描述語言(VHDL)的特點和應用進行了研究;并提出了應用FPGA芯片對電機速度進行控制的系統構成及工作原理。 論文還對FPGA芯片與DSP芯片共同完成電機控制的方案進行了論述,利用ALTERA公司的FPGA芯片完成了電機控制器的設計、制造和調試,并在此基礎上分析研究了利用此控制器對無刷直流電機進行調速控制的方法;兩種控制器共同工作,組合方便、功能強大,適合在高精度、高效、寬變速控制的應用場合下,可對電機實現精度更高、策略更復雜的控制。 論文最后還對在具體產品中的應用效果及行了簡單分析。

    標簽: FPGA 電機控制器 中的應用

    上傳時間: 2013-08-04

    上傳用戶:小鵬

  • 基于FPGA的Rake接收機的研究

    碼分多址(CDMA)通信方式以其特有的抗干擾性、多址能力和多徑分集能力,而成為第三代移動通信系統的主要技術。其中Rake接收技術是CDMA系統中的一項關鍵技術。隨著通信技術的迅猛發展,Rake接收技術以其有效的抗衰落的能力一直是人們研究的熱點。人們不斷的對傳統的Rake接收機進行改進,獲得性能更佳的Rake接收機。FPGA技術的快速發展,也很大的改變了傳統的數字系統設計的方法。FPGA以其龐大的規模、開發過程投資小、開發周期短、保密性好等優點,為人們對Rake接收機的研究提供了方便。 本文旨在設計一種功耗低、硬件實現相對簡單的Rake接收機結構。首先,本文介紹了Rake接收的相關理論,對Rake技術的抗衰落性能進行了分析,然后,對各種Rake接收機進行了比較,最終提出了一種靈活配置的Rake接收機的改進方案,該方案采用了不同的緩沖器結構,能夠更多的節約硬件資源,整個接收機的功耗更低。最后利用VerilogHDL語言對其中的主要模塊進行編程設計,并在Xilinx公司的集成開發工具ISE6.1中進行仿真,仿真平臺為Spartan-3系列中的XC3S1000芯片。仿真結果表明了所設計模塊的正確性。所設計模塊具有良好的可移植性,能夠被相關的系統調用,本文所做工作有一定的實際意義。

    標簽: FPGA Rake 接收機

    上傳時間: 2013-06-21

    上傳用戶:gaorxchina

  • 基于FPGA的工業X-CT二代掃描控制系統研究

    工業X-CT(X-ray Computed Tomography)無損檢測技術是以不損傷或者破壞被檢測對象的一種高新檢測技術,被譽為最佳的無損檢測手段,在無損檢測領域日益受到人們的青睞。近年來,各國都在投入大量的人力、物力對其進行研究與開發。 目前,工業CT主要采用第二代和第三代掃描方式。在工業CT第三代掃描方式中,掃描系統僅作“旋轉”運動,控制系統比較簡單。對此,我國已取得了可喜的成績。然而,對工業CT系統中的二代掃描運動控制系統,即針對“平移+旋轉”運動的控制系統的研究,我國已有采用,但與發達國家相比,還存在較大的差距。二代掃描方式與其它掃描方式相比,具有對被檢物的尺寸沒有要求,且能夠對感興趣的檢測區域進行局部掃描的獨特優點。同時X光源的射線出束角較小(一般小于20°),因此在工業X-CT系統主要采用二代掃描運動控制。有鑒于此,本論文結合有關科研項目,開展了工業X-CT二代掃描控制系統的研究。 論文首先介紹了工業X-CT系統的工作原理和各種掃描運動控制方式的特點,闡述了開展二代掃描控制的研究目的和意義。其次,根據二代掃描控制的特點,提出了“在優先滿足工業X-CT二代掃描控制的基礎上,力求實現對工業X-CT掃描運動的通用控制,使其能同時支持一、三代掃描方式”的設計思想。據此,研究確立了基于單片機AT89LV52及FPGA芯片EP1C3T100C8的運動控制架構,以實現二代掃描控制系統的設計方案。論文詳細介紹了可編程邏輯器件FPGA的工作原理和開發流程,并對其相關開發環境QuartusII4.1作了闡述。結合運動控制系統的硬件設計,詳細介紹了各功能模塊的具體設計過程,給出了相關的設計原理框圖和實際運行波形。并制作了相應的PCB板,調試了整個硬件控制系統。最后,論文還詳細研究了利用VisualC++6.0來完成上位機控制軟件的設計,給出了運動控制主界面及掃描運動控制功能軟件設計的流程圖。 論文對整個運動控制系統采用的經濟型的開環控制技術所帶來的不利影響,分析研究了增加步進電機的細分數以提高掃描精度的可能性,并對所研究的控制系統在調試過程中出現的一些問題及解決方案作了簡要的分析,提出了一些完善方法。

    標簽: FPGA X-CT 工業 掃描控制

    上傳時間: 2013-04-24

    上傳用戶:stella2015

  • 采用FPGA實現基于ATCA架構的2.5Gbps串行背板接口

    當前,在系統級互連設計中高速串行I/O技術迅速取代傳統的并行I/O技術正成為業界趨勢。人們已經意識到串行I/O“潮流”是不可避免的,因為在高于1Gbps的速度下,并行I/O方案已經達到了物理極限,不能再提供可靠和經濟的信號同步方法。基于串行I/O的設計帶來許多傳統并行方法所無法提供的優點,包括:更少的器件引腳、更低的電路板空間要求、減少印刷電路板(PCB)層數、PCB布局布線更容易、接頭更小、EMI更少,而且抵抗噪聲的能力也更好。高速串行I/O技術正被越來越廣泛地應用于各種系統設計中,包括PC、消費電子、海量存儲、服務器、通信網絡、工業計算和控制、測試設備等。迄今業界已經發展出了多種串行系統接口標準,如PCI Express、串行RapidIO、InfiniBand、千兆以太網、10G以太網XAUI、串行ATA等等。 Aurora協議是為私有上層協議或標準上層協議提供透明接口的串行互連協議,它允許任何數據分組通過Aurora協議封裝并在芯片間、電路板間甚至機箱間傳輸。Aurora鏈路層協議在物理層采用千兆位串行技術,每物理通道的傳輸波特率可從622Mbps擴展到3.125Gbps。Aurora還可將1至16個物理通道綁定在一起形成一個虛擬鏈路。16個通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數據傳輸速率。Aurora可優化支持范圍廣泛的應用,如太位級路由器和交換機、遠程接入交換機、HDTV廣播系統、分布式服務器和存儲子系統等需要極高數據傳輸速率的應用。 傳統的標準背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統的并行總線背板。現在,高速串行背板速率普遍從622Mbps到3.125Gbps,甚至超過10Gbps。AdvancedTCA(先進電信計算架構)正是在這種背景下作為新一代的標準背板平臺被提出并得到快速的發展。它由PCI工業計算機制造商協會(PICMG)開發,其主要目的是定義一種開放的通信和計算架構,使它們能被方便而迅速地集成,滿足高性能系統業務的要求。ATCA作為標準串行總線結構,支持高速互聯、不同背板拓撲、高信號密度、標準機械與電氣特性、足夠步線長度等特性,滿足當前和未來高系統帶寬的要求。 采用FPGA設計高速串行接口將為設計帶來巨大的靈活性和可擴展能力。Xilinx Virtex-IIPro系列FPGA芯片內置了最多24個RocketIO收發器,提供從622Mbps到3.125Gbps的數據速率并支持所有新興的高速串行I/O接口標準。結合其強大的邏輯處理能力、豐富的IP核心支持和內置PowerPC處理器,為企業從并行連接向串行連接的過渡提供了一個理想的連接平臺。 本文論述了采用Xilinx Virtex-IIPro FPGA設計傳輸速率為2.5Gbps的高速串行背板接口,該背板接口完全符合PICMG3.0規范。本文對串行高速通道技術的發展背景、現狀及應用進行了簡要的介紹和分析,詳細分析了所涉及到的主要技術包括線路編解碼、控制字符、逗點檢測、擾碼、時鐘校正、通道綁定、預加重等。同時對AdvancedTCA規范以及Aurora鏈路層協議進行了分析, 并在此基礎上給出了FPGA的設計方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設計工具,可在標準ATCA機框內完成單通道速率為2.5Gbps的全網格互聯。

    標簽: FPGA ATCA Gbps 2.5

    上傳時間: 2013-05-29

    上傳用戶:frank1234

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