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賽靈思

Xilinx(賽靈思)是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(IntellectualProperty)核。
  • ISE13.4 design flow

    賽靈思設(shè)計(jì)流程

    標(biāo)簽: design 13.4 flow ISE

    上傳時(shí)間: 2013-11-01

    上傳用戶:腳趾頭

  • 2011電子設(shè)計(jì)競賽培訓(xùn)-PSOC實(shí)驗(yàn)(一)

    賽靈思關(guān)于PSOC的培訓(xùn)資料

    標(biāo)簽: 2011 PSOC 電子設(shè)計(jì)競賽 實(shí)驗(yàn)

    上傳時(shí)間: 2013-11-01

    上傳用戶:zsjinju

  • Nexys3板卡培訓(xùn)資料

      本資料是關(guān)于Nexys3板卡的培訓(xùn)資料。Nexys 開發(fā)板是基于最新技術(shù)Spartan-6 FPGA的數(shù)字系統(tǒng)開發(fā)平臺(tái)。它擁有48M字節(jié)的外部存儲(chǔ)器(包括2個(gè)非易失性的相變存儲(chǔ)器),以及豐富的I/O器件和接口,可以適用于各式各樣的數(shù)字系統(tǒng)。 板上自帶AdeptTM高速USB2接口可以為開發(fā)板提供電源,也可以燒錄程序到FPGA,用戶數(shù)據(jù)的傳輸速率可以達(dá)到38M字節(jié)/秒。   Nexys3開發(fā)板可以通過添加一些低成本的外設(shè)Pmods (可以多達(dá)30幾個(gè))和Vmods (最新型外設(shè))來實(shí)現(xiàn)額外的功能,例如A/D和D/A轉(zhuǎn)換器,線路板,電機(jī)驅(qū)動(dòng)裝置,和實(shí)現(xiàn)裝置等等。另外,Nexys3完全兼容所有的賽靈思工具,包括免費(fèi)的WebPackTM,ChipscopeTM,EDKTM(嵌入式處理器設(shè)計(jì)套件),以及其他工具。 圖 Nexys3板卡介紹

    標(biāo)簽: Nexys3 板卡 培訓(xùn)資料

    上傳時(shí)間: 2013-10-09

    上傳用戶:thing20

  • 《器件封裝用戶向?qū)А?b>賽靈思產(chǎn)品封裝資料

    Introduction to Xilinx Packaging Electronic packages are interconnectable housings for semiconductor devices. The major functions of the electronic packages are to provide electrical interconnections between the IC and the board and to efficiently remove heat generated by the device. Feature sizes are constantly shrinking, resulting in increased number of transistors being packed into the device. Today's submicron technology is also enabling large-scale functional integration and system-on-a-chip solutions. In order to keep pace with these new advancements in silicon technologies, semiconductor packages have also evolved to provide improved device functionality and performance. Feature size at the device level is driving package feature sizes down to the design rules of the early transistors. To meet these demands, electronic packages must be flexible to address high pin counts, reduced pitch and form factor requirements. At the same time,packages must be reliable and cost effective.

    標(biāo)簽: 封裝 器件 用戶 賽靈思

    上傳時(shí)間: 2013-10-22

    上傳用戶:ztj182002

  • Xilinx FPGA設(shè)計(jì)實(shí)例介紹

      電子發(fā)燒友網(wǎng):針對(duì)目前電子發(fā)燒友網(wǎng)舉辦的“玩轉(zhuǎn)FPGA:iPad2,賽靈思開發(fā)板等你拿”,小編在電話回訪過程中留意到有很多參賽選手對(duì)Xilinx 公司的FPGA及其設(shè)計(jì)流程不是很熟悉,所以特意在此整理了一些相關(guān)知識(shí),希望對(duì)大家有所幫助。當(dāng)然也希望Xilinx  FPGA愛好者能跟我們一起來探討學(xué)習(xí)!   本文主要幫助大家熟悉利用ISE進(jìn)行Xilinx 公司FPGA 代碼開發(fā)的基本流程。主要是幫助初學(xué)者了解和初步掌握 ISE 的使用,不需要 FPGA 的開發(fā)基礎(chǔ),所以對(duì)每個(gè)步驟并不進(jìn)行深入的討論。 圖 實(shí)例顯示成果圖

    標(biāo)簽: Xilinx FPGA 設(shè)計(jì)實(shí)例

    上傳時(shí)間: 2013-11-06

    上傳用戶:時(shí)代將軍

  • 成為Xilinx FPGA設(shè)計(jì)專家(基礎(chǔ)篇)

      之前也一直在做關(guān)于Xilinx FPGA各個(gè)方面的文章,但是總體而言就顯得有些雜,總希望能有人能整理一下便于查閱;另外針對(duì)目前電子發(fā)燒友網(wǎng)舉辦的“玩轉(zhuǎn)FPGA:iPad2,賽靈思開發(fā)板等你拿”,小編在電話回訪過程中留意到有很多參賽選手對(duì)Xilinx 公司的FPGA及其設(shè)計(jì)流程不是很熟悉,所以想了想,最終還是決定自己動(dòng)手整合一下。一方面給自己梳理梳理相關(guān)知識(shí)架構(gòu),另一方面的話,跟大家分享分享,希望對(duì)大家有所幫助,當(dāng)然更加希望Xilinx? FPGA工程師/愛好者能跟我們一起來探討學(xué)習(xí)!《成為Xilinx FPGA設(shè)計(jì)專家》這本電子書,計(jì)劃分為3大部分:基礎(chǔ)篇、提升篇、高級(jí)篇。   當(dāng)然這里講的就是《成為Xilinx FPGA設(shè)計(jì)專家》(基礎(chǔ)篇)。本電子書主要論述了等相關(guān)內(nèi)容。本電子書旨在解決工程師日常設(shè)計(jì)中所需的基礎(chǔ)知識(shí),希望這本電子書可以對(duì)各位Xilinx? FPGA工程師/愛好者有所幫助。

    標(biāo)簽: Xilinx FPGA

    上傳時(shí)間: 2013-11-02

    上傳用戶:q986086481

  • Virtex-7HT_Press_Pitch-Chinese-final

    賽靈思正式發(fā)貨全球首款異構(gòu) 3D FPGA,為 Nx100G 和 400G 線路卡解決方案帶來突破性集成能力

    標(biāo)簽: HT_Press_Pitch-Chinese-final Virtex

    上傳時(shí)間: 2013-10-11

    上傳用戶:13033095779

  • 賽靈思三大創(chuàng)新系列28nm FPGA

    隨著行業(yè)的發(fā)展變化,人們對(duì)更高帶寬和更高系統(tǒng)級(jí)性能的需求似乎無止境,同時(shí)整個(gè)行業(yè)面臨著更嚴(yán)苛的功耗降低要求。與此同時(shí),競爭壓力要求客戶必須在不影響產(chǎn)品創(chuàng)新和差異化的情況下不斷提高生產(chǎn)率。

    標(biāo)簽: FPGA 28 nm 賽靈思

    上傳時(shí)間: 2014-12-28

    上傳用戶:xitai

  • WP370 -采用智能時(shí)鐘門控技術(shù)降低動(dòng)態(tài)開關(guān)功耗

        賽靈思推出業(yè)界首款自動(dòng)化精細(xì)粒度時(shí)鐘門控解決方案,該解決方案可將 Virtex®-6 和 Spartan®-6 FPGA 設(shè)計(jì)方案的動(dòng)態(tài)功耗降低高達(dá) 30%。賽靈思智能時(shí)鐘門控優(yōu)化可自動(dòng)應(yīng)用于整個(gè)設(shè)計(jì),既無需在設(shè)計(jì)流程中添加更多新的工具或步驟,又不會(huì)改變現(xiàn)有邏輯或時(shí)鐘,從而避免設(shè)計(jì)修改。此外,在大多數(shù)情況下,該解決方案都能保留時(shí)序結(jié)果。

    標(biāo)簽: 370 WP 智能時(shí)鐘 動(dòng)態(tài)

    上傳時(shí)間: 2013-11-16

    上傳用戶:eastimage

  • WP369-可擴(kuò)展式處理平臺(tái)各種嵌入式系統(tǒng)的理想解決方案

        賽靈思的新型可擴(kuò)展式處理平臺(tái)架構(gòu)可為開發(fā)人員提供無與倫比的系統(tǒng)性能、靈活性、可擴(kuò)展性和集成度,并為降低系統(tǒng)功耗、成本和縮小尺寸進(jìn)行了精心優(yōu)化。   可擴(kuò)展式處理平臺(tái)基于 ARM 的雙核 Cortex™-A9MPCore 處理器以及賽靈思的 28nm 可編程邏輯之上,采用以處理器為核心的設(shè)計(jì)方案,并能定義通過標(biāo)準(zhǔn)設(shè)計(jì)方法實(shí)施的綜合處理器系統(tǒng)。這種方案可為軟件開發(fā)人員在功能齊備且強(qiáng)大的優(yōu)化型低成本低功耗處理平臺(tái)上提供熟悉的編程環(huán)境。

    標(biāo)簽: 369 WP 擴(kuò)展式 處理平臺(tái)

    上傳時(shí)間: 2013-11-20

    上傳用戶:杏簾在望

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