Vivado設計套件，是FPGA廠商賽靈思公司2012年發布的集成設計環境。包括高度集成的設計環境和新一代從系統到IC級的工具，這些均建立在共享的可擴展數據模型和通用調試環境基礎上。集成的設計環境——Vivado設計套件包括高度集成的設計環境和新一代從系統到IC級的工具，這些均建立在共享的可擴展數據模型和通用調試環境基礎上。
標簽： 糾錯 編碼技術 劉富全
上傳時間： 2013-08-01
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在FPGA實現的加法器實現的Veilog代碼，應用軟件為賽林思公司的ISE9.1
標簽： Veilog FPGA 加法器 代碼
上傳時間： 2017-05-16
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第三屆飛思卡爾智能車競賽華東賽一等獎的程序
標簽： 飛思卡爾智能車 競賽 程序
上傳時間： 2017-07-13
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統一數據交換平臺,四川賽思特科技有限公司,UDPE統一數據平臺建設！
標簽： UDPE 數據 交換平臺
上傳時間： 2013-12-23
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北京賽億凌 溫度,濕度
標簽： 溫度 濕度
上傳時間： 2013-07-03
圖靈 LED驅動電路設計 清晰書簽版
標簽： LED 驅動 電路設計
上傳時間： 2013-06-05
北京航空航天大學在參加飛思卡爾智能車比賽中的技術報告
標簽： 航空航天 大學 技術報告
上傳時間： 2013-06-22
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飛思卡爾平板電腦開發板完整電路圖，是A8核的ARM作為cpu
標簽： 飛思卡爾 平板電腦 電路圖
上傳時間： 2013-07-18
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海思hi3511、hi3512芯片的開發技術手冊，對音視頻編解碼開發者很有幫助
標簽： hi 3511 3512 海思
上傳時間： 2013-05-16
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歷年電子設計競賽賽題及其解析，學習電路設計的入門經典資料，電路分析詳盡，實用。包括常用的典型電路模塊，可以移植到自己的設計中。
標簽： 電子設計競賽
上傳時間： 2013-06-07
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