為了縮短加法電路運行時間，提高FPGA運行效率，利用選擇進位算法和差額分組算法用硬件電路實現32位加法器，差額分組中的加法單元是利用一種改進的超前進位算法實現，選擇進位算法可使不同的分組單元并行運算，利用低位的運算結果選擇高位的進位為1或者進位為零的運算結果，節省了進位選擇等待的時間，最后利用XILINX進行時序仿真，在FPGA上進行驗證，可穩定運行在高達50兆的頻率，理論分析與計算機仿真表明該算法切實可行、有效并且易于實現。
上傳時間： 2013-12-19
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數字與模擬電路設計技巧IC與LSI的功能大幅提升使得高壓電路與電力電路除外，幾乎所有的電路都是由半導體組件所構成，雖然半導體組件高速、高頻化時會有EMI的困擾，不過為了充分發揮半導體組件應有的性能，電路板設計與封裝技術仍具有決定性的影響。 模擬與數字技術的融合由于IC與LSI半導體本身的高速化，同時為了使機器達到正常動作的目的，因此技術上的跨越競爭越來越激烈。雖然構成系統的電路未必有clock設計，但是毫無疑問的是系統的可靠度是建立在電子組件的選用、封裝技術、電路設計與成本，以及如何防止噪訊的產生與噪訊外漏等綜合考慮。機器小型化、高速化、多功能化使得低頻/高頻、大功率信號/小功率信號、高輸出阻抗/低輸出阻抗、大電流/小電流、模擬/數字電路，經常出現在同一個高封裝密度電路板，設計者身處如此的環境必需面對前所未有的設計思維挑戰，例如高穩定性電路與吵雜(noisy)性電路為鄰時，如果未將噪訊入侵高穩定性電路的對策視為設計重點，事后反復的設計變更往往成為無解的夢魘。模擬電路與高速數字電路混合設計也是如此，假設微小模擬信號增幅后再將full scale 5V的模擬信號，利用10bit A/D轉換器轉換成數字信號，由于分割幅寬祇有4.9mV，因此要正確讀取該電壓level并非易事，結果造成10bit以上的A/D轉換器面臨無法順利運作的窘境。另一典型實例是使用示波器量測某數字電路基板兩點相隔10cm的ground電位，理論上ground電位應該是零，然而實際上卻可觀測到4.9mV數倍甚至數十倍的脈沖噪訊(pulse noise)，如果該電位差是由模擬與數字混合電路的grand所造成的話，要測得4.9 mV的信號根本是不可能的事情，也就是說為了使模擬與數字混合電路順利動作，必需在封裝與電路設計有相對的對策，尤其是數字電路switching時，ground vance noise不會入侵analogue ground的防護對策，同時還需充分檢討各電路產生的電流回路(route)與電流大小，依此結果排除各種可能的干擾因素。以上介紹的實例都是設計模擬與數字混合電路時經常遇到的瓶頸，如果是設計12bit以上A/D轉換器時，它的困難度會更加復雜。
上傳時間： 2013-11-16
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阻抗匹配 阻抗匹配（Impedance matching）是微波電子學里的一部分，主要用于傳輸線上，來達至所有高頻的微波信號皆能傳至負載點的目的，不會有信號反射回來源點，從而提升能源效益。 大體上，阻抗匹配有兩種，一種是透過改變阻抗力（lumped-circuit matching），另一種則是調整傳輸線的波長（transmission line matching）。 要匹配一組線路，首先把負載點的阻抗值，除以傳輸線的特性阻抗值來歸一化，然后把數值劃在史密夫圖表上。 把電容或電感與負載串聯起來，即可增加或減少負載的阻抗值，在圖表上的點會沿著代表實數電阻的圓圈走動。如果把電容或電感接地，首先圖表上的點會以圖中心旋轉180度，然后才沿電阻圈走動，再沿中心旋轉180度。重覆以上方法直至電阻值變成1，即可直接把阻抗力變為零完成匹配。 由負載點至來源點加長傳輸線，在圖表上的圓點會沿著圖中心以逆時針方向走動，直至走到電阻值為1的圓圈上，即可加電容或電感把阻抗力調整為零，完成匹配.........
標簽： 阻抗匹配
上傳時間： 2013-11-13
上傳用戶：ddddddos
針對小電流接地故障診斷難的問題，設計了一個基于零序電流、零序電壓的實時檢測系統，對供電系統進行檢測并對故障線路進行選線。采用了多任務、可移植、可裁剪的嵌入式操作系統μC/OS-II。為防止中性點帶補償系統對于故障線路的過補償影響，系統還加入了補償零序導納判據對這種接地情況下的故障進行檢測。選線系統采用零序電壓觸發方式，既提高了實時性，也增大了選線的準確性。
上傳時間： 2014-01-18
上傳用戶：海陸空653
串聯高頻逆變電源的逆變橋一定要遵守先關斷后導通的原則，即上下橋臂存在一定的死區時間。本文基于對全橋逆變換流分析的基礎上，以設計最佳死區為目的，最終通過計算得出了使開關器件工作于零電壓開關（ZVS）條件時的死區時間，且設計了以CD4046和SG3525為核心的控制電路，給出了諧振網絡參數的計算。
上傳時間： 2013-10-20
上傳用戶：stella2015
電路如果存在不穩定性因素，就有可能出現振蕩。本文對比分析了傳統LDO和無片電容LDO的零極點，運用電流緩沖器頻率補償設計了一款無片外電容LDO，電流緩沖器頻率補償不僅可減小片上補償電容而且可以增加帶寬。對理論分析結果在Cadence平臺基上于CSMC0.5um工藝對電路進行了仿真驗證。本文無片外電容LDO的片上補償電容僅為3 pF，減小了制造成本。它的電源電壓為3.5~6 V，輸出電壓為3.5 V。當在輸入電源電壓6 V時輸出電流從100 μA到100 mA變化時，最小相位裕度為830，最小帶寬為4.58 MHz
上傳時間： 2014-12-24
上傳用戶：wangjin2945
零電壓開關控制的DC/DC變換器在中大功率應用場合受到越來越多的關注，并被廣泛地應用到工程中，其可靠性受到人們的重視。本文介紹了零電壓開關控制的原理和現在較為常用的零電壓開關控制芯片UCC3895芯片，并用該芯片完成一臺15V/48V的DC/DC變換器設計，給出了電路主要參數的設計和初步的實驗結果。
上傳時間： 2013-11-05
上傳用戶：devin_zhong
過電壓保護器，發電機中性點接地電阻柜，零序電流互感器。消諧電阻器
上傳時間： 2013-10-20
上傳用戶：wvbxj
Abstract: We can apply a BiCMOS integrated circuit with only resistors and no transistors to solve adifficult design problem. The mythically perfect operational amplifier's gain and temperature coefficient aredependent on external resistor values. Maxim precision resistor arrays are manufactured together on asingle die and then automatically trimmed, to ensure close ratio matching. This guarantees that theoperational amplifier (op amp) gain and temperature coefficient are predictable and reliable, even withlarge production volumes.
上傳時間： 2014-11-30
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UCD30xx 系列數字電源控制器包括UCD3040、UCD3020 以及UCD3028，主要應用在交直變換（AC/DC）電源和隔離的直直變換（DC/DC）電源上。數字電源和模擬電源原理是一樣的，但數字電源所使用的值都是數字量，是模擬量離散化后的值，所以不可避免的精度會有所損失。觀察UCD30xx 數字脈寬調制（DPWM）的下降沿，會發現在電源穩態運行時DPWM 下降沿有抖動現象（此時示波器用上升沿觸發）；而根據環路帶寬的不同，DPWM下降沿抖動范圍也會不一樣，帶寬高抖動就大，帶寬低抖動就小。對于大多數應用，這沒有任何問題，但如果帶寬要求很高，那么抖動范圍就會比較大，嚴重時會引起變壓器噪聲超標。本文主要介紹如何利用外加模擬零極點的方法，在不降低系統帶寬的同時降低DPWM抖動范圍。
上傳時間： 2013-11-14
上傳用戶：shen954166632
