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高速采樣

  • NiosⅡ和USB接口的高速數(shù)據(jù)采集卡設(shè)計(jì)

    基于fpga的高速數(shù)據(jù)采集卡設(shè)計(jì)制作

    標(biāo)簽: Nios USB 接口 高速數(shù)據(jù)

    上傳時(shí)間: 2014-12-28

    上傳用戶:cx111111

  • 基于FPGA的激光測(cè)距回波信號(hào)高速采集研究

    在激光測(cè)距系統(tǒng)中,微弱回波信號(hào)的檢測(cè)處理一直是一個(gè)難題。本文主要討論了激光測(cè)距接收系統(tǒng)的實(shí)現(xiàn)方法,這種測(cè)距方法既適用于短距離的測(cè)量又適用于長(zhǎng)距離的測(cè)量。首先介紹了脈沖式激光測(cè)距的原理,在此原理的基礎(chǔ)上,結(jié)合FPGA的高速信號(hào)處理能力,設(shè)計(jì)了高精度激光測(cè)距接收系統(tǒng),并設(shè)計(jì)了回波信號(hào)接收與計(jì)數(shù)電路模塊。

    標(biāo)簽: FPGA 激光測(cè)距 回波信號(hào) 高速采集

    上傳時(shí)間: 2013-10-19

    上傳用戶:dxxx

  • 基于SPI接口和FIFO緩沖器的大容量高速實(shí)時(shí)數(shù)據(jù)存儲(chǔ)方案

    大容量高速實(shí)時(shí)數(shù)據(jù)存儲(chǔ)方案

    標(biāo)簽: FIFO SPI 接口 大容量

    上傳時(shí)間: 2013-11-18

    上傳用戶:youke111

  • 基于FPGA 的低成本長(zhǎng)距離高速傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    為解決目前高速信號(hào)處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問(wèn)題,設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng),本系統(tǒng)借助Altera Cyclone III FPGA 的LVDS I/O 通道產(chǎn)生LVDS 信號(hào),穩(wěn)定地完成了數(shù)據(jù)的高速、遠(yuǎn)距離傳輸。系統(tǒng)所需的8B/10B 編解碼、數(shù)據(jù)時(shí)鐘恢復(fù)(CDR)、串/并行轉(zhuǎn)換電路、誤碼率計(jì)算模塊均在FPGA 內(nèi)利用VHDL 語(yǔ)言設(shè)計(jì)實(shí)現(xiàn),大大降低了系統(tǒng)互聯(lián)的復(fù)雜度和成本,提高了系統(tǒng)集成度和穩(wěn)定性。

    標(biāo)簽: FPGA 高速傳輸

    上傳時(shí)間: 2013-10-30

    上傳用戶:zhishenglu

  • 基于FPGA的高速電路設(shè)計(jì)與仿真

    現(xiàn)代數(shù)字信號(hào)處理從視頻擴(kuò)展到了中頻甚至射頻,針對(duì)要求信號(hào)處理的處理速度越來(lái)越高、傳輸速率越來(lái)越快等特點(diǎn),給出了一款使用高性能FPGA、DAC以及經(jīng)先進(jìn)的PCB設(shè)計(jì)工具設(shè)計(jì)、仿真的高速信號(hào)處理模塊,實(shí)現(xiàn)了對(duì)高速信號(hào)的實(shí)時(shí)接收和處理。關(guān)鍵詞:數(shù)字信號(hào)處理; 高速電路; FPGA;設(shè)計(jì)與仿真

    標(biāo)簽: FPGA 高速電路 仿真

    上傳時(shí)間: 2013-10-21

    上傳用戶:wendy15

  • 采用高速串行收發(fā)器Rocket I/O實(shí)現(xiàn)數(shù)據(jù)率為2.5 G

    摘要: 串行傳輸技術(shù)具有更高的傳輸速率和更低的設(shè)計(jì)成本, 已成為業(yè)界首選, 被廣泛應(yīng)用于高速通信領(lǐng)域。提出了一種新的高速串行傳輸接口的設(shè)計(jì)方案, 改進(jìn)了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關(guān)鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議 為促使FPGA 芯片與串行傳輸技術(shù)更好地結(jié)合以滿足市場(chǎng)需求, Xilinx 公司適時(shí)推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級(jí)的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時(shí)鐘生成及恢復(fù)等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標(biāo)準(zhǔn)的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點(diǎn)到點(diǎn)串行數(shù)據(jù)傳輸, 同時(shí)其可擴(kuò)展的帶寬, 為系統(tǒng)設(shè)計(jì)人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會(huì)導(dǎo)致系統(tǒng)資源的浪費(fèi)。本文提出的設(shè)計(jì)方案可以改進(jìn)Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應(yīng)用前景。

    標(biāo)簽: Rocket 2.5 高速串行 收發(fā)器

    上傳時(shí)間: 2013-11-06

    上傳用戶:smallfish

  • 基于FPGA的高速串行傳輸接口研究與實(shí)現(xiàn)

    摘 要:介紹了FPGA最新一代器件Virtex25上的高速串行收發(fā)器RocketIO。基于ML505開(kāi)發(fā)平臺(tái)構(gòu)建了一個(gè)高速串行數(shù)據(jù)傳輸系統(tǒng),重點(diǎn)說(shuō)明了該系統(tǒng)采用RocketIO實(shí)現(xiàn)1. 25Gbp s高速串行傳輸?shù)脑O(shè)計(jì)方案。實(shí)現(xiàn)并驗(yàn)證了采用FPGA完成千兆串行傳輸?shù)墓δ苣繕?biāo),為后續(xù)采用FPGA實(shí)現(xiàn)各種高速協(xié)議奠定了良好的基礎(chǔ)。關(guān)鍵詞: FPGA;高速串行傳輸; RocketIO; GTP 在數(shù)字系統(tǒng)互連設(shè)計(jì)中,高速串行I/O技術(shù)取代傳統(tǒng)的并行I/O技術(shù)成為當(dāng)前發(fā)展的趨勢(shì)。與傳統(tǒng)并行I/O技術(shù)相比,串行方案提供了更大的帶寬、更遠(yuǎn)的距離、更低的成本和更高的擴(kuò)展能力,克服了并行I/O設(shè)計(jì)存在的缺陷。在實(shí)際設(shè)計(jì)應(yīng)用中,采用現(xiàn)場(chǎng)可編程門陣列( FPGA)實(shí)現(xiàn)高速串行接口是一種性價(jià)比較高的技術(shù)途徑。

    標(biāo)簽: FPGA 高速串行 傳輸接口

    上傳時(shí)間: 2013-11-22

    上傳用戶:lingzhichao

  • 基于FPGA實(shí)現(xiàn)的高速串行交換模塊實(shí)現(xiàn)方法研究

    采用Xlinx公司的Virtex5系列FPGA設(shè)計(jì)了一個(gè)用于多種高速串行協(xié)議的數(shù)據(jù)交換模塊,并解決了該模塊實(shí)現(xiàn)中的關(guān)鍵問(wèn)題.該交換模塊實(shí)現(xiàn)4X模式RapidIO協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換,以及自定義光纖協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換,實(shí)現(xiàn)了單字讀寫以及DMA操作,并提供高速穩(wěn)定的傳輸帶寬.

    標(biāo)簽: FPGA 高速串行 模塊 實(shí)現(xiàn)方法

    上傳時(shí)間: 2013-10-12

    上傳用戶:rnsfing

  • 基于FPGA的多路高速串并轉(zhuǎn)換器設(shè)計(jì)

    高速串并轉(zhuǎn)換器的設(shè)計(jì)是FPGA 設(shè)計(jì)的一個(gè)重要方面,傳統(tǒng)設(shè)計(jì)方法由于采用FPGA 的內(nèi)部邏輯資源來(lái)實(shí)現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗(yàn)證平臺(tái)中多路高速串并轉(zhuǎn)換器的設(shè)計(jì)為例,詳細(xì)闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計(jì)方法和16 路1 :8 串并轉(zhuǎn)換器的實(shí)現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計(jì)的多路串并轉(zhuǎn)換器可以實(shí)現(xiàn)800 Mbit/ s 輸入信號(hào)的串并轉(zhuǎn)換,并且減少了設(shè)計(jì)復(fù)雜度,縮短了開(kāi)發(fā)周期,能滿足設(shè)計(jì)要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場(chǎng)可編程邏輯陣列;Xilinx ; ISERDES

    標(biāo)簽: FPGA 多路 串并轉(zhuǎn)換

    上傳時(shí)間: 2013-11-03

    上傳用戶:王小奇

  • 基于光纖技術(shù)的雷達(dá)高速通信技術(shù)研究

    文章分析了雷達(dá)高速寬帶數(shù)字接收與恢復(fù)的現(xiàn)狀,以及制約其發(fā)展的關(guān)鍵因素,提出基于高速串行器/解串器、FPGA和正交數(shù)字上變頻器的高速寬帶數(shù)字接收與恢復(fù)系統(tǒng)方案。系統(tǒng)以光纖為傳輸媒介,以FPGA為控制核心,正交調(diào)試器為信號(hào)調(diào)制平臺(tái),完成高速數(shù)字接收、基帶信號(hào)預(yù)處理與基帶信號(hào)的上變頻等功能。該系統(tǒng)具有誤碼率低、可靠性高的優(yōu)點(diǎn)。

    標(biāo)簽: 光纖技術(shù) 雷達(dá) 技術(shù)研究 高速通信

    上傳時(shí)間: 2014-12-28

    上傳用戶:czl10052678

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