基于Verilog-HDL的硬件電路的實現 9.7 步進電機的控制 9.7.1 步進電機驅動的邏輯符號 9.7.2 步進電機驅動的時序圖 9.7.3 步進電機驅動的邏輯框圖 9.7.4 計數模塊的設計與實現 9.7.5 譯碼模塊的設計與實現 9.7.6 步進電機驅動的Verilog-HDL描述 9.7.7 編譯指令-"宏替換`define"的使用方法 9.7.8 編譯指令-"時間尺度`timescale"的使用方法 9.7.9 系統任務-"$finish"的使用方法 9.7.10 步進電機驅動的硬件實現
標簽： Verilog-HDL 步進電機驅動 9.7 硬件電路
上傳時間： 2014-01-23
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基于Verilog-HDL的硬件電路的實現 9.8 基于256點陣的漢字顯示 9.8.1 單個靜止漢字顯示的設計原理及其仿真實現 9.8.2 單個靜止漢字顯示的硬件實現 9.8.3 多個靜止漢字顯示的設計原理及其硬件實現 9.8.4 單個運動漢字顯示的設計原理及其硬件實現 9.8.5 多個運動漢字顯示的設計原理及其硬件實現
標簽： Verilog-HDL 漢字顯示 9.8 256
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基本運算邏輯和它們的Verilog HDL模型
標簽： Verilog HDL 運算 模型
上傳時間： 2015-09-17
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pic MCU的HDL語言代碼，實現器件是Xilinx FPGA,經過驗證和測試
標簽： pic MCU HDL 語言
上傳時間： 2014-01-25
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原創VERILOG HDL 實現CACHE的操作，有需要請下載
標簽： VERILOG CACHE HDL 操作
上傳時間： 2015-09-20
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HDL實現的DES算法，及相關的Test bench激勵文件
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上傳時間： 2015-09-21
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verilog hdl編寫,六段流水線CPU.程序完整，功能強驚。分為多模塊編寫
標簽： verilog hdl CPU 編寫
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Verilog 程序例子 王金明：《Verilog HDL程序設計教程》程序例子，帶說明。
標簽： Verilog HDL 程序 教程
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aes算法的verilog hdl實現，供給大家作為參考 。
標簽： verilog aes hdl 算法
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verilog HDL picoblaze07.3.20
標簽： picoblaze verilog HDL 07
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