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• 基本運算邏輯和它們的Verilog HDL模型免費下載

  資源簡介：基本運算邏輯和它們的Verilog HDL模型

  標簽： Verilog HDL 運算 模型

  上傳時間： 2015-09-17

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• 第一章 數字信號處理、計算、程序、算法和硬線邏輯的基本概念 第二章 Verilog HDL設計方法概述 第三章 Verilog HDL的基本語法 第四章 不同抽象級別的Verilog HDL模型免費下載

  資源簡介：第一章 數字信號處理、計算、程序、算法和硬線邏輯的基本概念 第二章 Verilog HDL設計方法概述 第三章 Verilog HDL的基本語法 第四章 不同抽象級別的Verilog HDL模型 第五章 基本運算邏輯和它們的Verilog HDL模型 第六章 運算和數據流動控制邏輯 第七章...

  標簽： Verilog HDL 數字信號處理 基本概念

  上傳時間： 2016-02-08

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• 第一章 數字信號處理、計算、程序、 算法和硬線邏輯的基本概念 第二章 Verilog HDL設計方法概述 第三章 Verilog HDL的基本語法 第四章 不同抽象級別的Verilog HDL免費下載

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  標簽： Verilog HDL 數字信號處理 基本概念

  上傳時間： 2014-01-27

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• 這個文件中使用Verilog HDL簡單的利用基本運算實現了微型的cpu設計開發過程免費下載

  資源簡介：這個文件中使用Verilog HDL簡單的利用基本運算實現了微型的cpu設計開發過程

  標簽： Verilog HDL cpu 運算

  上傳時間： 2016-08-24

  上傳用戶：hgy9473

• 從算法設計到硬線邏輯的實現：復雜數字邏輯系統的Verilog HDL設計技術和方法免費下載

  資源簡介：從算法設計到硬線邏輯的實現：復雜數字邏輯系統的Verilog HDL設計技術和方法，結合DSP算法介紹Verilog HDL 設計。

  標簽： Verilog HDL 算法設計 數字邏輯

  上傳時間： 2016-12-16

  上傳用戶：xiaohuanhuan

• 是關于dct的Verilog HDL源代碼和測試程序免費下載

  資源簡介：是關于dct的Verilog HDL源代碼和測試程序

  標簽： Verilog dct HDL 源代碼

  上傳時間： 2014-06-15

  上傳用戶：四只眼

• 設計一個可進行復數運算的演示程序。要求實現下列六種基本運算:1)由輸入的實部和虛部生成一個復數；2)兩個復數求和；3)兩個復數求差；4)兩個復數求積免費下載

  資源簡介：設計一個可進行復數運算的演示程序。要求實現下列六種基本運算:1)由輸入的實部和虛部生成一個復數；2)兩個復數求和；3)兩個復數求差；4)兩個復數求積，5)從已知復數中分離出實部；6)從已知復數中分離出虛部。運算結果以相應的復數或實數的表示形式顯示。

  標簽： 運算 程序 輸入

  上傳時間： 2013-12-24

  上傳用戶：zhangyi99104144

• 包含了四位計數器等基本數字模塊的的Verilog HDL程序代碼,該功能實現,可以直接利用DC進行綜合,得到硬件電路,亦能夠轉換成VHDL語言進行綜合免費下載

  資源簡介：包含了四位計數器等基本數字模塊的的Verilog HDL程序代碼,該功能實現,可以直接利用DC進行綜合,得到硬件電路,亦能夠轉換成VHDL語言進行綜合

  標簽： Verilog VHDL HDL 計數器

  上傳時間： 2013-12-19

  上傳用戶：hopy

• 本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫EEPROM的Verilog HDL 行為模塊（eeprom_wr.v）、信號產生模塊（signal.v）和頂層模塊(top.v)免費下載

  資源簡介：本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫EEPROM的Verilog HDL 行為模塊（eeprom_wr.v）、信號產生模塊（signal.v）和頂層模塊(top.v) ，這樣可以有一個完整的EEPROM的控制模塊和測試文件，本文件通過測試。

  標簽： EEPROM eeprom_wr Verilog eeprom

  上傳時間： 2017-01-22

  上傳用戶：lanjisu111

• 4 digital LED dynamic display的Verilog HDL源代碼免費下載

  資源簡介：4 digital LED dynamic display的Verilog HDL源代碼，它能動態的顯示4位數，為FPGA 的DEBUG 提供便利，非常經典，簡單易懂，并且經過了Modelsim/ISE/FPGA(XC3S250ETQ144)驗證和實現，好的行為模型就應該大家分享。

  標簽： digital Verilog dynamic display

  上傳時間： 2016-04-12

  上傳用戶：壞天使kk

• SDRAM的Verilog HDL程序免費下載

  資源簡介：SDRAM的Verilog HDL程序，適合DE2開發板，和TRDB-LCM顯示器，很好哦

  標簽： Verilog SDRAM HDL 程序

  上傳時間： 2014-01-03

  上傳用戶：skfreeman

• 4bit ALU（運算邏輯單元）的設計 給出了此次設計alu的輸入輸出結構及相應的位數。其中C0是一位的進位輸入免費下載

  資源簡介：4bit ALU（運算邏輯單元）的設計 給出了此次設計alu的輸入輸出結構及相應的位數。其中C0是一位的進位輸入，A和B分別是4位的數據輸入，S0、S1、M分別為一位的功能選擇輸入信號；Cout是一位的進位輸出，F是4為的運算結果輸出。

  標簽： 4bit ALU alu 運算

  上傳時間： 2013-12-09

  上傳用戶：sevenbestfei

• 基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼免費下載

  資源簡介：基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼，其功能主要有：時間設置，時間顯示，跑表，分頻，日期設置，日期顯示等

  標簽： Verilog FPGA HDL 多功能

  上傳時間： 2013-08-18

  上傳用戶：問題問題

• 用于計算CRC的Verilog HDL源碼免費下載

  資源簡介：用于計算CRC的Verilog HDL源碼

  標簽： Verilog CRC HDL 計算

  上傳時間： 2015-02-07

  上傳用戶：569342831

• JSP的強大優勢在于把一種應用的商務邏輯和它的介紹分離開來。用 Smalltalk的面向對象的術語來說免費下載

  資源簡介：JSP的強大優勢在于把一種應用的商務邏輯和它的介紹分離開來。用 Smalltalk的面向對象的術語來說， JSP鼓勵MVC(model-view-controller)的web應用。JSP的classes 或 beans 是模型, JSP 是這個視圖, 而Servlet是控制器。這個例子是一個簡單的留言板

  標簽： Smalltalk JSP 商 分離

  上傳時間： 2013-12-20

  上傳用戶：003030

• 我用過的Verilog HDL寫的SDRAM core源程序,經過測試應用免費下載

  資源簡介：我用過的Verilog HDL寫的SDRAM core源程序,經過測試應用

  標簽： Verilog SDRAM core HDL

  上傳時間： 2015-03-31

  上傳用戶：15071087253

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  資源簡介：USB主機和設備的Verilog代碼，實現了USB1.1協議規范的要求

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  上傳時間： 2015-04-09

  上傳用戶：標點符號

• 11,13,16位超前進位加法器的Verilog HDL源代碼。免費下載

  資源簡介：11,13,16位超前進位加法器的Verilog HDL源代碼。

  標簽： Verilog HDL 11 13

  上傳時間： 2013-12-28

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  資源簡介：FPGA/CPLD應用,uart的Verilog HDL原碼

  標簽： Verilog FPGA CPLD uart

  上傳時間： 2013-12-28

  上傳用戶：lizhizheng88

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  上傳時間： 2013-11-26

  上傳用戶：星仔

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  標簽： Verilog aes HDL 算法

  上傳時間： 2013-12-18

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• 8251和8055的Verilog源碼免費下載

  資源簡介：8251和8055的Verilog源碼，可進行綜合和仿真，是學習SOC的好資料！

  標簽： Verilog 8251 8055 源碼

  上傳時間： 2014-08-24

  上傳用戶：lhc9102

• 通用串行異步收發器8251的Verilog HDL源代碼,經過仿真驗證。免費下載

  資源簡介：通用串行異步收發器8251的Verilog HDL源代碼,經過仿真驗證。

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  上傳時間： 2015-11-21

  上傳用戶：lizhizheng88

• 文中給出了在數字系統設計時常用的器件,和它們的參數希望對大家有所幫助免費下載

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  標簽： 數字系統設計 器件 參數 家

  上傳時間： 2014-01-20

  上傳用戶：jkhjkh1982

• 算術處理器的Verilog HDL的源代碼免費下載

  資源簡介：算術處理器的Verilog HDL的源代碼

  標簽： Verilog HDL 算術 處理器

  上傳時間： 2016-01-07

  上傳用戶：bjgaofei

• ps2接口的Verilog HDL源代碼免費下載

  資源簡介：ps2接口的Verilog HDL源代碼

  標簽： Verilog ps2 HDL 接口

  上傳時間： 2016-01-07

  上傳用戶：杜瑩12345

• 用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序免費下載

  資源簡介：用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序

  標簽： Verilog HDL GF C程序

  上傳時間： 2016-01-15

  上傳用戶：王楚楚

• 用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序免費下載

  資源簡介：用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序

  標簽： Verilog HDL GF C程序

  上傳時間： 2016-01-15

  上傳用戶：chenbhdt

• 用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序免費下載

  資源簡介：用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序

  標簽： Verilog HDL GF C程序

  上傳時間： 2014-01-13

  上傳用戶：gyq

• 占用資源少的Verilog HDL uart接口；采用固定波特率115200免費下載

  資源簡介：占用資源少的Verilog HDL uart接口；采用固定波特率115200，可以修改程序中的分頻來修改波特率，模式為1個啟始位，8位數據位，1個停止位；帶1字節緩存；當緩存空時輸出空信號

  標簽： Verilog 115200 uart HDL

  上傳時間： 2013-12-28

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