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Adder

上海交大float point Adder 設(shè)計ppt

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標(biāo)簽： float Adder point

上傳時間： 2015-02-07

上傳用戶：450976175
Ripple Adder: 16-bit 全加,半加及ripple Adder的設(shè)計及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置進(jìn)位加法器的設(shè)計方

Ripple Adder: 16-bit 全加,半加及ripple Adder的設(shè)計及VHDL程序 Carry Look ahead Adder:4, 16, 32 bits 前置進(jìn)位加法器的設(shè)計方案及VHDL程序 Carry Select Adder:16 Bits 進(jìn)位選擇加法器的設(shè)計方案及VHDL程序

標(biāo)簽： Adder Ripple ripple Carry

上傳時間： 2015-05-13

上傳用戶：我們的船長
counter and Adder program by vhdl. Just enjoy it!

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標(biāo)簽： counter program Adder enjoy

上傳時間： 2015-06-15

上傳用戶：x4587
fullAdder.vhd 一位全加器 Adder.vhd 四位全加器 multi4.vhd 四位并行乘法器

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標(biāo)簽： vhd fullAdder Adder multi

上傳時間： 2015-09-03

上傳用戶：上善若水
許多非常有用的 Verilog 實例: ADC, FIFO, Adder, MULTIPLIER 等

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標(biāo)簽： MULTIPLIER Verilog Adder FIFO

上傳時間： 2015-10-06

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Self timed pipelined Adder

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標(biāo)簽： pipelined timed Adder Self

上傳時間： 2014-01-10

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full Adder設(shè)計代碼

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標(biāo)簽： Adder full 代碼

上傳時間： 2015-11-20

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IEEE754 floating point Adder

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標(biāo)簽： floating Adder point IEEE

上傳時間： 2016-05-14

上傳用戶：exxxds
a demo script of "carry lookahead Adder" for synopsys design compiler

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標(biāo)簽： lookahead compiler synopsys script

上傳時間： 2016-07-22

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carry lookahead Adder verilog program

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標(biāo)簽： lookahead verilog program carry

上傳時間： 2014-12-02

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