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IP內核

  • FPGA中IP核的生成講解

    該文檔為FPGA中IP核的生成講解資料，講解的還不錯，感興趣的可以下載看看…………………………

    標簽： fpga ip核

    上傳時間： 2021-11-10

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  • FPGA_ASIC-NiosSoC系統中的BCH編解碼IP核的設計

    該文檔為FPGA_ASIC-NiosSoC系統中的BCH編解碼IP核的設計講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

    標簽： fpga

    上傳時間： 2022-03-12

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  • 設計的帶嵌入式收發器的Gen1×1硬核IP的 PCI Express IP編譯器

    在Cyclone IV GX收發器入門套件上,設計帶嵌入式收發器的Gen1×1硬核IP的 PCI Express IP編譯器。.rar

    標簽： 嵌入式

    上傳時間： 2022-04-23

    上傳用戶：kingwide

  • Xilinx FPGA應用進階 通用IP核詳解和設計開發 資料

    Xilinx FPGA應用進階  通用IP核詳解和設計開發

    標簽： xilinx fpga IP核

    上傳時間： 2022-06-03

    上傳用戶：jiabin

  • USB2.0 IP核,ASIC,FPGA可用,Verilog HDL源代碼

    USB2.0 IP核,ASIC,FPGA可用,Verilog HDL源代碼

    標簽： usb asic fpga verilog hdl

    上傳時間： 2022-06-25

    上傳用戶：qingfengchizhu

  • 基于IP核雙口RAM的FPGA與DSPEMIF的接口設計

    基于IP核雙口RAM的FPGA與DSPEMIF的接口設計                

    標簽： RAM fpga dsp emif 接口

    上傳時間： 2022-07-09

    上傳用戶：jiabin

  • digilent提供的基于vivado的xilinx ip核

    digilent提供的基于vivado的xilinx ip核，包含常用的hdmi解碼ip等文件

    標簽： vivado ip核

    上傳時間： 2022-07-26

    上傳用戶：trh505

  • 8051 IP核VERILOG代碼

    可以用來學習8051IP核設計，掌握8051的開發，以及SOC的設計

    標簽： VERILOG 8051 IP核 代碼

    上傳時間： 2013-04-24

    上傳用戶：jlyaccounts

  • FPGAIP核的設計

    FPGA能夠減少電子系統的開發風險和開發成本,縮短上市時間,降低維護升級成本,廣泛地應用在電子系統中.隨著集成電路向著片上系統(SoC)的發展,需要設計出FPGA IP核用于SoC芯片的設計.該論文的工作圍繞FPGA IP核的設計進行,在FPGA結構設計優化和FPGAIP接口方案設計兩方面進行了研究.設計改進了適用于數據通路的FPGA新結構——FDP.設計改進了可編程邏輯單元(LC);對可編程連線作為"2層2類"的層次結構進行組織,進行了改進并確定了各種連線的通道寬度;結合對迷宮布線算法的分析以及benchmark電路實驗的方法,提出了用于分段式網格連線的開關盒和連接盒新結構,提高連線的面積利用效率.在FPGA IP核的接口方案上,基于邊界掃描測試電路提出了FPGA IP核的測試方案;結合擴展邊界掃描測試電路得到的編程功和自動下載電路,為FPGA IP核提供了具有兩種不同編程方法的編程接口.采用SMIC 0.35um 3層金屬CMOS工藝,實現了一個10萬系統門規模的FDP結構,并和編程、測試接口一起進行版圖設計,試制了FDP100k芯片.FDP100k中包括了32×32個LC,128個可編程IO單元.在FDP100k的芯片測試中,對編程寄存器、各種可編程資源進行測試,并完成電路實現、性能參數測試以及IP核接口的測試,結果表明FPGA IP核的整體功能正確.

    標簽： FPGAIP

    上傳時間： 2013-04-24

    上傳用戶：gokk

  • 基于ARM核的AHBUSB20接口ASIC設計

    USB2．0接口和基于ARM核的SOC系統的應用已經非常廣泛，特別在電子消費類領域。包含USB2,0接口的ARM系統則更是市場的需求。本文介紹一種基于ARM核的USB2,0接口IP(AHB_USB2.0)的設計，主要對其中的串行接口引擎(SIE)的設計進行討論。 該 AHB_USB2.0 IP核支持USB2.0協議，并兼容USB1.1協議；支持AMBA2.0協議和UTMI 1.05協議。該IP核一側通過UTMI接口或ULPI接口的PHY與USB2.0主機端進行通信；另一側則通過AHB總線與ARM相連。 AHB_USB2.0 IP核在硬件上分為三個大模塊：ULPI模塊(ULPI)、串行接口引擎(SIE)模塊和AHB總線接口模塊(AHB)。ULPI模塊實現了UTMI接口轉ULPI接口。串行接口引擎(SIE)模塊為USB2.0的數據鏈路層協議處理模塊，為整個IP核的核心部分，進一步分為四個子模塊——GLC(全局控制模塊)，PIE(PHY接口處理引擎)，SIF(系統接口邏輯)和EPB(端點緩沖模塊)。GLC模塊負責整個IP的復位控制，IP時鐘的開關提示等；PIE模塊負責處理USB的事務級傳輸，包括組包解包等；SIF模塊負責協議相關寄存器組和端點緩沖區的讀寫，跨時鐘域信號的處理和PIE所需的控制信號的產生；AHB模塊負責IP核與ARM通信和DMA功能的實現。 該IP核的軟件設計遵循USB協議，Bulk Only協議和UFI協議，由外掛ARM實現USB設備命令和UFI命令的解析，并執行相應的操作。設計了IP核與ARM之間的多種數據傳輸方法，通過軟件實現常規數據讀寫訪問、內部DMA或外部DMA等多種方式的切換。 本IP已經通過EDA驗證和FPGA測試，并且已經在內嵌ARM核的FPGA系統上實現了多個U盤。這個FPGA系統的正確工作，證明了AHB_USB2.01P核設計是正確的。

    標簽： AHBUSB ASIC ARM 20

    上傳時間： 2013-05-17

    上傳用戶：qqoqoqo

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