等精度頻率計設計
標簽： 等精度 頻率計設
上傳時間： 2013-12-19
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高性能的數據壓縮可以有效的減少數據對存儲空間和通信帶寬的要求，降低通信成本。為解決圖像數據的高壓縮性能問題，本文提出了基于JPEG2000標準的數據壓縮系統的FPGA實現方案。相對于軟件算法實現和其他硬件方法，采用FPGA硬件實現可降低系統復雜度提高性能。最終設計的IP核具有資源占用少，性能良好和便于擴展等優點，能夠滿足通信傳輸和照相設備等應用需求。
標簽： JPEG 2000 FPGA 數據壓縮
上傳時間： 2013-11-22
上傳用戶：13691535575
可編程邏輯器件（PLD）是嵌入式工業設計的關鍵元器件。在工業設計中，PLD已經從提供簡單的膠合邏輯發展到使用FPGA作為協處理器。該技術在通信、電機控制、I/O模塊以及圖像處理等應用中支持 I/O 擴展，替代基本的微控制器 （MCU） 或者數字信號處理器 （DSP）。 隨著系統復雜度的提高，FPGA還能夠集成整個芯片系統（SoC），與分立的 MCU、DSP、ASSP，以及 ASIC解決方案相比，大幅度降低了成本。不論是用作協處理器還是SoC，Altera FPGA在您的工業應用中都具有以下優點： 1. 設計集成——使用FPGA作為協處理器或者SoC，在一個器件平臺上集成 IP和軟件堆棧，從而降低成本。 2. 可重新編程能力——在一個公共開發平臺的一片 FPGA中，使工業設計能夠適應協議、IP以及新硬件功能的發展變化。 3. 性能調整——通過FPGA中的嵌入式處理器、定制指令和IP模塊，增強性能，滿足系統要求。 4. 過時保護——較長的 FPGA 產品生命周期，通過 FPGA 新系列的器件移植，延長工業產品的生命周期，保護硬件不會過時。 5. 熟悉的工具——使用熟悉的、功能強大的集成工具，簡化設計和軟件開發、IP集成以及調試。
標簽： FPGA 工業應用
上傳時間： 2013-11-18
上傳用戶：tb_6877751
提出一種以現場可編程門陣列（FPGA）為硬件核心的鋼絲繩漏磁無損檢測系統設計方案，設計了外圍電路并對嵌入式IP軟核進行了配置，利用C語言和VHDL硬件描述語言編寫了檢測系統軟件程序。實驗表明該系統具有功耗低、運算能力強、精度高、便于攜帶等優點。
標簽： FPGA 漏磁 無損檢測 系統設計
上傳時間： 2015-01-01
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定制簡單LED的IP核的設計源代碼
標簽： LED 定制 IP核 源代碼
上傳時間： 2013-10-19
上傳用戶：gyq
這一節的目的是使用XPS為ARM PS 處理系統 添加額外的IP。從IP Catalog 標簽添加GPIO，并與ZedBoard板子上的8個LED燈相連。當系統建立完后，產生bitstream，并對外設進行測試。本資料為源代碼，原文設計過程詳見：【 玩轉賽靈思Zedboard開發板（4）：如何使用自帶外設IP讓ARM PS訪問FPGA？】 硬件平臺：Digilent ZedBoard 開發環境：Windows XP 32 bit 軟件： XPS 14.2 +SDK 14.2
標簽： ZedBoard FPGA ARM 訪問
上傳時間： 2013-11-06
上傳用戶：yuchunhai1990
對于利用LabVIEW FPGA實現RIO目標平臺上的定制硬件的工程師與開發人員，他們可以很容易地利用所推薦的組件設計構建適合其應用的、可復用且可擴展的代碼模塊。基于已經驗證的設計進行代碼模塊開發，將使現有IP在未來應用中得到更好的復用，也可以使在不同開發人員和內部組織之間進行共享和交換的代碼更好服用
標簽： LabVIEW FPGA IP核 模塊設計
上傳時間： 2013-10-14
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QuartusII中利用免費IP核的設計 作者：雷達室 以設計雙端口RAM為例說明。 Step1：打開QuartusII，選擇File—New Project Wizard，創建新工程，出現圖示對話框，點擊Next；
標簽： Quartus RAM IP核 雙端口
上傳時間： 2013-10-18
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基于Altera公司FPGA芯片EP2C8Q208，嵌入MC8051 IP Core，用C語言對MC8051 IP Core進行編程，以其作為控制核心，實現系統控制。在FPGA芯片中，利用Verilog HDL語言進行編程，設計了以MC8051 IP Core為核心的控制模塊、計數模塊、鎖存模塊和LCD顯示模塊等幾部分，實現了頻率的自動測量，測量范圍為0.1Hz~50MHz，測量誤差0.01%。并實現測頻率、周期、占空比等功能。
標簽： FPGA 多功能 頻率計
上傳時間： 2013-10-27
上傳用戶：潛水的三貢
基于FPGA的GPIB接口IP核的研究與設計
標簽： FPGA GPIB 接口 IP核
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