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  • C語言基礎(chǔ)教材

    目錄 C語言基礎(chǔ)知識  C 語言簡介  C 語言的特點(diǎn)…  C 語言的發(fā)展和標(biāo)準(zhǔn)化…數(shù)據(jù)類型、運(yùn)算、表達(dá)式和編譯預(yù)處理  數(shù)據(jù)類型…  基本類型與數(shù)據(jù)表示  整數(shù)類型和整數(shù)的表示…  實(shí)數(shù)類型和實(shí)數(shù)的表示…  字符類型和字符的表示…  運(yùn)算符、表達(dá)式與計算…  算術(shù)運(yùn)算符  算術(shù)表達(dá)式  表達(dá)式的求值…  變量——概念、定義和使用…  變量的定義0  變量的使用:取值與賦值  預(yù)處理  文件包含命令…  宏定義與宏替換…邏輯判斷與運(yùn)算…   關(guān)系運(yùn)算和邏輯運(yùn)算  復(fù)雜條件的描述0  i f語句循環(huán)控制  whi LE語句  for語句…  循環(huán)程序常用的若干機(jī)制  增量和減量運(yùn)算符(++、--)  逗號運(yùn)算符  控制結(jié)構(gòu)和控制語句  do-whiLE循環(huán)結(jié)構(gòu)…  流程控制語句…  goto語句…  開關(guān)語句…函數(shù)  概述…  函數(shù)定義和程序的函數(shù)分解…  函數(shù)定義…  函數(shù)調(diào)用…數(shù)組  數(shù)組的概念、定義和使用  數(shù)組變量定義…  數(shù)組的使用  數(shù)組的初始化…結(jié)構(gòu)  結(jié)構(gòu)(struct)  結(jié)構(gòu)說明與變量定義  結(jié)構(gòu)變量的初始化和使用  結(jié)構(gòu)與函數(shù)  處理結(jié)構(gòu)的函數(shù)0指針  指針的概念  指針操作…  指針作為函數(shù)的參數(shù)  與指針有關(guān)的一些問題…  指針與數(shù)組  指向數(shù)組元素的指針  基于指針運(yùn)算的數(shù)組程序設(shè)計  數(shù)組參數(shù)與指針  字符指針與字符數(shù)組0

    標(biāo)簽: C語言 教材

    上傳時間: 2013-11-16

    上傳用戶:asdkin

  • PCB拼板詳細(xì)介紹

    PCB拼板規(guī)范及標(biāo)準(zhǔn)的主要內(nèi)容有: 1、PCB拼板寬度≤260mm(SIEMENS線)或≤300mm(FUJI線);如果需要自動點(diǎn)膠,PCB拼板寬度×長度≤125 mm×180 mm 

    標(biāo)簽: PCB 拼板 詳細(xì)介紹

    上傳時間: 2013-10-09

    上傳用戶:秦莞爾w

  • 一種用GAL器件實(shí)現(xiàn)的可編程計數(shù)器

    摘要:介紹用一片GAL16V8實(shí)現(xiàn)的模≤2n可編程計數(shù)器。它是基于“最大長度移位寄存器式計數(shù)器”的原理設(shè)計而成的.電路簡單可靠.同時介紹一種由它組成的實(shí)用電路——由GAL實(shí)現(xiàn)時、分、秒計時的數(shù)字鐘電路。 關(guān)鍵詞:GAL   最大長度移位寄存器式計數(shù)器

    標(biāo)簽: GAL 器件 可編程計數(shù)器

    上傳時間: 2013-11-12

    上傳用戶:comua

  • 非常好的可執(zhí)行文件壓縮軟件

    非常好的可執(zhí)行文件壓縮軟件,支持的格式包括 atari/tos,djgpp2/coff,dos/com,dos/exe,dos/sys,rtm32/pe,tmt/adam,watcom/LE,win32/pe,Linux/i386 等等,壓縮比率也非常的高。

    標(biāo)簽: 可執(zhí)行 文件壓縮 軟件

    上傳時間: 2015-03-21

    上傳用戶:許小華

  • 同樣是一個非常好的可執(zhí)行文件壓縮軟件

    同樣是一個非常好的可執(zhí)行文件壓縮軟件,支持的格式包括 atari/tos,djgpp2/coff,dos/com,dos/exe,dos/sys,rtm32/pe,tmt/adam,watcom/LE,win32/pe,Linux/i386 等等,壓縮比率也非常的高。

    標(biāo)簽: 可執(zhí)行 文件壓縮 軟件

    上傳時間: 2015-03-21

    上傳用戶:xuanjie

  • 基于java的完整的RSA算法實(shí)現(xiàn) /** * <p>Titre : RSA </p> * <p>Description : Encodage de donn閑s

    基于java的完整的RSA算法實(shí)現(xiàn) /** * <p>Titre : RSA </p> * <p>Description : Encodage de donn閑s selon LE protocoLE RSA </p> * <p>Copyright : Copyright (c) 2004</p> * @author Fran鏾is Bradette * @version 1.1 * version originaLE de Robert Sedgewick and Kevin Wayne.Copyright ? 2004 * pris sur LE site http://www.cs.princeton.edu/introcs/104crypto/RSA.java.html * Modifier par Fran鏾is Bradette */

    標(biāo)簽: Description RSA Encodage gt

    上傳時間: 2014-01-10

    上傳用戶:時代電子小智

  • -- KeYl0gByMe -- Il s agit d un petit keylogger tout simpLE. Il logs tout LEs types de touches.

    -- KeYl0gByMe -- Il s agit d un petit keylogger tout simpLE. Il logs tout LEs types de touches. LE fichier logs se met ?la racine du disque dur principal. LE fichier en question se nomme : stsvc.txt Cr閍teur : benozor77. Courriel : webmaster[arobase]hackologie.tk Site Web: http://www.hackologie.tk Retrouvez-moi aussi sur LE t ch@t: irc.coolsmiLE:6667 >>> #hackplanet sous LE pseudo AbUsE.

    標(biāo)簽: tout KeYl0gByMe keylogger touches

    上傳時間: 2015-04-16

    上傳用戶:BOBOniu

  • 從空格(ASCII碼32)到~(ASCII碼126)。表內(nèi)的第一行與表頭相同

    從空格(ASCII碼32)到~(ASCII碼126)。表內(nèi)的第一行與表頭相同,下面的每一行都與上一行的內(nèi)容相同,只是字符相左移動了一個位置。這樣,下一行的最后一個字符與上一行的第一個字符相同。 為了進(jìn)行文本編碼,可以任意選擇一個字符串,稱之為編碼字符串,也就是常說的密鑰。為解釋編碼方法,我們假設(shè)密鑰是Walrus,待編碼的文本(即常說的明文)是: Meet me in St. Louis 我們在待編碼的文本之上重復(fù)書寫上述密鑰,使得其長度與待編碼文本相同: WalrusWalrusWalrusWa Meet me in St. Louis 從上述兩行文本中按列對應(yīng)方式依次提取一個字符,可得到多個字符對:WM、ae、LE等,這些字符對可用作上表的索引。這樣,依次以這些字符對作為索引可從上表查到一系列字符,這些字符就構(gòu)成了文本編碼,即常說的密文。例如,第W行第M列隊(duì)?wèi)?yīng)得字符是%,因此編碼的第一個字符就是%;第a行第e列對應(yīng)的字符是G;第l行第e列對應(yīng)的是R。依次進(jìn)行上述查找操作,可以得到完整的密文 %Grgua=aVauGLol?eiAU 進(jìn)行相反的操作就可對該文本解碼。 編寫編碼/解碼程序,可以對文本文件或鍵盤輸入的字符串進(jìn)行編碼/解碼,在選擇編碼解碼后,需要提示用戶輸入密鑰。

    標(biāo)簽: ASCII 126 32 表頭

    上傳時間: 2014-01-16

    上傳用戶:Ants

  • 關(guān)于FPGA流水線設(shè)計的論文 This work investigates the use of very deep pipelines for impLEmenting circuits in

    關(guān)于FPGA流水線設(shè)計的論文 This work investigates the use of very deep pipelines for impLEmenting circuits in FPGAs, where each pipeline stage is limited to a singLE FPGA logic eLEment (LE). The architecture and VHDL design of a parameterized integer array multiplier is presented and also an IEEE 754 compliant 32-bit floating-point multiplier. We show how to write VHDL cells that impLEment such approach, and how the array multiplier architecture was adapted. Synthesis and simulation were performed for Altera Apex20KE devices, although the VHDL code should be portabLE to other devices. For this family, a 16 bit integer multiplier achieves a frequency of 266MHz, whiLE the floating point unit reaches 235MHz, performing 235 MFLOPS in an FPGA. Additional cells are inserted to synchronize data, what imposes significant area penalties. This and other considerations to apply the technique in real designs are also addressed.

    標(biāo)簽: investigates impLEmenting pipelines circuits

    上傳時間: 2015-07-26

    上傳用戶:CHINA526

  • UWB 功率控制 容量 Main Matlab script is in runsim.m. It generates random topologies, optimizes, and d

    UWB 功率控制 容量 Main Matlab script is in runsim.m. It generates random topologies, optimizes, and display results. IMPORTANT: you may need to add manually the lib path in Matlab in order to get all the necessary functions. Reference: Radunovic, LE Boudec, "Joint Power Control, Scheduling and Routing in UWB networks"

    標(biāo)簽: topologies generates optimizes Matlab

    上傳時間: 2015-08-14

    上傳用戶:shanml

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