為了克服傳統(tǒng)功率MOS 導(dǎo)通電阻與擊穿電壓之間的矛盾,提出了一種新的理想器件結(jié)構(gòu),稱為超級結(jié)器件或Cool2MOS ,CoolMOS 由一系列的P 型和N 型半導(dǎo)體薄層交替排列組成。在截止態(tài)時,由于p 型和n 型層中的耗盡區(qū)電場產(chǎn)生相互補(bǔ)償效應(yīng),使p 型和n 型層的摻雜濃度可以做的很高而不會引起器件擊穿電壓的下降。導(dǎo)通時,這種高濃度的摻雜使器件的導(dǎo)通電阻明顯降低。由于CoolMOS 的這種獨(dú)特器件結(jié)構(gòu),使它的電性能優(yōu)于傳統(tǒng)功率MOS。本文對CoolMOS 導(dǎo)通電阻與擊穿電壓關(guān)系的理論計算表明,對CoolMOS 橫向器件: Ron ·A = C ·V 2B ,對縱向器件: Ron ·A = C ·V B ,與縱向DMOS 導(dǎo)通電阻與擊穿電壓之間Ron ·A = C ·V 2. 5B 的關(guān)系相比,CoolMOS 的導(dǎo)通電阻降低了約兩個數(shù)量級。
標(biāo)簽： CoolMOS VDMOS 導(dǎo)通電阻 分
上傳時間： 2013-10-21
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設(shè)計了一種用于高速ADC中的高速高增益的全差分CMOS運(yùn)算放大器。主運(yùn)放采用帶開關(guān)電容共模反饋的折疊式共源共柵結(jié)構(gòu)，利用增益提高和三支路電流基準(zhǔn)技術(shù)實(shí)現(xiàn)一個可用于12~14 bit精度，100 MS/s采樣頻率的高速流水線（Pipelined）ADC的運(yùn)放。設(shè)計基于SMIC 0.25 μm CMOS工藝，在Cadence環(huán)境下對電路進(jìn)行Spectre仿真。仿真結(jié)果表明，在2.5 V單電源電壓下驅(qū)動2 pF負(fù)載時，運(yùn)放的直流增益可達(dá)到124 dB，單位增益帶寬720 MHz，轉(zhuǎn)換速率高達(dá)885 V/μs，達(dá)到0.1%的穩(wěn)定精度的建立時間只需4 ns，共模抑制比153 dB。
標(biāo)簽： CMOS 增益提高 運(yùn)算 放大器設(shè)計
上傳時間： 2014-12-23
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schematic常用快捷鍵 x：檢查并存盤 s：存盤 [：縮小 ]：放大 F：整圖居中顯示 u：撤銷上一次操作 Esc：清楚剛鍵入的命令 c：復(fù)制 m：移動
上傳時間： 2013-11-21
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現(xiàn)代信息處理應(yīng)用中，對模數(shù)轉(zhuǎn)換器的速度、精度、功耗和動態(tài)性能等關(guān)鍵性能指標(biāo)不斷提出更高的要求。針對模數(shù)轉(zhuǎn)換的實(shí)際應(yīng)用，提出并設(shè)計了一種基于TI公司生產(chǎn)的雙通道14 位 250MSPS 低功耗A / D轉(zhuǎn)換器 ADS4249的RGB視頻編碼器電路設(shè)計。這款A(yù) / D轉(zhuǎn)換器的技術(shù)創(chuàng)新點(diǎn)在于其完美的實(shí)現(xiàn)高動態(tài)性能的同時又能擁有1.8 V超低功耗。這一特性使得ADS4249非常適合多載波，寬帶通信的信號處理應(yīng)用。
上傳時間： 2013-10-28
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采用電流模脈寬調(diào)制控制方案的電池充電芯片設(shè)計,鋸齒波信號的線性度較好,當(dāng)負(fù)載電路減小時,自動進(jìn)入Burst Mode狀態(tài)提高系統(tǒng)的效率。整個電路基于1.0 μm 40 V CMOS工藝設(shè)計,通過Hspice完成了整體電路前仿真驗證和后仿真,仿真結(jié)果表明,振蕩電路的性能較好,可廣泛應(yīng)用在PWM等各種電子電路中。
上傳時間： 2014-12-23
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零漂移放大器可動態(tài)校正其失調(diào)電壓并重整其噪聲密度。自穩(wěn)零型和斬波型是兩種常用類型，可實(shí)現(xiàn) nV 級失調(diào)電壓和極低的失調(diào)電壓時間/溫度漂移。放大器的 1/f 噪聲也視為直流誤差，也可一并消除。零漂移放大器為設(shè)計師提供了很多好處：首先，溫漂和 1/f 噪聲在系統(tǒng)中始終起著干擾作用，很難以其它方式消除，其次，相對于標(biāo)準(zhǔn)的放大器，零漂移放大器具有較高的開環(huán)增益、電源抑制比和共模抑制比，另外，在相同的配置下，其總輸出誤差低于采用標(biāo)準(zhǔn)精密放大器的輸出誤差
標(biāo)簽： 工程師 零漂移 運(yùn)算放大器
上傳時間： 2013-11-23
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提出了一種應(yīng)用于CSTN-LCD系統(tǒng)中低功耗、高轉(zhuǎn)換速率的跟隨器的實(shí)現(xiàn)方案。基于GSMC±9V的0.18 μm CMOS高壓工藝SPICE模型的仿真結(jié)果表明，在典型的轉(zhuǎn)角下，打開2個輔助模塊時，靜態(tài)功耗約為35 μA；關(guān)掉輔助模塊時，主放大器的靜態(tài)功耗為24 μA。有外接1 μF的大電容時，屏幕上的充放電時間為10 μs；沒有外接1μF的大電容時，屏幕上的充放電時間為13μs。驗證表明，該跟隨器能滿足CSTN-LCD系統(tǒng)低功耗、高轉(zhuǎn)換速率性能要求。
上傳時間： 2013-11-18
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設(shè)計了一種用于高速ADC中的全差分套筒式運(yùn)算放大器.從ADC的應(yīng)用指標(biāo)出發(fā),確定了設(shè)計目標(biāo),利用開關(guān)電容共模反饋、增益增強(qiáng)等技術(shù)實(shí)現(xiàn)了一個可用于12 bit精度、100 MHz采樣頻率的高速流水線(Pipelined)ADC中的運(yùn)算放大器.基于SMIC 0.13 μm,3.3 V工藝,Spectre仿真結(jié)果表明,該運(yùn)放可以達(dá)到105.8 dB的增益,單位增益帶寬達(dá)到983.6 MHz,而功耗僅為26.2 mW.運(yùn)放在4 ns的時間內(nèi)可以達(dá)到0.01%的建立精度,滿足系統(tǒng)設(shè)計要求.
標(biāo)簽： 增益 增強(qiáng)型 運(yùn)算放大器
上傳時間： 2013-10-16
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This reference design (RD) features a fullyassembled and tested surface-mount printed circuitboard (PCB). The RD board utilizes the MAX48851:2 or 2:1 multiplexer and other ICs to implement acomplete video graphics array (VGA) 8:1multiplexer.VGA input/output connections are provided to easilyinterface the MAX4885 RD board with VGAcompatibledevices. The RD board gives the optionto use a single 5V DC power supply (V+), or this RDboard can be powered from any one of the eight VGA sources.
標(biāo)簽： multiplexer reference VGA
上傳時間： 2013-11-09
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虛短和虛斷的概念 由于運(yùn)放的電壓放大倍數(shù)很大，一般通用型運(yùn)算放大器的開環(huán)電壓放大倍數(shù)都在80 dB以上。而運(yùn)放的輸出電壓是有限的，一般在 10 V～14 V。因此運(yùn)放的差模輸入電壓不足1 mV，兩輸入端近似等電位，相當(dāng)于 “短路”。開環(huán)電壓放大倍數(shù)越大，兩輸入端的電位越接近相等。 “虛短”是指在分析運(yùn)算放大器處于線性狀態(tài)時，可把兩輸入端視為等電位，這一特性稱為虛假短路，簡稱虛短。顯然不能將兩輸入端真正短路。 由于運(yùn)放的差模輸入電阻很大，一般通用型運(yùn)算放大器的輸入電阻都在1MΩ以上。因此流入運(yùn)放輸入端的電流往往不足1uA，遠(yuǎn)小于輸入端外電路的電流。故 通常可把運(yùn)放的兩輸入端視為開路，且輸入電阻越大，兩輸入端越接近開路。“虛斷”是指在分析運(yùn)放處于線性狀態(tài)時，可以把兩輸入端視為等效開路，這一特性 稱為虛假開路，簡稱虛斷。顯然不能將兩輸入端真正斷路。 在分析運(yùn)放電路工作原理時，首先請各位暫時忘掉什么同向放大、反向放大，什么加法器、減法器，什么差動輸入……暫時忘掉那些輸入輸出關(guān)系的公式……這些東東只會干擾你，讓你更糊涂﹔也請各位暫時不要理會輸入偏置電流、共模抑制比、失調(diào)電壓等電路參數(shù)，這是設(shè)計者要考慮的事情。我們理解的就是理想放大器(其實(shí)在維修中和大多數(shù)設(shè)計過程中，把實(shí)際放大器當(dāng)做理想放大器來分析也不會有問題)。
標(biāo)簽： 運(yùn)算放大器 虛斷
上傳時間： 2013-11-04
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