用verilog HDL寫的操作SRAM的源碼
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用verilog HDL實現曼徹斯特編碼的源碼...
verilog浮點乘發器,特定數據結構,指數底為10...
verilog浮點乘發器,特定數據結構,指數底為10,利用pipeline...
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verilog寫的回波抵消程序,相當于寫了個回波抵消的芯片,不是dsp,可編譯后下載于FPGA,絕對原創,寫了很長時間。...
RS編碼的源代碼使用Verilog在Xinloinx平臺...
VHDL與Verilog的比較...
verilog fifo...