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VERILOG HDL

基于VERILOG HDL的數碼管程序設計

基于VERILOG HDL的數碼管程序設計

標簽： Verilog HDL 數碼管程序設計

上傳時間： 2014-01-07

上傳用戶：zxc23456789
OFDM系統中FFT的VERILOG HDL 語言實現。

OFDM系統中FFT的VERILOG HDL 語言實現。

標簽： Verilog OFDM FFT HDL

上傳時間： 2017-01-18

上傳用戶：wcl168881111111
本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫EEPROM的VERILOG HDL 行為模塊（eeprom_wr.v）、信號產生模塊（signal.v）和頂層模塊(top.v)

本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫EEPROM的VERILOG HDL 行為模塊（eeprom_wr.v）、信號產生模塊（signal.v）和頂層模塊(top.v) ，這樣可以有一個完整的EEPROM的控制模塊和測試文件，本文件通過測試。

標簽： EEPROM eeprom_wr verilog eeprom

上傳時間： 2017-01-22

上傳用戶：lanjisu111
VERILOG HDL程序 VERILOG HDL程序

VERILOG HDL程序 VERILOG HDL程序

標簽： Verilog HDL 程序

上傳時間： 2017-01-29

上傳用戶：rocketrevenge
VERILOG HDL 華為入門教程.pdf 內部資料

VERILOG HDL 華為入門教程.pdf 內部資料

標簽： Verilog HDL 華為

上傳時間： 2013-12-19

上傳用戶：壞壞的華仔
VERILOG HDL語言設計的交通燈設計

VERILOG HDL語言設計的交通燈設計

標簽： Verilog HDL 語言交通燈

上傳時間： 2017-02-02

上傳用戶：671145514
用VERILOG HDL實現I2C Master Controller 的設計

用VERILOG HDL實現I2C Master Controller 的設計，包括主程序設計和測試程序設計

標簽： Controller verilog Master HDL

上傳時間： 2014-01-04

上傳用戶：tonyshao
What is Verilog? ➥ VERILOG HDL is a Hardware Description Language (HDL) ➥ VERILOG HDL

What is Verilog? ➥ VERILOG HDL is a Hardware Description Language (HDL) ➥ VERILOG HDL allows describe designs at a high level of abstraction as well as the lower implementation levels ➥ Primary use of HDLs is the simulation of designs ➥ Verilog is a discrete event time simulator What is VeriWell? ➥ VeriWell is a comprehensive implementation of VERILOG HDL

標簽： Verilog HDL 10149 Description

上傳時間： 2017-02-18

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此模塊用于"PS/2接口的鼠標或鍵盤"與"具有外部讀寫的8位并口單片機"雙向通信模塊. VERILOG HDL語言編寫,在Quartus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7

此模塊用于"PS/2接口的鼠標或鍵盤"與"具有外部讀寫的8位并口單片機"雙向通信模塊. VERILOG HDL語言編寫,在Quartus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7128SLC84-10芯片中通過. 文件中有詳細的注解. 此模塊具有對于PS/2時鐘和數據線的濾波功能,這樣減少外部干擾，保證通信的可靠性！

標簽： Verilog Quartus EPM7 8.1

上傳時間： 2017-02-20

上傳用戶：集美慧
用VERILOG HDL 實現時鐘(時和分)

用VERILOG HDL 實現時鐘(時和分)

標簽： Verilog HDL 實現時鐘分

上傳時間： 2013-12-26

上傳用戶：Amygdala

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VERILOG HDL

基于VERILOG HDL的數碼管程序設計

OFDM系統中FFT的VERILOG HDL 語言實現。

本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫EEPROM的VERILOG HDL 行為模塊（eeprom_wr.v）、信號產生模塊（signal.v）和頂層模塊(top.v)

VERILOG HDL程序 VERILOG HDL程序

VERILOG HDL 華為入門教程.pdf 內部資料

VERILOG HDL語言設計的交通燈設計

用VERILOG HDL實現I2C Master Controller 的設計

What is Verilog? ➥ VERILOG HDL is a Hardware Description Language (HDL) ➥ VERILOG HDL

此模塊用于"PS/2接口的鼠標或鍵盤"與"具有外部讀寫的8位并口單片機"雙向通信模塊. VERILOG HDL語言編寫,在Quartus II 8.1 (32-Bit)軟件中編譯,并下載至EPM7

用VERILOG HDL 實現時鐘(時和分)