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VERILOG-HDL

用cpld實(shí)現(xiàn)曼徹斯特編碼用verilog HDL進(jìn)行曼徹斯特編碼

用cpld實(shí)現(xiàn)曼徹斯特編碼用verilog HDL進(jìn)行曼徹斯特編碼，用于通信中

標(biāo)簽： verilog cpld HDL 曼徹斯特編碼

上傳時(shí)間： 2015-05-02

上傳用戶：chenbhdt
異步FIFO控制器的設(shè)計(jì) 主要用于異步先進(jìn)先出控制器的設(shè)計(jì)。所用語(yǔ)言Verilog HDL.

異步FIFO控制器的設(shè)計(jì) 主要用于異步先進(jìn)先出控制器的設(shè)計(jì)。所用語(yǔ)言Verilog HDL.

標(biāo)簽： Verilog FIFO HDL 控制器

上傳時(shí)間： 2014-11-05

上傳用戶：bjgaofei
D觸發(fā)器的設(shè)計(jì) 主要用在時(shí)序電路中。所用語(yǔ)言為Verilog HDL.

D觸發(fā)器的設(shè)計(jì) 主要用在時(shí)序電路中。所用語(yǔ)言為Verilog HDL.

標(biāo)簽： Verilog HDL D觸發(fā)器時(shí)序電路

上傳時(shí)間： 2014-06-23

上傳用戶：ywqaxiwang
用一位全加器組成四位全加器. 所用語(yǔ)言是Verilog HDL. 主要用在加法器的設(shè)計(jì)中。

用一位全加器組成四位全加器. 所用語(yǔ)言是Verilog HDL. 主要用在加法器的設(shè)計(jì)中。

標(biāo)簽： Verilog HDL 全加器語(yǔ)言

上傳時(shí)間： 2015-05-02

上傳用戶：zukfu
指令譯碼電路的設(shè)計(jì)。主要用在數(shù)字電路的設(shè)計(jì)中。所用語(yǔ)言為Verilog HDL.

指令譯碼電路的設(shè)計(jì)。主要用在數(shù)字電路的設(shè)計(jì)中。所用語(yǔ)言為Verilog HDL.

標(biāo)簽： Verilog HDL 指令譯碼電路

上傳時(shí)間： 2015-05-02

上傳用戶：h886166
11,13,16位超前進(jìn)位加法器的Verilog HDL源代碼。

11,13,16位超前進(jìn)位加法器的Verilog HDL源代碼。

標(biāo)簽： Verilog HDL 11 13

上傳時(shí)間： 2013-12-28

上傳用戶：ouyangtongze
verilog hdl 快速入門,里面包含很多有用的硬件描述語(yǔ)言的程序

verilog hdl 快速入門,里面包含很多有用的硬件描述語(yǔ)言的程序

標(biāo)簽： verilog hdl 快速入門硬件描述語(yǔ)言

上傳時(shí)間： 2014-01-03

上傳用戶：愛(ài)死愛(ài)死
以verilog HDL 語(yǔ)言編寫的一首歌曲

以verilog HDL 語(yǔ)言編寫的一首歌曲，可供初學(xué)者借鑒

標(biāo)簽： verilog HDL 語(yǔ)言編寫

上傳時(shí)間： 2013-12-26

上傳用戶：ma1301115706
HDL 編碼風(fēng)格與編碼指導(dǎo),介紹了詳細(xì)的vhdl和verilog hdl語(yǔ)言的編程風(fēng)格

HDL 編碼風(fēng)格與編碼指導(dǎo),介紹了詳細(xì)的vhdl和verilog hdl語(yǔ)言的編程風(fēng)格

標(biāo)簽： verilog vhdl HDL hdl

上傳時(shí)間： 2014-01-05

上傳用戶：古谷仁美
arm verilog hdl ip core

arm verilog hdl ip core

標(biāo)簽： verilog core arm hdl

上傳時(shí)間： 2014-01-14

上傳用戶：wang0123456789