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Verilog HDL代碼書寫規(guī)范

用verilog HDL實現曼徹斯特編碼的源碼

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標簽： verilog HDL 曼徹斯特編碼源碼

上傳時間： 2013-12-29

上傳用戶：lhc9102
一個ping , html ,ftp 三功能合一的網路程式源代碼 , 我是來自臺灣的朋友 , 謝謝 :)

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標簽： ping html ftp 合一

上傳時間： 2014-01-25

上傳用戶：龍飛艇
人事考勤管理系統源代碼

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標簽： 系統

上傳時間： 2015-03-10

上傳用戶：aix008
Computer Architecture Handbook on Verilog HDL

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標簽： Architecture Computer Handbook Verilog

上傳時間： 2015-03-15

上傳用戶：www240697738
verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，3-6章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-12

上傳用戶：rocketrevenge
verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，7-8章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-09

上傳用戶：cuiyashuo
verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，9-10章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-26

上傳用戶：qb1993225
verilog hdl教程135例:verilog hdl語言類似于C語言

verilog hdl教程135例:verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，11-12章

標簽： verilog hdl 135 C語言

上傳時間： 2015-03-24

上傳用戶：zhaoq123
這是一個Verilog HDL編寫的RISC cpu的程序

這是一個Verilog HDL編寫的RISC cpu的程序，該程序共10個子程序，實現了簡單的RISC cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。

標簽： Verilog RISC HDL cpu

上傳時間： 2015-03-26

上傳用戶：qiao8960
減1計數器一、設計要求用Verilog HDL語言設計一個計數器。要求計數器具有異步置位/復位功能

減1計數器一、設計要求用Verilog HDL語言設計一個計數器。要求計數器具有異步置位/復位功能，可以進行自增和自減計數，其計數周期為2^N（N為二進制位數）。二、設計原理輸入/輸出說明： d：異步置數數據輸入； q：當前計數器數據輸出； clock：時鐘脈沖； count_en：計數器計數使能控制（1：計數/0：停止計數）； updown：計數器進行自加/自減運算控制（1：自加/0：自減）； load_d

標簽： Verilog 計數器 HDL 減

上傳時間： 2015-03-28

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