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Verilog hdl

Computer Architecture Handbook on Verilog hdl

Computer Architecture Handbook on Verilog hdl

標簽： Architecture Computer Handbook Verilog

上傳時間： 2015-03-15

上傳用戶：www240697738
Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，3-6章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-12

上傳用戶：rocketrevenge
Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，7-8章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-09

上傳用戶：cuiyashuo
Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，9-10章

標簽： verilog hdl 135 C語言

上傳時間： 2013-12-26

上傳用戶：qb1993225
Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言，便于學習。本文檔帶有源代碼，11-12章

標簽： verilog hdl 135 C語言

上傳時間： 2015-03-24

上傳用戶：zhaoq123
這是一個Verilog hdl編寫的RISC cpu的程序

這是一個Verilog hdl編寫的RISC cpu的程序，該程序共10個子程序，實現了簡單的RISC cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。

標簽： Verilog RISC HDL cpu

上傳時間： 2015-03-26

上傳用戶：qiao8960
減1計數器一、設計要求用Verilog hdl語言設計一個計數器。要求計數器具有異步置位/復位功能

減1計數器一、設計要求用Verilog hdl語言設計一個計數器。要求計數器具有異步置位/復位功能，可以進行自增和自減計數，其計數周期為2^N（N為二進制位數）。二、設計原理輸入/輸出說明： d：異步置數數據輸入； q：當前計數器數據輸出； clock：時鐘脈沖； count_en：計數器計數使能控制（1：計數/0：停止計數）； updown：計數器進行自加/自減運算控制（1：自加/0：自減）； load_d

標簽： Verilog 計數器 HDL 減

上傳時間： 2015-03-28

上傳用戶：zycidjl
我用過的Verilog hdl寫的SDRAM core源程序,經過測試應用

我用過的Verilog hdl寫的SDRAM core源程序,經過測試應用

標簽： verilog SDRAM core hdl

上傳時間： 2015-03-31

上傳用戶：15071087253
Verilog hdl硬件描述語言的教程

Verilog hdl硬件描述語言的教程

標簽： Verilog HDL 硬件描述語言教程

上傳時間： 2015-04-04

上傳用戶：lnnn30
Verilog hdl. for igginner. tutorial in word file1 KAMPATE

Verilog hdl. for igginner. tutorial in word file1 KAMPATE

標簽： igginner tutorial verilog KAMPATE

上傳時間： 2015-04-07

上傳用戶：chenxichenyue

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Verilog hdl

Computer Architecture Handbook on Verilog hdl

Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言

Verilog hdl教程135例:Verilog hdl語言類似于C語言

這是一個Verilog hdl編寫的RISC cpu的程序

減1計數器一、設計要求用Verilog hdl語言設計一個計數器。要求計數器具有異步置位/復位功能

我用過的Verilog hdl寫的SDRAM core源程序,經過測試應用

Verilog hdl硬件描述語言的教程

Verilog hdl. for igginner. tutorial in word file1 KAMPATE