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Verilog hdl

  • verilog lcd1602顯示

    基于verilog的lcd1602顯示 基于verilog的lcd1602顯示 基于verilog的lcd1602顯示

    標簽： verilog 1602 lcd

    上傳時間： 2013-04-24

    上傳用戶：懶龍1988

  • 基于FPGA的JPEG圖像壓縮芯片設計

    該文探討了以FPGA(Field Programmable Gates Array)為平臺,使用HDL(Hardware Description Language)語言設計并實現符合JPEG靜態圖象壓縮算法基本模式標準的圖象壓縮芯片.在簡要介紹JPEG基本模式標準和FPGA設計流程的基礎上,針對JPEG基本模式硬件編碼器傳統結構的缺點,提出了一種新的改進結構.JPEG基本模式硬件編碼器改進結構的設計思想、設計結構和Verilog設計實現在其后章節中進行了詳細闡述,并分別給出了改進結構中各個模塊的單獨測試結果.在該文的測試部分,闡述利用實際圖像作為輸入,從FPGA的輸出得到了正確的壓縮圖像,計算了相應的圖像壓縮速度和圖象質量指標,并與軟件壓縮的速度和結果做了對比,提出了未來的改進建議.

    標簽： FPGA JPEG 圖像壓縮 芯片設計

    上傳時間： 2013-04-24

    上傳用戶：Andy123456

  • 華為verilog教程.pdf

    華為verilog教程，學習verilog快速入門

    標簽： verilog 華為 教程

    上傳時間： 2013-07-18

    上傳用戶：crazykook

  • 隨機讀寫I2C串行總線接口電路設計

    I2C(Inter Integrated Circuits)是Philips公司開發的用于芯片之間連接的串行總線，以其嚴格的規范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。 現場可編程門陣列(FPGA)設計靈活、速度快，在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路，實現與外圍I2C接口器件E2PROM進行數據通信，實現讀、寫等功能，傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環境中進行仿真，在Xilinx公司的ISE9.li開發平臺上進行了下載，搭建外圍電路，用Agilem邏輯分析儀進行數據采集，分析測試結果。 首先，介紹了微電子設計的發展概況以及設計流程，重點介紹了HDL/FPGA的設計流程。其次，對I2C串行總線進行了介紹，重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀／寫時序作了介紹。第三，基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路；接口電路由同步有限狀態機(FSM)來實現；測試模塊首先將數據寫入到AT24C02的指定地址，接著將寫入的數據讀出，并將兩個數據顯示在外圍LED數碼管和發光二極管上，從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四，用Agilent邏輯分析儀進行傳輸數據的采集，分析數據傳輸的時序，從而驗證電路設計的正確性。最后，論文對所取得的研究成果進行了總結，并展望了下一步的工作。

    標簽： I2C 隨機 讀寫 串行總線接口

    上傳時間： 2013-06-08

    上傳用戶：再見大盤雞

  • VERILOG入門

    Verilog入門教程，絕對超值 剛起步的人可以來看看

    標簽： VERILOG

    上傳時間： 2013-05-29

    上傳用戶：siguazgb

  • 基于FPGA的中值濾波Verilog程序

    運用Verilog語言來實現在FPGA的中值濾波

    標簽： Verilog FPGA 中值濾波 程序

    上傳時間： 2013-08-04

    上傳用戶：yd19890720

  • Visual Elite 0

    Summit Design公司基于ESL設計產品的最新Visual Elite圖像產品具有Advanced SystemC建模及分析功能。該工具的最新版本包括原始SystemC構造，允許用戶在SystemC內建模并驗證設計。 該工具的HDL版本可幫助門級設計師們學習用Verilog和VHDL設計。最新版本的Visual Elite可幫助硬件設計師們和C/C++編程者迅速使用SystemC語言創建系統。Visual Elite 允許用戶熟悉語言后，使用預建圖形模塊創建系統并自行創建文本模塊。 該工具的瀏覽器

    標簽： Visual Elite

    上傳時間： 2013-04-24

    上傳用戶：東大小布

  • HDL Designer Series 2010.2a win320

    Mentor Graphics HDL Designer 工具套件，為客戶帶來生產力更高的設計輸入、分析與管理功能，包括更強大的聯機資料表格，無論設計復雜性如何，都能迅速建立高品質且結構良好的硬件描述語言。HDL Designer Series可協助工程師迅速輸入和分析復雜的ASIC、FPGA和系統單芯片設計，讓客戶新產品于更短時間內上

    標簽： Designer 2010.2 Series HDL

    上傳時間： 2013-08-05

    上傳用戶：hustfanenze

  • Active HDL 8.4.30

    ALDEC公司的Active-HDL是一個開放型的仿真工具。 可支持幾乎所有的FPGA/CPLD廠商的產品，設計輸入可以原理圖或硬件描述語言或有限狀態機 方式

    標簽： Active HDL 30

    上傳時間： 2013-07-14

    上傳用戶：來茴

  • ModleSim 6.50

    Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器

    標簽： ModleSim 6.50

    上傳時間： 2013-04-24

    上傳用戶：zukfu

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