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asic

asic(ApplicationSpecificIntegratedCircuit)即專用集成電路,是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。用CPLD(復(fù)雜可編程邏輯器件)和FPGA(現(xiàn)場可編程邏輯門陣列)來進(jìn)行asic設(shè)計(jì)是最為流行的方式之一,它們的共性是都具有用戶現(xiàn)場可編程特性,都支持邊界掃描技術(shù),但兩者在集成度、速度以及編程方式上具有各自的特點(diǎn)。[1]
  • 采用TüV認(rèn)證的FPGA開發(fā)功能安全系統(tǒng)

    This white paper discusses how market trends, the need for increased productivity, and new legislation have accelerated the use of safety systems in industrial machinery. This TÜV-qualified FPGA design methodology is changing the paradigms of safety designs and will greatly reduce development effort, system complexity, and time to market. This allows FPGA users to design their own customized safety controllers and provides a significant competitive advantage over traditional microcontroller or asic-based designs. Introduction The basic motivation of deploying functional safety systems is to ensure safe operation as well as safe behavior in cases of failure. Examples of functional safety systems include train brakes, proximity sensors for hazardous areas around machines such as fast-moving robots, and distributed control systems in process automation equipment such as those used in petrochemical plants. The International Electrotechnical Commission’s standard, IEC 61508: “Functional safety of electrical/electronic/programmable electronic safety-related systems,” is understood as the standard for designing safety systems for electrical, electronic, and programmable electronic (E/E/PE) equipment. This standard was developed in the mid-1980s and has been revised several times to cover the technical advances in various industries. In addition, derivative standards have been developed for specific markets and applications that prescribe the particular requirements on functional safety systems in these industry applications. Example applications include process automation (IEC 61511), machine automation (IEC 62061), transportation (railway EN 50128), medical (IEC 62304), automotive (ISO 26262), power generation, distribution, and transportation. 圖Figure 1. Local Safety System

    標(biāo)簽: FPGA 安全系統(tǒng)

    上傳時(shí)間: 2013-11-05

    上傳用戶:維子哥哥

  • ALTERA公司器件介紹匯總

      本資料是關(guān)于Altera公司基本器件的主要介紹(主要特性、優(yōu)勢、適用配置器件、型號、引腳、下載電纜、軟件等)   目 錄   1、 MAX7000系列器件   2、 MAX3000A系列器件   3、 MAX II 系列器件   4、 Cyclone系列器件   5、 Cyclone II系列器件   6、 Stratix系列器件   7、 Stratix GX系列器件   8、 Stratix II系列器件   9、 HardCopy II結(jié)構(gòu)化asic   10、其它系列器件   11、配置器件   12、下載電纜   13、開發(fā)軟件   14、IP CORE   15、Nios II嵌入式處理器   16、ALTERA開發(fā)板   17、ALTERA電源選擇

    標(biāo)簽: ALTERA 器件

    上傳時(shí)間: 2013-10-16

    上傳用戶:文993

  • 四大FPGA供應(yīng)商專家談FPGA設(shè)計(jì)訣竅

     Actel、Altera、Lattice Semiconductor和Xilinx是目前業(yè)界最主要的四大FPGA供應(yīng)商,為了 幫助中國的應(yīng)用開發(fā)工程師更深入地了解FPGA的具體設(shè)計(jì)訣竅,我們特別邀請到了Altera系統(tǒng)應(yīng)用 工程部總監(jiān)Greg Steinke、Xilinx綜合方法經(jīng)理Frederic Rivoallon、Xilinx高級技術(shù)市場工程師 Philippe Garrault、Xilinx產(chǎn)品應(yīng)用工程部高級經(jīng)理Chris Stinson、Xilinx IP解決方案工程部總 監(jiān)Mike Frasier、Lattice Semiconductor應(yīng)用工程部總監(jiān)Bertrand Leigh和軟件產(chǎn)品規(guī)劃經(jīng)理Mike Kendrick、Actel公司硅產(chǎn)品市場總監(jiān)Martin Mason和應(yīng)用高級經(jīng)理Jonathan Alexander為大家傳經(jīng) 授道。 他們將就一系列大家非常關(guān)心的關(guān)鍵設(shè)計(jì)問題發(fā)表他們的獨(dú)到見解,包括:什么是目前FPGA應(yīng)用工 程師面對的最主要設(shè)計(jì)問題?如何解決?當(dāng)開始一個(gè)新的FPGA設(shè)計(jì)時(shí),你們會推薦客戶采用什么樣 的流程?對于I/O信號分布的處理,你們有什么建議可以提供 給客戶?如果你的客戶準(zhǔn)備移植到另外一個(gè)FPGA、asic和結(jié)構(gòu)化asic之間進(jìn)行抉擇?(下)">結(jié)構(gòu)化 asicasic,你會建議你的客戶如何做?

    標(biāo)簽: FPGA

    上傳時(shí)間: 2013-11-09

    上傳用戶:xinshou123456

  • xilinx Zynq-7000 EPP產(chǎn)品簡介

    The Xilinx Zynq-7000 Extensible Processing Platform (EPP) redefines the possibilities for embedded systems, giving system and software architects and developers a flexible platform to launch their new solutions and traditional asic and ASSP users an alternative that aligns with today’s programmable imperative. The new class of product elegantly combines an industrystandard ARMprocessor-based system with Xilinx 28nm programmable logic—in a single device. The processor boots first, prior to configuration of the programmable logic. This, along with a streamlined workflow, saves time and effort and lets software developers and hardware designers start development simultaneously. 

    標(biāo)簽: xilinx Zynq 7000 EPP

    上傳時(shí)間: 2013-11-01

    上傳用戶:dingdingcandy

  • WP312 - 賽靈思新一代28nm FPGA技術(shù)概覽

        賽靈思選用 28nm 高介電層金屬閘 (HKMG) 高性能低 功耗技術(shù),并將該技術(shù)與新型一體化 ASMBLTM 架構(gòu)相結(jié)合,從而推出能降低功耗、提高性能的新一代FPGA。這些器件實(shí)現(xiàn)了前所未有的高集成度和高帶寬,為系統(tǒng)架構(gòu)師和設(shè)計(jì)人員提供了一種可替代 ASSP和 asic 的全面可編程解決方案。

    標(biāo)簽: FPGA 312 WP 28

    上傳時(shí)間: 2013-10-10

    上傳用戶:TF2015

  • WP380 -賽靈思堆疊硅片互聯(lián)技術(shù)

        可編程技術(shù)勢在必行 — 用更少的資源實(shí)現(xiàn)更多功能 隨時(shí)隨地降低風(fēng)險(xiǎn)、使用可編程硬件設(shè)計(jì)平臺快速開發(fā)差異化產(chǎn)品 — 驅(qū)使人們不斷探索能夠提供更大容量、更低功耗和更高帶寬的 FPGA 解決方案,用來創(chuàng)建目前 asic 和 ASSP 所能提供的系統(tǒng)級功能。賽靈思已經(jīng)開發(fā)出一種創(chuàng)新型 FPGA 設(shè)計(jì)和制造方法,能夠滿足“可編程技術(shù)勢在必行”的兩大關(guān)鍵要求。堆疊硅片互聯(lián)技術(shù)是新一代 FPGA 的基礎(chǔ),不僅超越了摩爾定律,而且實(shí)現(xiàn)的功能能夠滿足最嚴(yán)格的設(shè)計(jì)要求。利用該技術(shù),賽靈思縮短了批量交付最大型 FPGA 所需的時(shí)間,從而可以滿足最終客戶的批量生產(chǎn)需求。本白皮書將探討促使賽靈思開發(fā)堆疊硅片互聯(lián)技術(shù)的技術(shù)及經(jīng)濟(jì)原因,以及使之實(shí)現(xiàn)的創(chuàng)新方法。

    標(biāo)簽: 380 WP 賽靈思 堆疊硅片

    上傳時(shí)間: 2013-11-03

    上傳用戶:ztj182002

  • 北京理工大學(xué)FPGA講義

      專用集成電路( asic )的出現(xiàn)   􀁻 asic的提出和發(fā)展說明集成電路進(jìn)入了一個(gè)新階段。   􀁻 通用的、標(biāo)準(zhǔn)的集成電路已不能完全適應(yīng)電子系統(tǒng)的急劇變化和更新?lián)Q代。各個(gè)電子系統(tǒng)廠家都希望生產(chǎn)出具有自己特色的合格產(chǎn)品,只有asic產(chǎn)品才能達(dá)到這種要求。這也就是自80年代中期以來,asic得到廣泛重視的根本原因。   􀁻 asic電路的蓬勃發(fā)展推動著設(shè)計(jì)方法和設(shè)計(jì)工具的完善,同時(shí)也促進(jìn)著系統(tǒng)設(shè)計(jì)人員與芯片設(shè)計(jì)人員的結(jié)合和相互滲透。   FPGA的發(fā)展:IC-〉asic-〉FPGA   􀁻 FPGA分類、結(jié)構(gòu)、設(shè)計(jì)流程,F(xiàn)PGA設(shè)計(jì)工具:   􀁻 VHDL   􀁻 Verilog   􀁻 VHDL的仿真   􀁻 VHDL的綜合   􀁻 FPGA實(shí)現(xiàn)過程   􀁻 FPGA實(shí)現(xiàn)高性能DSP   􀁻 FPGA嵌入式系統(tǒng)設(shè)計(jì)

    標(biāo)簽: FPGA 理工 大學(xué) 講義

    上傳時(shí)間: 2013-11-06

    上傳用戶:lanjisu111

  • 華為 FPGA設(shè)計(jì)高級技巧Xilinx篇

      隨著HDL Hardware Description Language 硬件描述語言語言綜合工具及其它相關(guān)工具的推廣使廣大設(shè)計(jì)工程師從以往煩瑣的畫原理圖連線等工作解脫開來能夠?qū)⒐ぷ髦匦霓D(zhuǎn)移到功能實(shí)現(xiàn)上極大地提高了工作效率任何事務(wù)都是一分為二的有利就有弊我們發(fā)現(xiàn)現(xiàn)在越來越多的工程師不關(guān)心自己的電路實(shí)現(xiàn)形式以為我只要將功能描述正確其它事情交給工具就行了在這種思想影響下工程師在用HDL語言描述電路時(shí)腦袋里沒有任何電路概念或者非常模糊也不清楚自己寫的代碼綜合出來之后是什么樣子映射到芯片中又會是什么樣子有沒有充分利用到FPGA的一些特殊資源遇到問題立刻想到的是換速度更快容量更大的FPGA器件導(dǎo)致物料成本上升更為要命的是由于不了解器件結(jié)構(gòu)更不了解與器件結(jié)構(gòu)緊密相關(guān)的設(shè)計(jì)技巧過分依賴綜合等工具工具不行自己也就束手無策導(dǎo)致問題遲遲不能解決從而嚴(yán)重影響開發(fā)周期導(dǎo)致開發(fā)成本急劇上升   目前我們的設(shè)計(jì)規(guī)模越來越龐大動輒上百萬門幾百萬門的電路屢見不鮮同時(shí)我們所采用的器件工藝越來越先進(jìn)已經(jīng)步入深亞微米時(shí)代而在對待深亞微米的器件上我們的設(shè)計(jì)方法將不可避免地發(fā)生變化要更多地關(guān)注以前很少關(guān)注的線延時(shí)我相信asic設(shè)計(jì)以后也會如此此時(shí)如果我們不在設(shè)計(jì)方法設(shè)計(jì)技巧上有所提高是無法面對這些龐大的基于深亞微米技術(shù)的電路設(shè)計(jì)而且現(xiàn)在的競爭越來越激勵(lì)從節(jié)約公司成本角度出 也要求我們盡可能在比較小的器件里完成比較多的功能   本文從澄清一些錯(cuò)誤認(rèn)識開始從FPGA器件結(jié)構(gòu)出發(fā)以速度路徑延時(shí)大小和面積資源占用率為主題描述在FPGA設(shè)計(jì)過程中應(yīng)當(dāng)注意的問題和可以采用的設(shè)計(jì)技巧本文對讀者的技能基本要求是熟悉數(shù)字電路基本知識如加法器計(jì)數(shù)器RAM等熟悉基本的同步電路設(shè)計(jì)方法熟悉HDL語言對FPGA的結(jié)構(gòu)有所了解對FPGA設(shè)計(jì)流程比較了解

    標(biāo)簽: Xilinx FPGA 華為 高級技巧

    上傳時(shí)間: 2013-11-06

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  • 擴(kuò)頻通信芯片STEL-2000A的FPGA實(shí)現(xiàn)

    針對傳統(tǒng)集成電路(asic)功能固定、升級困難等缺點(diǎn),利用FPGA實(shí)現(xiàn)了擴(kuò)頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實(shí)現(xiàn)NCO模塊,在下變頻模塊調(diào)用了硬核乘法器并引入CIC濾波器進(jìn)行低通濾波,給出了DQPSK解調(diào)的原理和實(shí)現(xiàn)方法,推導(dǎo)出一種簡便的引入?仔/4固定相移的實(shí)現(xiàn)方法。采用模塊化的設(shè)計(jì)方法使用VHDL語言編寫出源程序,在Virtex-II Pro 開發(fā)板上成功實(shí)現(xiàn)了整個(gè)系統(tǒng)。測試結(jié)果表明該系統(tǒng)正確實(shí)現(xiàn)了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of asic such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the DDS IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標(biāo)簽: STEL 2000 FPGA 擴(kuò)頻通信

    上傳時(shí)間: 2013-11-06

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  • 基于FPGA的手持設(shè)備MPU功耗解決方案

    在基于asic或FPGA的設(shè)計(jì)中,設(shè)計(jì)人員必須認(rèn)真考慮某些性能標(biāo)準(zhǔn),他們面臨的挑戰(zhàn)主要體現(xiàn)在面積、速度和功耗方面。  與asic一樣,供應(yīng)商在FPGA設(shè)計(jì)中也需要應(yīng)對面積和速度的挑戰(zhàn)。隨著門數(shù)不斷增加,F(xiàn)PGA需要更大的面積和尺寸來適應(yīng)更多的應(yīng)用,設(shè)計(jì)工具需要采用更好的算法以便更有效地利用面積。不斷演進(jìn)的FPGA技術(shù)也給設(shè)計(jì)人員帶來一系列新的挑戰(zhàn),電源利用率就是其中之一,這對于為手持或便攜式設(shè)備設(shè)計(jì)基于FPGA的嵌入式系統(tǒng)來說是急需解決的問題。

    標(biāo)簽: FPGA MPU 手持設(shè)備 功耗

    上傳時(shí)間: 2013-11-14

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