針對主控制板上存儲器(SRAM) 存儲的數據量小和最高頻率低的情況,提出了基于SDR Sdram(同步動態RAM) 作為主存儲器的LED 顯示系統的研究。在實驗中,使用了現場可編程門陣列( FPGA)
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sdram接口的vhdl實現,適用于lattice的FPGA,內含狀態機和各個模塊的具體實現...
FPGA設計的SDRAM控制器,有仿真代碼,已通過驗證...
DDR2 SDRAM 控制器的FPGA實現...
這個是一個基于FPGA的SDRAM控制器系統,實現對SDRAM的讀寫操作,用來實現時序的控制...
使用Verilog實現基于FPGA的SDRAM控制器...
FPGA讀寫SDRAM的VHDL程序,已經測試過...
基于FPGA的SDRAM控制器Verilog代碼,開發環境為Quartus6.1,控制SDRAM實現對同一片地址先寫后讀。...
該文檔為基于FPGA的SDRAM控制器的設計與實現簡介文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………...
基于FPGA設計的sdram讀寫測試實驗Verilog邏輯源碼Quartus工程文件+文檔說明,DRAM選用海力士公司的 HY57V2562 型號,容量為的 256Mbit,采用了 54 引腳的TSO...