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  • SNR boost ADC

    SNR boost是一種噪聲成型技術(shù)，該技術(shù)能夠改變量化噪聲的頻譜

    標(biāo)簽： boost SNR ADC

    上傳時(shí)間： 2013-10-17

    上傳用戶：894898248

  • 時(shí)鐘及定時(shí)指南-德州儀器

    時(shí)鐘及定時(shí)指南-德州儀器

    標(biāo)簽： 時(shí)鐘 定時(shí) 德州儀器

    上傳時(shí)間： 2013-10-08

    上傳用戶：kao21

  • 基于LMH6517的高性能DVGA設(shè)計(jì)

    本文介紹了LMH6517 可變增益放大器匹配電路和PCB 布局布線的設(shè)計(jì)指導(dǎo)，以及LMH6517 的主要特性和這些特性對于系統(tǒng)設(shè)計(jì)的幫助。

    標(biāo)簽： 6517 DVGA LMH 性能

    上傳時(shí)間： 2013-11-09

    上傳用戶：dragonhaixm

  • DAC3484,DAC34H84輸出功率定標(biāo)

    DAC3484 和DAC34H84 是德州儀器（Texas Instruments）新推出的低功耗，高密度，高采樣率，高性能的數(shù)模轉(zhuǎn)換芯片，這款芯片目前已經(jīng)廣泛的應(yīng)用在通信行業(yè)。本文詳細(xì)介紹了DAC3484，DAC34H84 與正交調(diào)制器的輸出接口以及輸出功率定標(biāo)的計(jì)算問題。

    標(biāo)簽： DAC 3484 34 84

    上傳時(shí)間： 2013-10-18

    上傳用戶：sun_pro12580

  • 非均勻采樣的頻譜研究

    非均勻采樣的一個(gè)很大的優(yōu)點(diǎn)就是它具有抗頻率混疊的性能[ ]，首先從均勻采樣討論由采樣而引起的頻譜混疊現(xiàn)象，在均勻采樣和非均勻采樣的頻譜圖對比中討論兩種采樣方式引起的不同的頻譜混疊現(xiàn)象，從對比中分析非均勻采樣方式的優(yōu)勢。從最簡單的非均勻采樣方法逐步深入到完全隨機(jī)的非均勻采樣方法，研究由于采樣方法的改變對數(shù)字信號頻譜的影響。最后可以看到非均勻采樣的方法可以將混疊信號的頻譜降低到完全不影響對真實(shí)信號的檢測。

    標(biāo)簽： 采樣 頻譜

    上傳時(shí)間： 2013-11-11

    上傳用戶：baby25825

  • L波段捷變頻收發(fā)前端設(shè)計(jì)仿真

    針對應(yīng)用于信息戰(zhàn)的數(shù)據(jù)鏈而言，L波段收發(fā)前端是其關(guān)鍵部件之一。本文介紹了一種基于DDS的捷變頻收發(fā)前端的理論分析、設(shè)計(jì)思路和基本構(gòu)成。從接收鏈路、發(fā)射鏈路以及捷變頻本振等方面進(jìn)行分析，并給出仿真結(jié)果。該組件具有低噪聲、高密度、捷變頻等特點(diǎn)。

    標(biāo)簽： L波段 捷變 前端設(shè)計(jì) 仿真

    上傳時(shí)間： 2013-10-31

    上傳用戶：dgann

  • 基于映射函數(shù)收縮算法的圖像去噪方法

    文中討論了圖像的高斯加性噪聲模型和圖像的稀疏性表示，提出了利用映射函數(shù)來描述圖像的去噪過程，通過求解映射函數(shù)和利用映射函數(shù)對加噪圖像的小波變換子帶系數(shù)進(jìn)行變換，達(dá)到了降低圖像噪聲并使加噪圖像逼近原始圖像的目的。經(jīng)過實(shí)驗(yàn)比較，驗(yàn)證了本文算法的可行性和魯棒性。

    標(biāo)簽： 映射 函數(shù) 圖像去噪 算法

    上傳時(shí)間： 2013-10-21

    上傳用戶：許小華

  • 基于CORDIC算法的高速ODDFS電路設(shè)計(jì)

    為了滿足現(xiàn)代高速通信中頻率快速轉(zhuǎn)換的需求，基于坐標(biāo)旋轉(zhuǎn)數(shù)字計(jì)算（CORDIC，Coordinate Rotation Digital Computer）算法完成正交直接數(shù)字頻率合成（ODDFS，Orthogonal Direct Digital Frequency Synthesizer）電路設(shè)計(jì)方案。采用MATLAB和Xilinx System Generator開發(fā)工具搭建電路的系統(tǒng)模型，通過現(xiàn)場可編程門陣列（FPGA，F(xiàn)ield Programmable Gate Array）完成電路的寄存器傳輸級（RTL，Register Transfer Level）驗(yàn)證，仿真結(jié)果表明電路設(shè)計(jì)具有很高的有效性和可行性。

    標(biāo)簽： CORDIC ODDFS 算法 電路設(shè)計(jì)

    上傳時(shí)間： 2013-11-09

    上傳用戶：hfnishi

  • 階躍阻抗濾波器及其倍頻應(yīng)用

    階躍阻抗諧振結(jié)構(gòu)（SIR）是一種新型微帶線結(jié)構(gòu)，它具有小型化，尺寸易調(diào)整，寄生諧振頻率可調(diào)等優(yōu)勢。本文利用一種半波長階躍阻抗諧振結(jié)構(gòu)設(shè)計(jì)了兩個(gè)不同尺寸發(fā)卡形濾波器，獲得同樣優(yōu)秀的性能指標(biāo)。而后利用此類濾波器完成了一個(gè)倍頻電路的設(shè)計(jì)并且達(dá)到預(yù)期要求。

    標(biāo)簽： 階躍 濾波器 倍頻 阻抗

    上傳時(shí)間： 2013-10-22

    上傳用戶：zchpr@163.com

  • 基于ATF54143平衡式低噪聲放大器的設(shè)計(jì)

    基于低噪聲放大器（LNA）的噪聲系數(shù)和駐波比之間的矛盾，本文采用安捷倫公司的ATF54143晶體管計(jì)了一款工作于890~960 MHz平衡式低噪聲放大器。該設(shè)計(jì)分為兩部分：3 dB 90°相移定向耦合器和并聯(lián)的低噪聲放大器。本文中首先介紹LNA相關(guān)理論，然后通過安捷倫公司的ADS仿真軟件進(jìn)行電路仿真，仿真結(jié)果滿足設(shè)計(jì)要求，達(dá)到了低噪聲系數(shù)和良好地駐波比要求。此文也為后面電路的設(shè)計(jì)和調(diào)試提供了理論支持。

    標(biāo)簽： 54143 ATF 平衡式 低噪聲放大器

    上傳時(shí)間： 2013-11-02

    上傳用戶：410805624

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