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pcb layout

  • pcb_layout_的指導(dǎo)思想與基本走線要求

    pcb layout時,可以參照這些資料,介紹PCB布線以及畫PCB時的一些常用規(guī)則,畫出一塊優(yōu)質(zhì)的PCB,當(dāng)然,按照實際需要,也可以自由變通這是一個完整的PCB Layout設(shè)計規(guī)則,文章從元器件的布局到元件排列,再到導(dǎo)線布線,以及線寬及間距這些,還有的是焊盤,都做了詳細(xì)的分析以下是詳細(xì)內(nèi)容:

    標(biāo)簽: pcb_layout 走線

    上傳時間: 2013-10-28

    上傳用戶:xyipie

  • pcb layout圖文教程終結(jié)版

    制作此教程的目的旨在學(xué)習(xí), 網(wǎng)上也有很多講的比較好的教程,此做并不是想跟他們比什么,希望此教程能對大家學(xué)習(xí)有所幫助。每個教程講的內(nèi)容不盡相同,希望此教程能夠幫助大家快速學(xué)習(xí)Alitum Designer、PADS 和Cadence。

    標(biāo)簽: Layout PCB 圖文教程

    上傳時間: 2014-01-14

    上傳用戶:q986086481

  • 神速-三天學(xué)會PADS pcb layout

    絕對有用的資料

    標(biāo)簽: Layout PADS PCB

    上傳時間: 2013-10-21

    上傳用戶:ardager

  • pcb layout指南

    一般規(guī)則 元器件放置 . 信號走線 電源 地線 晶振

    標(biāo)簽: Layout PCB

    上傳時間: 2013-10-18

    上傳用戶:dvfeng

  • pcb layout DIY封裝庫

    Altium Designer下的封裝庫,整個庫都是項目的積累,所有元件都通過項目測試,可靠快捷。此刻上傳,奉獻(xiàn)給大家,希望能不讓更多的人受益。。。

    標(biāo)簽: Layout PCB DIY 封裝庫

    上傳時間: 2013-11-12

    上傳用戶:tfyt

  • SM320 pcb layout GUIDELINES

    Silicon Motion, Inc. has made best efforts to ensure that the information contained in this document is accurate andreliable. However, the information is subject to change without notice. No responsibility is assumed by SiliconMotion, Inc. for the use of this information, nor for infringements of patents or other rights of third parties.Copyright NoticeCopyright 2002, Silicon Motion, Inc. All rights reserved. No part of this publication may be reproduced, photocopied,or transmitted in any form, without the prior written consent of Silicon Motion, Inc. Silicon Motion, Inc. reserves theright to make changes to the product specification without reservation and without notice to our users

    標(biāo)簽: GUIDELINES LAYOUT 320 PCB

    上傳時間: 2014-12-24

    上傳用戶:zhaistone

  • DN385 10A高性能點的負(fù)載DC/DC微型模塊

      Advancements in board assembly, pcb layout anddigital IC integration have produced a new generationof densely populated, high performance systems. Theboard-mounted point-of-load (POL) DC/DC power suppliesin these systems are subject to the same demandingsize, high power and performance requirements asother subsystems. The rigorous new POL demands aredifficult to meet with traditional controller or regulatorICs, or power modules.

    標(biāo)簽: DC 385 10A DN

    上傳時間: 2014-12-24

    上傳用戶:lbbyxmraon

  • DUAL DIGITAL ISOLATORS

    The ISO7220 and ISO7221 are dual-channel digital isolators. To facilitate pcb layout, the channels are orientedin the same direction in the ISO7220 and in opposite directions in the ISO7221. These devices have a logic inputand output buffer separated by TI’s silicon-dioxide (SiO2) isolation barrier, providing galvanic isolation of up to4000 V. Used in conjunction with isolated power supplies, these devices block high voltage, isolate grounds, andprevent noise currents on a data bus or other circuits from entering the local ground and interfering with ordamaging sensitive circuitry.

    標(biāo)簽: ISOLATORS DIGITAL DUAL

    上傳時間: 2013-10-24

    上傳用戶:hbsunhui

  • 基于CPLD與FPGA的多串口設(shè)計

    1 無線射頻,手機(jī)電路,電視家電,信號處理,電源電路等電路圖應(yīng)有盡有。 2 PCB使用教程,PCB使用技巧,PCB布線規(guī)則,pcb layout經(jīng)驗資料豐富精彩。 3 各類電子課件,電子教材,測量儀表,嵌入式技術(shù),制造技術(shù)收藏資料。 4 IC中文資料,IC datasheet,規(guī)則標(biāo)準(zhǔn), 網(wǎng)上查不到,這里找的到。

    標(biāo)簽: CPLD FPGA 多串口

    上傳時間: 2013-11-11

    上傳用戶:kangqiaoyibie

  • FPGA連接DDR2的問題討論

    我采用XC4VSX35或XC4VLX25 FPGA來連接DDR2 SODIMM和元件。SODIMM內(nèi)存條選用MT16HTS51264HY-667(4GB),分立器件選用8片MT47H512M8。設(shè)計目標(biāo):當(dāng)客戶使用內(nèi)存條時,8片分立器件不焊接;當(dāng)使用直接貼片分立內(nèi)存顆粒時,SODIMM內(nèi)存條不安裝。請問專家:1、在設(shè)計中,先用Xilinx MIG工具生成DDR2的Core后,管腳約束文件是否還可更改?若能更改,則必須要滿足什么條件下更改?生成的約束文件中,ADDR,data之間是否能調(diào)換? 2、對DDR2數(shù)據(jù)、地址和控制線路的匹配要注意些什么?通過兩只100歐的電阻分別連接到1.8V和GND進(jìn)行匹配 和 通過一只49.9歐的電阻連接到0.9V進(jìn)行匹配,哪種匹配方式更好? 3、V4中,pcb layout時,DDR2線路阻抗單端為50歐,差分為100歐?Hyperlynx仿真時,那些參數(shù)必須要達(dá)到那些指標(biāo)DDR2-667才能正常工作? 4、 若使用DDR2-667的SODIMM內(nèi)存條,能否降速使用?比如降速到DDR2-400或更低頻率使用? 5、板卡上有SODIMM的插座,又有8片內(nèi)存顆粒,則物理上兩部分是連在一起的,若實際使用時,只安裝內(nèi)存條或只安裝8片內(nèi)存顆粒,是否會造成信號完成性的影響?若有影響,如何控制? 6、SODIMM內(nèi)存條(max:4GB)能否和8片分立器件(max:4GB)組合同時使用,構(gòu)成一個(max:8GB)的DDR2單元?若能,則布線阻抗和FPGA的DCI如何控制?地址和控制線的TOP圖應(yīng)該怎樣? 7、DDR2和FPGA(VREF pin)的參考電壓0.9V的實際工作電流有多大?工作時候,DDR2芯片是否很燙,一般如何考慮散熱? 8、由于多層板疊層的問題,可能頂層和中間層的銅箔不一樣后,中間的夾層后度不一樣時,也可能造成阻抗的不同。請教DDR2-667的SODIMM在8層板上的推進(jìn)疊層?

    標(biāo)簽: FPGA DDR2 連接 問題討論

    上傳時間: 2013-10-12

    上傳用戶:han_zh

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