美女视频黄a大片欧美 ,亚洲欧美综合区自拍另类,9999精品

qUARTus-II

入侵檢測系統(tǒng)的網(wǎng)絡(luò)包分類技術(shù)研究

基于FPGA技術(shù)的網(wǎng)絡(luò)入侵檢測是未來的發(fā)展方向，而網(wǎng)絡(luò)包頭的分類是入侵檢測系統(tǒng)的關(guān)鍵。文章首先介紹了FPGA技術(shù)的基本原理以及其在信息安全方面的應(yīng)用，接著介紹入侵檢測系統(tǒng)以及FPGA技術(shù)在入侵檢測系統(tǒng)中的應(yīng)用。分析了幾種比較出名的網(wǎng)絡(luò)包分類算法，包括軟件分類方法、TCAM分類算法、BV算法、Tree Bitmap算法以及端口范圍分類算法。在此基礎(chǔ)上，文章設(shè)計(jì)了一個基于FPGA技術(shù)的入侵檢測系統(tǒng)包分類的基本框架圖，實(shí)現(xiàn)框架圖中的各個基本功能模塊。在實(shí)現(xiàn)過程中，提出了一類結(jié)合三態(tài)內(nèi)容可尋址內(nèi)存(TCAM)和普通存儲器(RAM)的網(wǎng)絡(luò)包包頭分類方案。我們將檢測規(guī)則編號并位圖化，使用RAM存儲與包頭結(jié)構(gòu)相關(guān)的規(guī)則位圖，通過TCAM上的數(shù)據(jù)匹配操作，快速關(guān)聯(lián)待分析的網(wǎng)絡(luò)數(shù)據(jù)包與入侵檢測規(guī)則。文章還討論了網(wǎng)包頭分類方法的優(yōu)化算法，將優(yōu)化算法與未優(yōu)化算法在速度和空間上進(jìn)行比較。此外，還討論了對Snort的規(guī)則庫進(jìn)行整理和規(guī)則化的問題。最后，對所設(shè)計(jì)的包頭分類匹配模塊在Quartus II進(jìn)行仿真評估，將實(shí)驗(yàn)結(jié)果與已有的一些分類算法進(jìn)行了比較。結(jié)果說明，本設(shè)計(jì)在匹配速度和更新速度上有優(yōu)勢，但消耗了較多的存儲空間．

標(biāo)簽： 入侵檢測系統(tǒng) 網(wǎng)絡(luò) 包分類技術(shù)研究

上傳時間： 2013-07-17

上傳用戶：gonuiln
QuartusII_5_0.rar

Quartus II 軟件5.0在高密度FPGA設(shè)計(jì)上具有性能和效率領(lǐng)先優(yōu)勢。此版本首次展示了業(yè)內(nèi)編譯增強(qiáng)技術(shù)以及多種新的高密度設(shè)計(jì)高效特性。 Quartus II軟件5.0的新特性和增強(qiáng)功能包括：編譯和時序逼近的增強(qiáng)特性編譯增強(qiáng)特性縮短近70％編譯時間編譯增強(qiáng)特性使設(shè)計(jì)人員能夠根據(jù)綜合和適配的需要，將設(shè)計(jì)劃分為物理和邏輯分區(qū)，在特定設(shè)計(jì)分區(qū)上實(shí)施物理綜合等高級優(yōu)化技術(shù)，保持其他模塊性能不變，從而提高時序逼近效率。SignalTap? II 嵌入式邏輯分析儀也可以采用該技術(shù)加速實(shí)現(xiàn)驗(yàn)證迭代。時

標(biāo)簽： QuartusII

上傳時間： 2013-06-06

上傳用戶：dapangxie
全數(shù)字OQPSK解調(diào)算法的研究及FPGA實(shí)現(xiàn)

隨著各種通信系統(tǒng)數(shù)量的日益增多，為了充分地利用有限的頻譜資源，高頻譜利用率的調(diào)制技術(shù)不斷被應(yīng)用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡(luò)調(diào)制技術(shù)，具有較高的頻譜利用率和功率利用率，廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)和地面移動通信系統(tǒng)。因此，對于OQPSK全數(shù)字解調(diào)技術(shù)的研究具有一定的理論價值。本文以軟件無線電和全數(shù)字解調(diào)的相關(guān)理論為指導(dǎo)，成功設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的OQPSK全數(shù)字解調(diào)。論文介紹了OQPSK全數(shù)字接收解調(diào)原理和基于軟件無線電設(shè)計(jì)思想的全數(shù)字接收機(jī)的基本結(jié)構(gòu)，詳細(xì)闡述了當(dāng)今OQPSK數(shù)字解調(diào)中載波頻率同步、載波相位同步、時鐘同步和數(shù)據(jù)幀同步的一些常用算法，并選擇了相應(yīng)算法構(gòu)建了三種系統(tǒng)級的實(shí)現(xiàn)方案。通過MATLAB對解調(diào)方案的仿真和性能分析，確定了FPGA中的系統(tǒng)實(shí)現(xiàn)方案。在此基礎(chǔ)上，本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發(fā)平臺上設(shè)計(jì)了同步解調(diào)系統(tǒng)中的各個模塊，還對各模塊和整個系統(tǒng)在ModelSim中進(jìn)行了時序仿真驗(yàn)證，并對設(shè)計(jì)中出現(xiàn)的問題進(jìn)行了修正。最后，經(jīng)過FPGA調(diào)試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實(shí)際測試，本文對系統(tǒng)方案進(jìn)行了最終的改進(jìn)與調(diào)整。實(shí)際測試結(jié)果表明，本文的設(shè)計(jì)最終能夠達(dá)到了預(yù)期的指標(biāo)和要求。本課題設(shè)計(jì)經(jīng)過時序和資源優(yōu)化后還可以向ASIC和系統(tǒng)級SOC轉(zhuǎn)化，以進(jìn)一步縮小系統(tǒng)體積、降低成本和提高電路的可靠性，因此具有良好的實(shí)際應(yīng)用價值。

標(biāo)簽： OQPSK FPGA 全數(shù)字解調(diào)

上傳時間： 2013-07-14

上傳用戶：aappkkee
基于FPGA的數(shù)字頻率計(jì)的設(shè)計(jì)與實(shí)現(xiàn)

介紹了一種運(yùn)用FPGA開發(fā)軟件Quartus II設(shè)計(jì)的數(shù)字頻率計(jì)。該數(shù)字頻率計(jì)的1 Hz～1 MHz輸入被測脈沖信號具有頻率測量、周期測量、脈寬測量和占空比測量等多種用途，其測試結(jié)果由3 只七段數(shù)碼

標(biāo)簽： FPGA 數(shù)字頻率計(jì)

上傳時間： 2013-05-22

上傳用戶：qb1993225
DSP Builder　10.10

對于CPLD、FPGA和HardCopy? ASIC設(shè)計(jì)，Quartus? II軟件10.1是業(yè)界性能和效能首屈一指的軟件，現(xiàn)在可以下載。這一最新版軟件引入了Qsys，它是功能強(qiáng)大的系統(tǒng)集成新工具。在Quartus II訂購版軟件10.1中以beta版的形式提供Qsys，它提高了系統(tǒng)開發(fā)速度，支持設(shè)計(jì)重用，從而縮短了FPGA設(shè)計(jì)過程，減輕了工作量。

標(biāo)簽： Builder 10.10 DSP

上傳時間： 2013-06-10

上傳用戶：yd19890720
Altera-jtag0

首先安裝Quartus II 10.0 SP1(默認(rèn)是32/64-Bit一起安裝)：此軟件在Windows XP和Windows 7的32/64位操作系統(tǒng)下都驗(yàn)證過了，沒有問題！Windows Vista 32/64因?yàn)槲④浂挤艞壛耍詻]有驗(yàn)證，理論上應(yīng)該可以正常使用。

標(biāo)簽： Altera-jtag

上傳時間： 2013-04-24

上傳用戶：hhkpj
QuartusII Web Edtition 10.1 0

"Quartus II設(shè)計(jì)軟件是Altera提供的完整的多平臺設(shè)計(jì)環(huán)境，能夠直接滿足特定設(shè)計(jì)需要，為可編程芯片系統(tǒng)（SOPC）提供全面的設(shè)計(jì)環(huán)境。"

標(biāo)簽： QuartusII Edtition 10.1 Web

上傳時間： 2013-06-07

上傳用戶：奈雁歸dxh
神經(jīng)網(wǎng)絡(luò)PID飛行控制算法的FPGA實(shí)現(xiàn)

神經(jīng)網(wǎng)絡(luò)控制算法作為一種比較成熟的智能控制算法，在空空導(dǎo)彈的理論研究中也得到了很多應(yīng)用，但它的實(shí)際應(yīng)用通常是通過軟件實(shí)現(xiàn)的，而軟件實(shí)現(xiàn)是串行執(zhí)行指令，運(yùn)行速度慢，可靠性低，很難滿足實(shí)際導(dǎo)彈制導(dǎo)系統(tǒng)實(shí)時性的要求。控制算法硬件實(shí)現(xiàn)的最大特點(diǎn)就是可提高控制算法的實(shí)時運(yùn)算速度和可靠性。本課題針對導(dǎo)彈制導(dǎo)系統(tǒng)，以FPGA為硬件平臺研究神經(jīng)網(wǎng)絡(luò)控制算法的硬件實(shí)現(xiàn)。本文首先對BP神經(jīng)網(wǎng)絡(luò)算法思想進(jìn)行了深入分析，并對BP網(wǎng)絡(luò)的各個階段進(jìn)行了理論推導(dǎo)，最后對BP神經(jīng)網(wǎng)絡(luò)PID飛行控制算法進(jìn)行了研究和總結(jié)，為硬件實(shí)現(xiàn)提供了理論基礎(chǔ)。基于對上述理論的深入研究和分析，本文提出了一種適合FPGA實(shí)現(xiàn)該神經(jīng)網(wǎng)絡(luò)控制算法的硬件實(shí)現(xiàn)模型。在該模型中，神經(jīng)網(wǎng)絡(luò)各層之間采用串行執(zhí)行數(shù)據(jù)方式，層間則采用并行運(yùn)行方式，可有效提高系統(tǒng)的運(yùn)算速度。由于模塊化、層次化的自頂向下的模塊化設(shè)計(jì)方法可有效減少錯誤的產(chǎn)生，是設(shè)計(jì)復(fù)雜大規(guī)模系統(tǒng)的理想設(shè)計(jì)方法。本文采用了此設(shè)計(jì)方法，通過把系統(tǒng)模塊化，對各個子模塊分別用VHDL硬件描述語言進(jìn)行描述，并基于QUARTUS II軟件開發(fā)平臺進(jìn)行綜合和仿真，直到達(dá)到研究設(shè)計(jì)要求。最后將仿真程序源代碼下載配置到具體的Cyclone II系列EP2C70 FPGA芯片中,應(yīng)用于某實(shí)際導(dǎo)彈控制系統(tǒng)的研究。理論分析和實(shí)驗(yàn)結(jié)果表明該神經(jīng)網(wǎng)絡(luò)飛行控制算法的FPGA硬件實(shí)現(xiàn)是有效可行的，可滿足系統(tǒng)實(shí)時性的要求，為制導(dǎo)系統(tǒng)的實(shí)際工程實(shí)現(xiàn)提供了基礎(chǔ)。

標(biāo)簽： FPGA PID 神經(jīng)網(wǎng)絡(luò) 飛行控制

上傳時間： 2013-04-24

上傳用戶：冇尾飛鉈
Quartus_II_9.0破解器.rar

#首先安裝Quartus II 9.0 (32-Bit)： #用Quartus_II_9.0破解器.exe破解C:\altera\90\quartus\bin下的sys_cpt.dll和quartus.exe文件（運(yùn)行Quartus_II_9.0破解器.exe后,直接點(diǎn)擊“應(yīng)用補(bǔ)丁”，如果出現(xiàn)“未找到該文件。搜索該文件嗎？”，點(diǎn)擊“是”，（如果直接把該破解器Copy到C:\altera\90\quartus\bin下，就不會出現(xiàn)這個對話框，而是直接開始破解！）然后選中sys_cpt.dll，點(diǎn)擊“打開”。安裝默認(rèn)的sys_cpt.dll路徑是在C:\altera\90\quartus\bin下）。 #把license.dat里的XXXXXXXXXXXX 用您老的網(wǎng)卡號替換(在Quartus II 9.0的Tools菜單下選擇License Setup，下面就有NIC ID)。 #在Quartus II 9.0的Tools菜單下選擇License Setup，然后選擇License file，最后點(diǎn)擊OK。 #注意：license文件存放的路徑名稱不能包含漢字和空格，空格可以用下劃線代替。 #僅限于學(xué)習(xí),不要用于商業(yè)目的! 嚴(yán)禁貼到網(wǎng)上！！！

標(biāo)簽： Quartus_II 9.0 破解

上傳時間： 2013-04-24

上傳用戶：zhuoying119
FPGA開發(fā)光盤各章節(jié)實(shí)例的設(shè)計(jì)工程與源碼

附錄光盤說明\r\n本書附贈的光盤包括各章節(jié)實(shí)例的設(shè)計(jì)工程與源碼，所有工程在下列軟件環(huán)境下運(yùn)行通過：\r\n? Windows XP SP2\r\n? MATLAB\r\n? Altera Quartus II \r\n? synplify8.4\r\n? modelsim_ae6.1\r\n\r\n光盤目錄與實(shí)例名稱的對應(yīng)關(guān)系如下：\r\n\r\n cht02文件夾中存放的是書中第2章中的例子，讀者可以將一些簡單例子的代碼 \r\n拷貝到MATLAB命令窗口進(jìn)行運(yùn)行，也可以把

標(biāo)簽： FPGA 發(fā)光工程源碼

上傳時間： 2013-08-11

上傳用戶：ecooo